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片上芯片SoC挑戰(zhàn)傳統(tǒng)測試方案

  • SoC廠商如何在提高復(fù)雜器件傳輸速度的同時(shí)降低測試成本?隨著先進(jìn)的集成電路(IC)設(shè)計(jì)方法和高密度生產(chǎn)技術(shù)的使用，半導(dǎo)體廠商能夠把不同的數(shù)字和模擬電路集成在極小芯片上，其尺寸之小、功能之全尚無先例，我們稱之為
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基于FPGA的DSP功能提高圖像處理的實(shí)例分析

  • 電子產(chǎn)品世界,為電子工程師提供全面的電子產(chǎn)品信息和行業(yè)解決方案,是電子工程師的技術(shù)中心和交流中心,是電子產(chǎn)品的市場中心,EEPW 20年的品牌歷史,是電子工程師的網(wǎng)絡(luò)家園
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基于FPGA視頻圖像的Canny算法加速器的設(shè)計(jì)

  • 摘要：由于Canny算法自身的復(fù)雜性，使得其做邊緣檢測的處理時(shí)間較長。針對(duì)這個(gè)問題，提出和實(shí)現(xiàn)了一種Canny算法的硬件加速功能。加速功能的設(shè)計(jì)是以FPGA為硬件基礎(chǔ)，并采用了流水線技術(shù)來對(duì)系統(tǒng)的結(jié)構(gòu)改進(jìn)和優(yōu)化。最
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基于FPGA的圖像傳感器驅(qū)動(dòng)的設(shè)計(jì)方案

  • 汽車在給人們生活帶來便利的同時(shí)也帶來了交通事故。其中超速行駛是造成交通事故的重要隱患之一。據(jù)研究表明，目前針對(duì)車輛超速行駛情況的道路抓拍系統(tǒng)中所使用的圖像傳感器大多為小面陣器件，普遍為100萬～200萬像素
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星載環(huán)境FPGA軟件在軌重加載的一種方法

  • 摘要：FPGA在空間系統(tǒng)中已經(jīng)廣泛應(yīng)用，為了滿足系統(tǒng)可靠性和可擴(kuò)展性的要求，實(shí)現(xiàn)FPGA軟件的在軌重加載迫在眉睫。根據(jù)FPGA的加載配置原理，以Xilinx公司的Virtex-Ⅱ系列FPGA為實(shí)例，介紹了FPGA在軌重加載的硬件電路設(shè)
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復(fù)雜性提升，視覺創(chuàng)意火，師生熱情高

  • 5月底6月初，“英特爾杯大學(xué)生電子設(shè)計(jì)競賽·嵌入式系統(tǒng)專題邀請(qǐng)賽”(簡稱嵌入式系統(tǒng)專題邀請(qǐng)賽)組委會(huì)走訪了部分華中、華東地區(qū)大學(xué)，從中可以看出此次競賽的特點(diǎn)。為此，本刊訪問了邀請(qǐng)賽組委會(huì)及英特爾(中國)公司的負(fù)責(zé)人。
  • 關(guān)鍵字： 英特爾  嵌入式  FPGA  201207  

采用FPGA解決DSP設(shè)計(jì)難題

基于FPGA的任意波形發(fā)生器設(shè)計(jì)與研究

  • 標(biāo)簽：FPGA DDS任意波形發(fā)生器( Arbit rary Waveform Generato r,AWG) 是一種多波型的信號(hào)發(fā)生器， 它不僅能產(chǎn)生正弦波、指數(shù)波等常規(guī)波形， 也可以表現(xiàn)出載波調(diào)制的多樣化， 如： 產(chǎn)生調(diào)頻、調(diào)幅、調(diào)相和脈沖調(diào)制
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嵌入式邏輯分析儀在FPGA時(shí)序匹配設(shè)計(jì)中的應(yīng)用

  • 引言隨著FPGA器件規(guī)模的不斷增加、封裝密度不斷提高，傳統(tǒng)邏輯分析儀在FPGA板級(jí)調(diào)試中的應(yīng)用日益困難。為此，主流FPGA廠商相繼在其開發(fā)工具中增加了嵌入式邏輯分析儀(ELA) IP軟核，如Lattice在ispLEVER中提供的ispTR
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FPGA平臺(tái)的實(shí)時(shí)圖像處理系統(tǒng)設(shè)計(jì)

  • 摘要：本文提出了一種基于FPGA的實(shí)時(shí)圖像處理系統(tǒng)設(shè)計(jì)方案。介紹了系統(tǒng)硬件結(jié)構(gòu)設(shè)計(jì)和器件選型方案。并著重介紹了FPGA內(nèi)部功能模塊的設(shè)計(jì)，使整個(gè)處理系統(tǒng)既可支持大數(shù)據(jù)量的實(shí)時(shí)傳輸，又能滿足圖像數(shù)據(jù)實(shí)時(shí)處理的需要。
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對(duì)基于SoC系統(tǒng)設(shè)計(jì)的探查

  • 對(duì)基于SoC系統(tǒng)設(shè)計(jì)的探查,調(diào)試復(fù)雜電子系統(tǒng)從來都不是一項(xiàng)簡單的工作，但至少是可以實(shí)現(xiàn)的。您要找到問題所在。采用您最相信的“示波器”，通過模擬電路到數(shù)字轉(zhuǎn)換，您可以追溯到問題的源頭。然后，編寫測試小程序，檢查驅(qū)動(dòng)和外設(shè)
  • 關(guān)鍵字： 探查  設(shè)計(jì)  系統(tǒng)  SoC  基于  

采用FPGA的片上系統(tǒng)和嵌入式系統(tǒng)的遠(yuǎn)程監(jiān)控系統(tǒng)介紹

  • 采用FPGA的片上系統(tǒng)和嵌入式系統(tǒng)的遠(yuǎn)程監(jiān)控系統(tǒng)介紹,本系統(tǒng)立足于利用Intemet實(shí)現(xiàn)核環(huán)境信息的遠(yuǎn)程采集。在實(shí)現(xiàn)上，采用了基于SOPC技術(shù)的嵌入式解決方案，通過在FPGA中嵌入NioslI軟核處理器和所需外設(shè)的IP Core(硅知識(shí)產(chǎn)權(quán)核)，然后再配備相應(yīng)的網(wǎng)絡(luò)接口，實(shí)現(xiàn)利用互聯(lián)
  • 關(guān)鍵字： 系統(tǒng)  監(jiān)控系統(tǒng)  介紹  遠(yuǎn)程  嵌入式  FPGA  采用  

基于FPGA芯片的GPS信號(hào)源的設(shè)計(jì)方案介紹

  • 基于FPGA芯片的GPS信號(hào)源的設(shè)計(jì)方案介紹,頻率合成器是發(fā)射系統(tǒng)和接收系統(tǒng)中的核心器件，采用相位負(fù)反饋頻率控制技術(shù)，具有良好的窄帶載波跟蹤性能和帶寬調(diào)制跟蹤性能，為系統(tǒng)上、下變頻提供本振信號(hào)，對(duì)相位噪聲和雜散具有很好的抑制作用，通過鎖相頻率合成
  • 關(guān)鍵字： 設(shè)計(jì)  方案  介紹  信號(hào)源  GPS  FPGA  芯片  基于  

基于LabVIEW FPGA模塊的FIFO深度設(shè)定實(shí)現(xiàn)

  • 為了解決基于LabVIEWFPGA模塊的DMAFIFO深度設(shè)定不當(dāng)帶來的數(shù)據(jù)不連續(xù)問題，結(jié)合LabVIEWFPGA的編程特點(diǎn)和DMA FIFO的工作原理，提出了一種設(shè)定FIFO深度的方法。對(duì)FIFO不同深度的實(shí)驗(yàn)表明，采用該方法設(shè)定的FIFO深度能夠
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基于DSP與FPGA的高精度數(shù)據(jù)采集系統(tǒng)設(shè)計(jì)

  • 電子產(chǎn)品世界,為電子工程師提供全面的電子產(chǎn)品信息和行業(yè)解決方案,是電子工程師的技術(shù)中心和交流中心,是電子產(chǎn)品的市場中心,EEPW 20年的品牌歷史,是電子工程師的網(wǎng)絡(luò)家園
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fpga soc介紹

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