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fpga ip 文章 最新資訊

賽靈思28納米FPGA明年量產(chǎn)　強(qiáng)攻ASIC陣地

  • 　　現(xiàn)場可編程邏輯閘陣列芯片(FPGA)近年來加速取代特殊應(yīng)用芯片(ASIC)市場，F(xiàn)PGA雙雄賽靈思(Xilinx)與阿爾特拉(Altera)先后推出28納米FPGA產(chǎn)品，可望加速FPGA取代ASIC市場，賽靈思亞太區(qū)營銷及應(yīng)用總監(jiān)張宇清指出，28納米FPGA可大幅提升效能，并降低功耗與價(jià)格，拓展以往FPGA無法取代的ASIC市場，加速FPGA 市場的成長力道。 　　張宇清指出，F(xiàn)PGA要取代ASIC市場有4大障礙，包括需要提高更大的容量、更高的系統(tǒng)效能、更低的功耗與更低的成本，過去在40納米雖然已有
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FPGA與DSP信號處理系統(tǒng)的散熱設(shè)計(jì)

  • FPGA與DSP信號處理系統(tǒng)的散熱設(shè)計(jì),引言
    隨著系統(tǒng)性能的不斷提升，系統(tǒng)功耗也隨之增大，如何對系統(tǒng)進(jìn)行有效的散熱，控制系統(tǒng)溫度滿足芯片的正常工作條件變成了一個(gè)十分棘手的問題。通常使用風(fēng)冷技術(shù)對系統(tǒng)進(jìn)行散熱。采用風(fēng)冷技術(shù)時(shí)要重點(diǎn)考慮散熱
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高速突發(fā)模式誤碼測試儀的FPGA實(shí)現(xiàn)方案

  • 摘要：突發(fā)模式誤碼測試儀與一般連續(xù)誤碼測試儀不同，其接收端在誤碼比對前要實(shí)現(xiàn)在十幾位內(nèi)，對具有相位跳變特點(diǎn)的信號進(jìn)行時(shí)鐘提取和數(shù)據(jù)恢復(fù)，并且在誤碼比對時(shí)須濾除前導(dǎo)碼和定界符，僅對有效數(shù)據(jù)進(jìn)行誤碼統(tǒng)計(jì)。
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基于FPGA的UART設(shè)計(jì)與實(shí)現(xiàn)

  • 介紹了應(yīng)用現(xiàn)場可編程門陣列(FPGA)設(shè)計(jì)和實(shí)現(xiàn)通用異步收發(fā)器UART的方法。采用有限狀態(tài)機(jī)模型形式化描述了UART的功能，在此基礎(chǔ)上用硬件描述語言VHDL編程實(shí)現(xiàn)了UART，并使用QuartusⅡ軟件中的嵌入式邏輯分析儀SignalTapⅡ?qū)?shù)據(jù)傳輸進(jìn)行了檢測，驗(yàn)證了設(shè)計(jì)的正確性。
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quartus的IP仿真出錯(cuò)解決方案

  • quartus的IP仿真出錯(cuò)解決方案,大家都知道quartus的IP可以直接拿來用的，大大節(jié)省了開發(fā)時(shí)間，而且其代碼是絕對優(yōu)化的；所有的前奏都操作成功，設(shè)置沒什么問題，開始對生成的fft.vhd文件進(jìn)行編譯，點(diǎn)擊Start Compilation，第一感覺：慢！編譯很慢，
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基于FPGA的短波發(fā)射機(jī)自動調(diào)諧系統(tǒng)的設(shè)計(jì)

CDMA無線終端TCP／IP協(xié)議

  • CDMA是無線通信領(lǐng)域的后起之秀，采用頻分編碼技術(shù)，與基于時(shí)分復(fù)用的GSM相比具有明顯優(yōu)勢。CDMA能夠?qū)崿F(xiàn)從現(xiàn)有通信系統(tǒng)到下一代通信系統(tǒng)的平滑過渡，具有較強(qiáng)的功能伸縮性；可以支持先進(jìn)的天線技術(shù)，通過增加小區(qū)覆蓋
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基于FPGA的8B／10B編解碼設(shè)計(jì)

  • 摘要：為提高8B／10B編解碼的工作速度和簡化邏輯方法，提出一種基于FPGA的8B／10B編解碼系統(tǒng)設(shè)計(jì)方案。與現(xiàn)有的8B／10B編解碼方案相比，該方案是一種利用FPGA實(shí)現(xiàn)8B／lOB編解碼的模塊方法，接收模塊在收到外部發(fā)送的
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基于WCDMA速率適配算法的FPGA設(shè)計(jì)

  • 基于WCDMA速率適配算法的FPGA設(shè)計(jì),隨著因特網(wǎng)爆炸性的增長以及各種無線業(yè)務(wù)需求的增加，傳統(tǒng)的無線通信網(wǎng)已經(jīng)越來越無法適應(yīng)人們的需要。因此，以大容量、高數(shù)據(jù)率和承載多媒體業(yè)務(wù)為目的的第三代移動通信系統(tǒng)(IMT-2000)應(yīng)運(yùn)而生。碼分多址(CDMA)由于
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Altera Stratix V FPGA提供RLDRAM 3存儲器支持

  • 　　Altera公司今天發(fā)布Stratix® V系列FPGA，適用于支持Micron技術(shù)公司的下一代低延時(shí)DRAM (RLDRAM® 3存儲器)。Stratix V FPGA采用新的存儲器體系結(jié)構(gòu)，降低延時(shí)，高效實(shí)現(xiàn)FPGA業(yè)界最好的系統(tǒng)性能。Stratix V FPGA為網(wǎng)絡(luò)設(shè)備生產(chǎn)商提供存儲器接口解決方案，支持在互聯(lián)網(wǎng)上迅速有效的傳送視頻、語音和數(shù)據(jù)。 　　Micron公司業(yè)務(wù)開發(fā)高級經(jīng)理Bruce Franklin表示：“Micron的下一代RLDRAM 3存儲器專門設(shè)
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基于FPGA的IRIG-B(DC)碼產(chǎn)生電路設(shè)計(jì)

  • 摘要：提出了一種IRIG-B(DC)碼產(chǎn)生電路的設(shè)計(jì)方法。采用Altera公司低功耗Cyclone FPGA系列中的EPlC6T144、8段數(shù)碼管、晶體振蕩器和MAX3232E等器件構(gòu)成硬件電路、使用VHDL語言設(shè)計(jì)IRIG-B直流時(shí)間碼的軟件。為了設(shè)置和
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基于FPGA的PCI硬件加解密卡設(shè)計(jì)

  • 摘要：提出一種基于FPGA的PCI硬件加解密卡的設(shè)計(jì)方案，用硬件加解密取代了傳統(tǒng)的軟件加解密，將加解密模塊和PCI接口模塊集成在一個(gè)FPGA芯片內(nèi)實(shí)現(xiàn)。分析了PCI加解密卡的軟硬件的結(jié)構(gòu)和原理，詳細(xì)介紹了DESX加解密算法
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基于CPLD／FPGA的CMI編碼設(shè)計(jì)與實(shí)現(xiàn)

  • 根據(jù)CMI碼的特性，介紹了一種新的編程思路實(shí)現(xiàn)CMI編碼，在Max+PlusⅡ開發(fā)平臺上使用VHDL編程實(shí)現(xiàn)CMI編碼，并得到仿真波形。實(shí)驗(yàn)結(jié)果表明，這種編程思路簡單、清晰。在產(chǎn)生7位偽隨機(jī)序列的前提下，分別對“O”，“1”進(jìn)行編碼。這種思路為其他碼型設(shè)計(jì)提供了參考。
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高速移動下OFDM均衡器的FPGA實(shí)現(xiàn)

  • 在高速移動下，OFDM系統(tǒng)載波間正交性被破壞，出現(xiàn)載波間干擾(ICI)，嚴(yán)重影響系統(tǒng)性能，必須采用適當(dāng)?shù)木饧夹g(shù)以補(bǔ)償ICI。為了保證通信的有效性和實(shí)時(shí)性要求，使用FPGA實(shí)現(xiàn)了一種低復(fù)雜度的最小均方誤差(MMSE)OFDM均衡器算法。在ISE軟件平臺上使用Verilog語言編寫程序，并在Xilinx公司Virtex-2實(shí)驗(yàn)板(XC2V930芯片)上對設(shè)計(jì)進(jìn)行了驗(yàn)證。
  • 關(guān)鍵字： OFDM  FPGA  移動  均衡器    
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fpga ip介紹

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