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dsp＋fpga 文章 最新資訊

嵌入式系統(tǒng)設(shè)計中的低功耗技術(shù)

  • 嵌入式系統(tǒng)設(shè)計中的低功耗技術(shù),摘要： 為了探討嵌入式系統(tǒng)的低功耗技術(shù)降低嵌入式系統(tǒng)的功率消耗， 文中從硬件和軟件兩個方面對嵌入式系統(tǒng)設(shè)計的低功耗問題進行了分析和研究。

    0 引言

    隨著科學的發(fā)展和微電子技術(shù)的不斷創(chuàng)新，嵌入式系統(tǒng)的應(yīng)
  • 關(guān)鍵字： 嵌入式  DSP  

基于FPGA的CCD相機時序發(fā)生器的設(shè)計

  • 本文分析了IL-E2型TDI-CCD 芯片的工作過程和對驅(qū)動信號的要求，在此基礎(chǔ)上設(shè)計出合理的時序電路， 為了滿足在實際工作中像移速度異速匹配的要求，在時序電路的設(shè)計中時序發(fā)生部分是可調(diào)的。這種設(shè)計方案簡單、可靠、實用。
  • 關(guān)鍵字： FPGA  CCD  相機  時序    

基于TMS320LF2407A 和AT89S52 三相異步電機雙閉環(huán)調(diào)速控制系統(tǒng)設(shè)計

  • 摘 要: 針對某裝備中三相交流異步電機調(diào)速的要求， 以TMS320LF2407A 和AT89S52 為核心采用磁場定向控制策略設(shè)計了一電流、轉(zhuǎn)速雙閉環(huán)調(diào)速控制系統(tǒng)， 給出了硬件原理框圖、關(guān)鍵器件、設(shè)計思想和程序流程圖。實驗結(jié)
  • 關(guān)鍵字： DSP  

基于LPC2478 的網(wǎng)絡(luò)型電能質(zhì)量監(jiān)測裝置人機交互功能研發(fā)

  • 摘要: 基于網(wǎng)絡(luò)型電能質(zhì)量監(jiān)測裝置的硬件結(jié)構(gòu)和功能，給出了在RealViewMDK 開發(fā)環(huán)境下向LPC2478 微處理器移植mu;C/OS-Ⅱ嵌入式實時操作系統(tǒng)的過程，闡述了集成mu;C/GUI 圖形接口的實現(xiàn)步驟。給出了LPC2478 微處理器
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基于FPGA+ DSP的實時圖像處理系統(tǒng)設(shè)計與實現(xiàn)

  • 基于FPGA+ DSP的實時圖像處理系統(tǒng)設(shè)計與實現(xiàn),摘 要: 針對圖像處理系統(tǒng)計算量大、實時性高和體積小的要求， 研制了一種以DSP為主處理器FPGA 為輔處理器的高性能實時圖像處理系統(tǒng)。利用這兩種芯片的各自特點， 將算法分成兩部分分別交由FPGA 和DSP處理， 大大提高
  • 關(guān)鍵字： FPGA，DSP  

基于FPGA的8085A CPU結(jié)構(gòu)分析與實現(xiàn)

  • 1 引 言

    微型計算機原理幾乎是所有理工科類大學生的必修課目之一， 其重要性不言而喻。然而大多數(shù)教學側(cè)重于應(yīng)用方面， 對計算機的結(jié)構(gòu)及工作原理涉之不深， 因為無法做一個CPU 來演示。這樣學生不能真正了解
  • 關(guān)鍵字： 8085A  FPGA  CPU  結(jié)構(gòu)分析    

基于邏輯分析內(nèi)核的FPGA電路內(nèi)調(diào)試技術(shù)

  • 隨著FPGA融入越來越多的能力，對有效調(diào)試工具的需求將變得至關(guān)重要。對內(nèi)部可視能力的事前周密計劃將能使研制組采用正確的調(diào)試戰(zhàn)略，以更快完成他們的設(shè)計任務(wù)。

    “我知道我的設(shè)計中存在一個問題，但我沒有很
  • 關(guān)鍵字： FPGA  邏輯分析  電路  調(diào)試技術(shù)    

基于DSP的無位置傳感器永磁同步電機磁場定向控制系統(tǒng)

  • 本文著重介紹了一種改進算法，即取消相電流傳感器且采用滑模觀測器實現(xiàn)無位置傳感器速度控制?！　?br />

    永磁同步電機（PMSM）是近年來發(fā)展較快的一種電機，由于其轉(zhuǎn)子采用永磁鋼，屬于無刷電機的一種，具有一般無刷
  • 關(guān)鍵字： DSP  傳感器  PMSM  

Cadence為復(fù)雜的FPGA/ASIC設(shè)計提高驗證效率

  • 　　全球電子設(shè)計創(chuàng)新領(lǐng)先企業(yè)Cadence設(shè)計系統(tǒng)公司,今天宣布在幫助ASIC與FPGA設(shè)計者們提高驗證效率方面取得最新重大進展。加上對最新Accellera Universal Verification Methodology (UVM) 1.0業(yè)界標準的全面支持，600多種新功能擴展了指標驅(qū)動型驗證(MDV)的范圍，幫助工程師實現(xiàn)更快、更全面的驗證閉合與硅實現(xiàn)。 　　
  • 關(guān)鍵字： Cadence  FPGA  

高階累積量調(diào)制識別改進算法的FPGA實現(xiàn)

  • 摘要：基于高階累積量的數(shù)字調(diào)制信號識別算法在低信噪比環(huán)境下識別率較低。針對這一問題，提出了高階累積量的改進算法，通過調(diào)整特征參數(shù)的判別順序先識別出MASK信號的方式，取得了較好的效果。討論了該算法的FPGA設(shè)
  • 關(guān)鍵字： FPGA  高階累積量  調(diào)制識別  改進算法    

20個FPGA成功案例

  • 自 1985 年 Xilinx 向市場推出全球首款現(xiàn)場可編程門陣列 (FPGA) 以來，成千上萬的設(shè)計工程師充分利用其卓越的靈活性、可重復(fù)編程性、功能性和出眾的高性能及高容量構(gòu)建了各種令人稱贊的創(chuàng)新型產(chǎn)品，使我們的日常生活
  • 關(guān)鍵字： FPGA  案例    

基于TMS320F2812的太陽跟蹤器設(shè)計

  • 摘要：采用傳感器和太陽位置計算相結(jié)合的方法，設(shè)計了基于TI公司的TMS320F2812的高精度太陽跟蹤器。一方面可以防止較大誤差積累，另一方面可以避免光線、天氣情況的影響，跟蹤精度得到了較大提高，能夠很好地應(yīng)用于光
  • 關(guān)鍵字： DSP  電池  傳感器  

利用LabVIEW和CompactRIO開發(fā)慣性檢管器

  • 挑戰(zhàn):尋找石油或者天然氣管道的參考位置，并確?？臻g誤差小于1米解決方案:通過使用LabVIE...
  • 關(guān)鍵字： FPGA  LabVIEW  CompactRIO  慣性檢管器  

采用WDM的精確定時器及其在冗余技術(shù)中的應(yīng)用

  • 采用WDM的精確定時器及其在冗余技術(shù)中的應(yīng)用,提出一種設(shè)備冗余的系統(tǒng)設(shè)計方法， 為系統(tǒng)的故障檢測和切換技術(shù)提供了一種解決方案。利用此方法設(shè)計了雙冗余CAN 總線板卡以及在Window s XP 系統(tǒng)下的WDM 驅(qū)動。該模塊工作穩(wěn)定， 數(shù)據(jù)傳輸可靠， 冗余切換切實可行。并可依據(jù)實際使用要求在線修改定時查詢時間。這種冗余實現(xiàn)方法在提高設(shè)備可靠性方面具有一定的實用價值。
  • 關(guān)鍵字： FPGA  
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