- Altera公司今天發(fā)布FPGA和SoC FPGA的開放計算語言(OpenCL?)標準開發(fā)計劃。OpenCL標準是基于C語言的開放標準，適用于并行編程。Altera的OpenCL計劃結合了FPGA的并行能力以及OpenCL標準，實現強大的系統(tǒng)加速功能。與使用Verilog或者VHDL等底層硬件描述語言(HDL)的傳統(tǒng)FPGA開發(fā)方法相比，這一混合系統(tǒng)(CPU + FPGA，使用OpenCL標準)還具有明顯的產品及時面市優(yōu)勢。
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Altera FPGA
- 全球可編程平臺領導廠商賽靈思公司 (Xilinx, Inc. )今天宣布，賽靈思聯盟計劃 (Xilinx Alliance Program)推出高等設計服務成員計劃，作為其設計服務成員計劃的一個重要擴展，幫助 FPGA 客戶加速新產品的開發(fā)，并使其更輕松找到滿足其設計與開發(fā)需求的最佳合作伙伴。
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賽靈思 FPGA
- Tensilica今日宣布，多媒體IC設計公司Skyviia已為其新一代多媒體SoC(片上系統(tǒng))設計選用了Tensilica的HiFi音頻DSP內核。
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Tensilica HiFi音頻 DSP
- 引 言 眾所周知， 視覺是人類感知世界的最重要的方式， 而現實生活中的所有物質形態(tài)都是以三維空間而客觀存在。三維顯示能真正地再現客觀世界的立體空間， 提供更符合人們觀察習慣的交流方式， 有助于人們在綜合
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FPGA LED 體三維 方案
- 摘要：為了使基于FPGA設計的信號處理系統(tǒng)具有更高運行速度和具有更優(yōu)化的電路版圖布局布線，提出了一種適用于FPGA結構的改進型WALLACE TREE架構乘法器。首先討論了基于標準單元3：2壓縮器的改進型6：4壓縮器，根據FP
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WALLACE FPGA TREE 乘法器設計
- 摘要：針對目前多數的FPGA都支持浮點IP核，卻較少關注數據源獲取的問題，提出了一種數據格式轉換方法。使用VHDL語言，采用流水線處理方式將ASCII碼所表示的一定范圍內的實數轉換為單精度浮點數。經過ModelSim功能仿真
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FPGA 數據格式 方法 轉換
- DSP的雙電源解決方案,DSP的供電電路設計是DSP應用系統(tǒng)設計的一個重要組成部分。TIDSP家族（C6000和C54xx）要求有獨立的內核電源和I／O電源，如TMS320VC5402，它的內核電壓是1．8V，I／O電壓是3．3V。由于DSP一般在系統(tǒng)中要承擔大量的實時
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解決方案 電源 DSP
- 全球領先的硅產品知識產權(SIP)平臺解決方案和數字信號處理器(DSP)內核授權廠商CEVA公司宣布，東芝公司 (Toshiba Corporation) 獲CEVA-TeakLite-III DSP內核授權許可，助力其即將推出的移動音頻芯片和汽車音頻DSP產品系列。CEVA-TeakLite-III DSP內核具有用于此類復雜音頻應用的最佳性能，為東芝提供最先進和成熟的32位音頻DSP能力。這一內核在The Linley Group的DSP內核報告中獲評選為“最優(yōu)音頻處理器”
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東芝 DSP
- 摘要：現有的遙測接收機為PCI接口，需安裝在工控機上使用，為實現設備小型化、便攜化，設計實現了小型網絡接口遙測解調模塊，可配合帶有網口的計算機使用。采用FPGA進行遙測數據的幀同步與IRIG—B時碼解調，將接
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FPGA ARM 遙測數據 網絡
- 在眾多當代應用中，嵌入式系統(tǒng)必須滿足極其苛刻的時序要求。其中之一就是啟動時間——即上電后電子系統(tǒng)進入可操作狀態(tài)所需要的時間。PCI Express產品或汽車應用中基于CAN的電子控制單元(ECU)就是具有嚴格時序要求的電子系統(tǒng)的應用實例。
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賽靈思 Xilinx FPGA
- 全球領先的硅產品知識產權(SIP)平臺解決方案和數字信號處理器(DSP)內核授權廠商CEVA公司宣布，東芝公司 (Toshiba Corporation) 獲CEVA-TeakLite-III DSP內核授權許可，助力其即將推出的移動音頻芯片和汽車音頻DSP產品系列。CEVA-TeakLite-III DSP內核具有用于此類復雜音頻應用的最佳性能，為東芝提供最先進和成熟的32位音頻DSP能力。這一內核在The Linley Group的DSP內核報告中獲評選為“最優(yōu)音頻處理器”。
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CEVA DSP
- 摘要：基于卷積碼的編譯碼原理，使用VHDL語言和FPGA芯片設計并實現了(2，1，3)卷積碼編譯碼器。其中譯碼器設計采用“截尾”的Vite-rbi譯碼算法，在支路量度計算、路徑量度和譯碼路徑的更新與存儲以及判決與
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FPGA 卷積碼 編譯碼器
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