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基于DSP和ARM的音頻處理系統(tǒng)設(shè)計

本文闡述了由三者組成的音頻處理系統(tǒng)的硬件接口設(shè)計和軟件編程，提供了有效和實用的音頻處理系統(tǒng)方案。
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走近AVS的“芯” 上海龍晶微電子有限公司

眾所周知，標(biāo)準(zhǔn)是用來規(guī)范產(chǎn)業(yè)運作各個環(huán)節(jié)的基礎(chǔ)。但是僅有標(biāo)準(zhǔn)沒有產(chǎn)品來依托，產(chǎn)業(yè)也只是脆弱的鏈條。而AVS在這一點上始終難掩尷尬。就在前不久剛結(jié)束的廣電CCBN展上，AVS標(biāo)準(zhǔn)的對手H.264、MPEG-2可謂出盡風(fēng)頭，幾乎每個商家的展臺上都有支持它的產(chǎn)品：高清、標(biāo)清、車載、手持一應(yīng)俱全。而在如此重要的對壘臺上，國家自主研發(fā)的視音頻解碼產(chǎn)品仍然沒有出現(xiàn)。究其原因，AVS標(biāo)準(zhǔn)剛頒布，產(chǎn)業(yè)還未完善，缺少了整個產(chǎn)業(yè)的重中之重------“芯片”，商家再急也變不出最終面對消費者的產(chǎn)品。機頂盒、手機等下游制造商只能
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意法半導(dǎo)體推出二合一芯片針對低價DVB-C機頂盒

意法半導(dǎo)體日前發(fā)布了新一代有線數(shù)字電視機頂盒單片解決方案。該公司OMEGA系列產(chǎn)品的最新成員QAMi5107是一個標(biāo)清數(shù)字電視解調(diào)器和MPEG解碼器的二合一產(chǎn)品。這個新器件有助于制造商降低組件總成本，簡化電路板設(shè)計和組裝，同時還能提高性能和安全功能。在推進電視從模擬向數(shù)字轉(zhuǎn)換的進程中，價格是影響網(wǎng)絡(luò)服務(wù)提供商為新的有線數(shù)字電視服務(wù)定義機頂盒的一個重合機頂盒前端的數(shù)字信號解調(diào)器和后端的MPEG解碼器功能，ST為消費電子產(chǎn)品廠商降低了機頂盒制造總成本，因為該芯片組本身成本
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FPGA創(chuàng)新中心落戶無錫國家集成電路設(shè)計基地

可編程解決方案領(lǐng)導(dǎo)廠商賽靈思公司（Xilinx）與無錫國家高新技術(shù)產(chǎn)業(yè)開發(fā)區(qū)管理委員會今天共同宣布成立無錫國家集成電路設(shè)計基地FPGA（現(xiàn)場可編程門陣列）創(chuàng)新中心，并隆重舉行賽靈思正式授權(quán)“無錫國家集成電路設(shè)計基地—賽靈思聯(lián)合實驗室”揭牌儀式。無錫新區(qū)管委會副主任朱曉紅以及賽靈思公司研究實驗室高級總監(jiān)、全球大學(xué)計劃負(fù)責(zé)人Patrick Lysaght等出席了成立大會并為聯(lián)合實驗室揭牌。作為國家級的集成電路設(shè)計基地，新的FPGA創(chuàng)新中心的成立以及聯(lián)合實驗室的打造，意味著可編程設(shè)計在電子設(shè)計領(lǐng)域的
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FPGA：22年從配角到主角

任何一個從事后看來很成功的新事物從誕生到發(fā)展壯大都不可避免地經(jīng)歷過艱難的歷程并可能成為被研究的案例，F(xiàn)PGA也不例外。1985年，當(dāng)全球首款FPGA產(chǎn)品——XC2064誕生時，注定要使用大量芯片的PC機剛剛走出硅谷的實驗室進入商業(yè)市場，因特網(wǎng)只是科學(xué)家和政府機構(gòu)通信的神秘鏈路，無線電話笨重得像磚頭，日后大紅大紫的Bill Gates正在為生計而奮斗，創(chuàng)新的可編程產(chǎn)品似乎并沒有什么用武之地。　　事實也的確如此。最初，F(xiàn)PGA只是用于膠合邏輯，從膠合邏輯到算法
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TI達芬奇技術(shù)使視頻安全與監(jiān)控應(yīng)用獲得系統(tǒng)性能雙倍提升

日前，德州儀器(TI)針對視頻安全監(jiān)控應(yīng)用推出了TMS320DM647與TMS320DM648兩款全新達芬奇(DaVinci)技術(shù)數(shù)字信號處理器（DSPs）。 TI致力于通過領(lǐng)先的軟硬件技術(shù)、工具與支持不斷推動數(shù)字視頻市場創(chuàng)新，以滿足包括數(shù)碼錄像機(DVR)、IP視頻服務(wù)器、機器視覺系統(tǒng)與高性能成像應(yīng)用等在內(nèi)的多通道視頻安全與基礎(chǔ)局端應(yīng)用的要求。兩款新品建立在TI最新TMS320C64x+ DSP內(nèi)核基礎(chǔ)上，為基于TMS320DM642
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數(shù)字差分BPSK擴頻接收機的設(shè)計與FPGA實現(xiàn)

本文提出了一種全數(shù)字差分BPSK擴頻接收機的實現(xiàn)方案，通過Simulink仿真驗證了該方案具有較低的誤碼率。
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利用FPGA實現(xiàn)UART的設(shè)計

引言　　隨著計算機技術(shù)的發(fā)展和廣泛應(yīng)用，尤其是在工業(yè)控制領(lǐng)域的應(yīng)用越來越廣泛，計算機通信顯的尤為重要。串行通信雖然使設(shè)備之間的連線大為減少，但隨之帶來串／并轉(zhuǎn)換和位計數(shù)等問題，這使串行通信技術(shù)比并行通信技術(shù)更為復(fù)雜。串／并轉(zhuǎn)換可用軟件實現(xiàn)，也可用硬件實現(xiàn)。用軟件實現(xiàn)串行傳送大多采用循環(huán)移位指令將一個字節(jié)由高位到低位(或低位到高位)一位一位依次傳送，這種方法雖然簡單但速度慢，而且大量占用CPU的時間，影響系統(tǒng)的性能。更為方便的實現(xiàn)方法是用硬件，目前微處理器串行接口常用的LSI 芯片是UART(通用異
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基于FPGA的八位RISC CPU的設(shè)計

1 引言　　隨著數(shù)字通信和工業(yè)控制領(lǐng)域的高速發(fā)展，要求專用集成電路（ASIC）的功能越來越強，功耗越來越低，生產(chǎn)周期越來越短，這些都對芯片設(shè)計提出了巨大的挑戰(zhàn)，傳統(tǒng)的芯片設(shè)計方法已經(jīng)不能適應(yīng)復(fù)雜的應(yīng)用需求了。SoC（System on a Chip）以其高集成度，低功耗等優(yōu)點越來越受歡迎。開發(fā)人員不必從單個邏輯門開始去設(shè)計ASIC，而是應(yīng)用己有IC芯片的功能模塊，稱為核（core），或知識產(chǎn)權(quán)（IP）宏單元進行快速設(shè)計，效率大為提高。CPU 的IP
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定點DSP的準(zhǔn)確計時

數(shù)字信號處理（ＤＳＰ）是一門涉及許多學(xué)科而又廣泛應(yīng)用于許多領(lǐng)域的新興學(xué)科。２０世紀(jì)６０年代以來，隨著計算機技術(shù)和信息技術(shù)的飛速發(fā)展，數(shù)字信號處理技術(shù)應(yīng)運而生，并得到迅速的發(fā)展。在過去的二十多年里，ＤＳＰ已經(jīng)在通信等領(lǐng)域得到極為廣泛的應(yīng)用，特別是在一些測量控制領(lǐng)域?熏應(yīng)用更是越來越廣泛。本文擬采用定點ＤＳＰ——ＴＭＳ３２０Ｆ２０６來測量一些物理量，如測交流信號的頻率、相位，但這些物理量的測量都離不開信號時間的測量，所以采用定點ＤＳＰ準(zhǔn)確地測量時間直接關(guān)系到這些物理量測量
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DSP和PBL3717A構(gòu)成的步進電機的控制系統(tǒng)

　　摘要：介紹由美國TI公司的數(shù)字信號處理器TMS320LF2407A和SGS公司的步進電機驅(qū)動芯片PBL3717A構(gòu)成的兩相混合式步進電機的控制系統(tǒng)。　　關(guān)鍵詞：PBL3717A DSP 步進電機控制系統(tǒng) 　　引言　　步進電機是數(shù)字控制系統(tǒng)中的一種重要執(zhí)行元件，廣泛應(yīng)用于各種控制系統(tǒng)中。它是一種將電脈沖信號轉(zhuǎn)換為位移或轉(zhuǎn)速的控制電機，輸入一個脈沖信號，電機就轉(zhuǎn)動一個角度或前進一步。其機械角位移和轉(zhuǎn)速分別與輸入電機繞組的脈沖個數(shù)和脈沖頻率成比例，可以通過改變脈沖頻率在大范圍內(nèi)調(diào)速，易于與計算
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Altera首次實現(xiàn)了對關(guān)鍵工業(yè)以太網(wǎng)協(xié)議的FPGA IP支持

　　Altera公司日前宣布為工業(yè)自動化應(yīng)用中的以太網(wǎng)通信協(xié)議提供FPGA支持，這些應(yīng)用包括ProfiNet、Ethernet/IP、Modbus-IDA、EtherCAT、SERCOS III接口和Ethernet Powerlink等。這些關(guān)鍵通信協(xié)議的知識產(chǎn)權(quán)(IP)內(nèi)核現(xiàn)在可以在Altera低成本Cyclone®系列FPGA中實現(xiàn)。　　設(shè)計人員利用工業(yè)以太網(wǎng)IP內(nèi)核可以在一塊電路板上實現(xiàn)任何標(biāo)準(zhǔn)，這不但減小了外形尺寸，而且節(jié)省了時間。系統(tǒng)OEM能夠以高性價比方式在其自動化產(chǎn)品中增加工業(yè)
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基于DSP技術(shù)的多路語音實時采集與壓縮處理系統(tǒng)

介紹一個多路語音實時采集與壓縮處理系統(tǒng)。該系統(tǒng)基于PC－ISA總線結(jié)構(gòu)，最大的特點是通過單片DSP高性能價格比實時地實現(xiàn)了多達10路的語音采集和10路語音實時壓縮及一路語音解壓處理。該系統(tǒng)已成功應(yīng)用于某語音記錄設(shè)備中。
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一種基于DSP和采樣ADC的數(shù)字鎖定放大器

探討了用DSP（數(shù)字信號處理器）和采樣ADC（模數(shù)轉(zhuǎn)換器）實現(xiàn)數(shù)字鎖定放大器的一種方法。
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基于FPGA的智能控制器設(shè)計及測試方法研究

摘要：通過模糊自整定PID控制器的設(shè)計，本文提出了一種基于VHDL描述、DSP Builder和Modelsim混合仿真、FPGA實現(xiàn)的智能控制器設(shè)計及測試新方法。首先，通過MATLAB仿真，得出智能控制器的結(jié)構(gòu)和參數(shù)。然后，基于VHDL進行智能控制器的數(shù)字化實現(xiàn)及其開環(huán)測試。在此基礎(chǔ)上，通過分析一般智能控制器的測試特點，采用DSP Builder構(gòu)建閉環(huán)測試系統(tǒng)，Modelsim運行DSP Builder生成文件來驗證QuartusII中所做VHDL設(shè)計的測試方法。實驗表明，該測試方法能有效模擬控制器的
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