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cpld/fpga 文章 最新資訊
FPGA 協(xié)處理的進(jìn)展

- 對(duì)許多包含并行性或可流水化的算法而言,由于裕量連接帶寬可實(shí)現(xiàn)用戶(hù)自定義的數(shù)據(jù)通路,這樣,邏輯可在一個(gè)時(shí)鐘周期內(nèi)訪(fǎng)問(wèn)存儲(chǔ)器或訪(fǎng)問(wèn)另一個(gè)邏輯塊的結(jié)果,從而使FPGA的持續(xù)性能可接近峰值性能。由于固定架構(gòu)具備預(yù)先確定的用以實(shí)現(xiàn)不同功能的邏輯塊集合,所以可以為FPGA配置支持某種給定算法的最優(yōu)邏輯函數(shù)比例來(lái)實(shí)現(xiàn)器件資源的最佳利用。
- 關(guān)鍵字: 進(jìn)展 處理 FPGA 交換
Altera Stratix IV GT FPGA與QSFP實(shí)現(xiàn)互操作性
- Altera 公司今天宣布其Stratix® IV GT FPGA 實(shí)現(xiàn)了與Avago公司 的 40G 四通道小型可插拔 (QSFP) 光學(xué)模塊的互操作性。QSFP 光學(xué)模塊在單條光纖電纜鏈路上數(shù)據(jù)速率為 40-Gbps。利用 Stratix IV GT FPGA 中特有的 11.3-Gbps 嵌入式收發(fā)器,設(shè)計(jì)人員現(xiàn)在可以運(yùn)用 FPGA 的靈活性和性能優(yōu)勢(shì)在其線(xiàn)卡中將 40G QSFP 光學(xué)模塊橋接到其它器件,從而增加總系統(tǒng)帶寬。 QSFP 是一些計(jì)算及電信應(yīng)用中使用的高性能交換機(jī)、路
- 關(guān)鍵字: Altera FPGA Stratix QSFP
基于FPGA的時(shí)間間隔測(cè)量模塊設(shè)計(jì)
- 摘要:介紹一種基于FPGA技術(shù)的時(shí)間間隔測(cè)量方法,通過(guò)分析FPGA的主要技術(shù)優(yōu)勢(shì)及其在工業(yè)控制領(lǐng)域中所處的重要地位,給出設(shè)計(jì)時(shí)間間隔測(cè)量模塊所選用的FPGA器件并進(jìn)行硬件設(shè)計(jì),以及所選用的軟件并進(jìn)行軟件設(shè)計(jì)。描述
- 關(guān)鍵字: FPGA 時(shí)間間隔測(cè)量 模塊設(shè)計(jì)
基于CPLD和ISA總線(xiàn)的數(shù)據(jù)采集系統(tǒng)設(shè)計(jì)
- 摘要:介紹一種基于復(fù)雜可編程邏輯器件(CPLD)的數(shù)據(jù)采集系統(tǒng),并給出詳細(xì)的設(shè)計(jì)方案。計(jì)算機(jī)通過(guò)ISA總線(xiàn)實(shí)現(xiàn)與數(shù)據(jù)采集系統(tǒng)的指令和數(shù)據(jù)傳輸。通過(guò)VHDL編程實(shí)現(xiàn)CPLD對(duì)12位串行模數(shù)轉(zhuǎn)換器ADS7816的控制。最后,給出該
- 關(guān)鍵字: CPLD ISA 總線(xiàn) 數(shù)據(jù)采集
CPLD在臭氧電源中的應(yīng)用
- 摘要:利用壓控振蕩器CD4046和可編程邏輯器件EPM7128構(gòu)成控制系統(tǒng),通過(guò)調(diào)節(jié)逆變輸出脈沖的占空比和頻率,實(shí)現(xiàn)臭氧電源輸出電壓和頻率的調(diào)節(jié),從而達(dá)到對(duì)臭氧電源輸出功率的調(diào)節(jié)。調(diào)試結(jié)果表明該系統(tǒng)滿(mǎn)足實(shí)時(shí)性和功耗
- 關(guān)鍵字: CPLD 臭氧電源 中的應(yīng)用
FPGA和ARM的Profibus-DP主站通信平臺(tái)設(shè)計(jì)
- 摘要:提出一個(gè)使用FPGA和ARM微控制器實(shí)現(xiàn)Profibus-DP主站(1類(lèi))通信平臺(tái)的解決方案;解析了Profibus-DP通信協(xié)議,重點(diǎn)是令牌輪轉(zhuǎn)協(xié)議;給出了該主站通信平臺(tái)的系統(tǒng)構(gòu)建。該通信平臺(tái)可以獨(dú)立實(shí)現(xiàn)Profibus-DP主站(1類(lèi))
- 關(guān)鍵字: Profibus-DP FPGA ARM 通信
FPGA芯片在高速數(shù)據(jù)采集緩存系統(tǒng)中的應(yīng)用
- 摘要:給出了以FPGA為核心邏輯控制模塊的高性能數(shù)據(jù)采集系統(tǒng)的設(shè)計(jì)方法,并在QuartusII8.0集成環(huán)境中進(jìn)行軟件設(shè)計(jì)和系統(tǒng)仿真,最后給出了新型緩存系統(tǒng)中主要功能模塊的仿真圖形。
關(guān)鍵詞:FPGA;高速;數(shù)據(jù)采集;緩 - 關(guān)鍵字: FPGA 芯片 高速數(shù)據(jù) 采集
TMS320F2812與CPLD的視頻采集系統(tǒng)接口設(shè)計(jì)
- 摘要:介紹基于TMS320F2812和CPLD的數(shù)字視頻采集系統(tǒng)的接口設(shè)計(jì)。該系統(tǒng)采用同步分離電路、TMS320F2812、EPM7128、TMS320C6416、IDE硬盤(pán)存儲(chǔ)器以及顯示器接口等芯片,利用TMs320F2812中的ADC采樣速度和轉(zhuǎn)換精度高的優(yōu)
- 關(guān)鍵字: 接口 設(shè)計(jì) 系統(tǒng) 采集 CPLD 視頻 TMS320F2812
基于Simulink的數(shù)據(jù)鏈系統(tǒng)仿真及性能分析
- 未來(lái)戰(zhàn)場(chǎng)必是網(wǎng)絡(luò)中心戰(zhàn)格局下的系統(tǒng)一體化作戰(zhàn),用于制導(dǎo)的武器數(shù)據(jù)鏈?zhǔn)瞧渲兄匾画h(huán)。通常武器數(shù)據(jù)鏈用...
- 關(guān)鍵字: Simulink 數(shù)據(jù)鏈系統(tǒng) 仿真 FPGA
基于FPGA+DSP的雷達(dá)回波發(fā)生器設(shè)計(jì)
- 雷達(dá)回波發(fā)生器利用現(xiàn)代仿真技術(shù)生成蘊(yùn)含雷達(dá)目標(biāo)和環(huán)境信息的模擬雷達(dá)信號(hào),用來(lái)對(duì)雷達(dá)系統(tǒng)進(jìn)行性能測(cè)試和評(píng)估。根據(jù)通用性、靈活性要求,提出了一種基于DSP+FPGA的雷達(dá)回波發(fā)生器的設(shè)計(jì)方法;簡(jiǎn)要介紹了設(shè)計(jì)思想,詳細(xì)闡述了系統(tǒng)的硬件組成和軟件設(shè)計(jì),并給出了測(cè)試結(jié)果并總結(jié)了該雷達(dá)回波發(fā)生器的一些優(yōu)點(diǎn)。
- 關(guān)鍵字: FPGA DSP 雷達(dá)回波 發(fā)生器
ISPl362在基于FPGA的紅外成像系統(tǒng)中的應(yīng)用
- 摘要:ISPl362是飛利浦推出的一款USB可編程控制芯片,其內(nèi)部集成了一個(gè)高級(jí)主控制器,一個(gè)外設(shè)控制器,主機(jī)和設(shè)備控制器兼容USB 2.O協(xié)議,支持12 Mb/s的全速傳輸和1.5 Mb/s的低速傳輸;芯片有三種工作模式,即主
- 關(guān)鍵字: ISPl FPGA 362 紅外成像系統(tǒng)
一種基于FPGA的可編程電壓源系統(tǒng)設(shè)計(jì)
- 0引言可編程電源指某些功能或參數(shù)可以通過(guò)計(jì)算機(jī)軟件編程進(jìn)行控制的電源??删幊屉娫吹膶?shí)現(xiàn)方法...
- 關(guān)鍵字: FPGA 可編程電壓源 設(shè)計(jì) Cyclone
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