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Nordic Semiconductor為Matter over Wi-Fi智能鎖提供本地或遠程訪問功能

  • Anona Security Technology Limited發(fā)布了一款兼容Matter over Wi-Fi的智能鎖，可安裝在任何門上，為房主或經(jīng)批準的訪客提供遠程無線門禁功能。Anona Holo智能鎖集成了Nordic Semiconductor的?nRF5340高級多協(xié)議SoC 和nRF7002?Wi-Fi 6 Companion IC，可通過用戶智能手機上的應用程序使用低功耗藍牙無線連接，或使用智能鎖與兼容的智能家居生態(tài)系統(tǒng)之間的 Matter over Wi-Fi 連接
  • 關鍵字： Nordic  Matter over Wi-Fi  智能鎖  

將ASIC IP核移植到FPGA上——更新概念并推動改變以完成充滿挑戰(zhàn)的任務!

  • 本系列文章從數(shù)字芯片設計項目技術總監(jiān)的角度出發(fā)，介紹了如何將芯片的產品定義與設計和驗證規(guī)劃進行結合，詳細講述了在FPGA上使用IP核來開發(fā)ASIC原型項目時，必須認真考慮的一些問題。文章從介紹使用預先定制功能即IP核的必要性開始，通過闡述開發(fā)ASIC原型設計時需要考慮到的IP核相關因素，用八個重要主題詳細分享了利用ASIC所用IP來在FPGA上開發(fā)原型驗證系統(tǒng)設計時需要考量的因素。在上篇文章中，我們介紹了將ASIC IP移植到FPGA原型平臺上的必要性，并對原型設計中各種考量因素進行了總體概述，分析開發(fā)A
  • 關鍵字： ASIC IP  FPGA  SmartDV  

燦芯半導體發(fā)布通用高性能小數(shù)分頻鎖相環(huán)IP及相關解決方案

  • 一站式定制芯片及IP供應商——燦芯半導體（上海）股份有限公司近日宣布成功研發(fā)出一款通用高性能小數(shù)分頻鎖相環(huán)（fractional-N PLL） IP，支持24bits高精度小數(shù)分頻，最高輸出頻率4.5Ghz，另外還支持擴頻時鐘（SSC）功能，可以為客戶提供多功能的小數(shù)分頻 PLL解決方案。PLL電路一般用于產生輸出頻率，輸出頻率值與PLL的參考輸入頻率呈倍數(shù)關系。小數(shù)分頻PLL通過頻率乘法比例的小數(shù)值，實現(xiàn)更精確的輸出頻率控制，從而提供更高精度和準確度的輸出頻率。SSC發(fā)生器是在一定頻率范圍內調制時鐘信號
  • 關鍵字： 燦芯半導體  小數(shù)分頻  鎖相環(huán)  IP  

IC設計倚重IP、ASIC趨勢成形

  • 半導體制程進入2奈米，擷發(fā)科技董事長楊健盟指出，IC設計難度陡增，未來硅智財、ASIC角色將更加吃重，協(xié)助IC設計以SoC方式因應AI新世代。楊健盟分析，過往IDM分拆晶圓代工之典范，將在IC設計上發(fā)生，AI時代IC設計大者恒大趨勢成形。 擷發(fā)科技已獲國際芯片大廠AI芯片外包訂單，楊健盟認為，現(xiàn)在芯片晶體管動輒百億個，考驗IC設計業(yè)者研發(fā)量能。大量采用基礎、接口IP使研發(fā)能力更能專注前段設計，海外大廠甚至將后段交由ASIC業(yè)者，未來倚重IP、ASIC趨勢只會更加明顯。中國臺灣半導體產業(yè)鏈在邏輯先進制程、先
  • 關鍵字： IC設計  IP  ASIC  

半導體知識產權市場規(guī)模將增長27.1億美元

  • 根據(jù)Technavio的報告，全球半導體知識產權（IP）市場規(guī)模預計將在2024年至2028年間增長27.1億美元。預計在預測期內，市場的復合年增長率（CAGR）將超過7.47%。復雜芯片設計和多核技術的使用推動了市場的增長，同時納米光子集成電路（ICs）的出現(xiàn)也是一大趨勢。然而，半導體IP的重復使用構成了一項挑戰(zhàn)。主要市場參與者包括Achronix Semiconductor Corp.、Advanced Micro Devices Inc.、Alphawave IP Group plc、Arm Ltd
  • 關鍵字： 半導體知識產權  IP  

Arm發(fā)布基于3nm芯片工藝的新CPU、GPU IP

  • 芯片設計公司Arm今日發(fā)布了針對旗艦智能手機的新一代CPU和GPU IP（設計方案）：Cortex-X925 CPU、Immortalis G925 GPU。新產品均使用了其最新的Armv9架構，基于臺積電3nm制程工藝方案，針對終端設備在AI應用上的性能進行設計優(yōu)化。此外還將提供軟件工具，讓開發(fā)人員更容易在采用Arm架構的芯片上運行生成式AI聊天機器人和其他AI代碼。預計搭載最新內核設計的手機將于2024年底上市。據(jù)官方介紹，新的CPU與GPU IP是目前旗下同類產品中性能最強的一代，新CPU性能提升3
  • 關鍵字： arm  CPU  GPU  IP  3nm  

西門子推出 Solido IP 驗證套件，為下一代 IC 設計提供端到端的芯片質量保證

  • ●? ?西門子集成的驗證套件能夠在整個IC設計周期內提供無縫的IP質量保證，為IP開發(fā)團隊提供完整的工作流程西門子數(shù)字化工業(yè)軟件日前推出 Solido? IP 驗證套件 (Solido IP Validation Suite)，這是一套完整的自動化簽核解決方案，可為包括標準單元、存儲器和 IP 模塊在內的設計知識產權 (IP) 提供質量保證。這一全新的解決方案提供完整的質量保證 (QA) 覆蓋范圍，涵蓋所有 IP 設計視圖和格式，還可提供 “版本到版本” 的 IP 認證，能夠提升完整芯
  • 關鍵字： 西門子  Solido IP  IC設計  IC 設計  

炬芯科技的智能手表SoC采用了芯原的2.5D GPU IP

  • 芯原股份近日宣布低功耗?AIoT?芯片設計廠商炬芯科技股份有限公司（炬芯科技，?股票代碼：688049.SH）在其高集成度的雙模藍牙智能手表SoC? ATS3085S和ATS3089系列中采用了芯原低功耗且功能豐富的2.5D圖形處理器（GPU）IP。?炬芯科技的智能手表SoC ATS3085S和ATS3089系列擁有卓越的圖形顯示性能，采用2D+2.5D雙GPU硬件加速配置，支持JPEG硬件解碼，具有高幀率、低功耗等特點。該系列SoC以其高集成度，可實現(xiàn)單
  • 關鍵字： 炬芯  智能手表  芯原  2.5D GPU IP  

一文把TCP/IP協(xié)議講絕了！

  • 本文整理了一些TCP/IP協(xié)議簇中需要必知必會的十大問題，既是面試高頻問題，又是程序員必備基礎素養(yǎng)。一、TCP/IP模型TCP/IP協(xié)議模型（Transmission Control Protocol/Internet Protocol），包含了一系列構成互聯(lián)網(wǎng)基礎的網(wǎng)絡協(xié)議，是Internet的核心協(xié)議?；赥CP/IP的參考模型將協(xié)議分成四個層次，它們分別是鏈路層、網(wǎng)絡層、傳輸層和應用層。下圖表示TCP/IP模型與OSI模型各層的對照關系。TCP/IP協(xié)議族按照層次由上到下，層層包裝。最上面的是應用層
  • 關鍵字： TCP  IP  協(xié)議  程序員  

銳成芯微亮相北京車展 發(fā)布應用于wBMS的藍牙RF IP

  • 25日，北京國際車展火熱開幕，銳成芯微攜旗下車規(guī)級IP亮相車展中國芯展區(qū)，并發(fā)布應用于wBMS（無線電池管理系統(tǒng)）的車規(guī)級藍牙RF IP。銳成芯微亮相2024北京車展中國芯展區(qū)（左）隨著電動汽車和新能源市場的快速發(fā)展，電池管理系統(tǒng)的需求也在不斷增加。無線電池管理系統(tǒng)（wBMS）作為提升電池性能、安全性和可靠性的關鍵技術之一，正逐漸成為汽車廠商、特別是頭部汽車廠商的關注焦點。而車規(guī)級藍牙RF IP作為wBMS中的重要組成部分，結合了藍牙的通信能力和RF IP的定位功能，為實現(xiàn)安全可靠的電池管理保駕護航。立足
  • 關鍵字： 銳成芯微  wBMS  藍牙RF  IP  

嘉楠基于RISC-V的端側AIoT SoC采用了芯原的ISP IP和GPU IP

  • 芯原股份（芯原）近日宣布嘉楠科技（嘉楠）全球首款支持RISC-V Vector 1.0標準的商用量產端側AIoT芯片K230集成了芯原的圖像信號處理器（ISP）IP ISP8000、畸變矯正（DeWarp）處理器IP DW200，以及2.5D圖形處理器（GPU）IP GCNanoV。該合作極大地優(yōu)化了高精度、低延遲的端側AIoT解決方案，可廣泛適用于各類智能產品及場景，如邊緣側大模型多模態(tài)接入終端、3D結構光深度感知模組、交互型機器人、開源硬件，以及智能制造、智能家居和智能教育相關硬件設備等。芯原的ISP
  • 關鍵字： 嘉楠  RISC-V  AIoT SoC  芯原  ISP IP  GPU IP  

芯原業(yè)界領先的嵌入式GPU IP賦能先楫高性能的HPM6800系列RISC-V MCU

  • 2024年3月4日，中國上?！驹煞荩ㄐ驹善贝a：688521.SH）今日宣布先楫半導體（簡稱“先楫”）的HPM6800系列新一代數(shù)字儀表顯示及人機界面系統(tǒng)應用平臺采用了芯原的高性能2.5D圖形處理器（GPU）IP。HPM6800系列產品基于RISC-V CPU內核，具備高算力、低功耗、高集成度和出色的多媒體功能，適用于汽車儀表、人機交互界面（HMI），以及電子后視鏡（CMS）等需要復雜圖形處理、高分辨率顯示和高性能多媒體用戶界面的應用。 芯原支持OpenVG的2.5D GPU IP能夠
  • 關鍵字： 芯原  GPU IP  先楫  RISC-V MCU  

芯科科技為全球首批原生支持Matter-over-Thread的智能鎖提供強大助力，推動Matter加速成為主流技術

  • 中國，北京 – 2024年2月29日 – 致力于以安全、智能無線連接技術，建立更互聯(lián)世界的全球領導廠商Silicon Labs（亦稱“芯科科技”，NASDAQ：SLAB）今日宣布，公司的解決方案已被選擇用于全球首批原生支持Matter-over-Thread的智能鎖中。隨著越來越多支持Matter的設備被部署以簡化互聯(lián)家居體驗，企業(yè)需要可靠和安全的解決方案來加速將其兼容Matter的產品推向市場。位于美國硅谷的智能鎖制造商U-tec*在其新發(fā)布的Ultraloq Bolt Fingerprint Matt
  • 關鍵字： 芯科科技  Matter-over-Thread  智能鎖  Matter  

采用芯原NPU IP的AI類芯片已在全球出貨超過1億顆

  • 芯原股份近日宣布集成了芯原神經(jīng)網(wǎng)絡處理器（NPU）IP的人工智能（AI）類芯片已在全球范圍內出貨超過1億顆，主要應用于物聯(lián)網(wǎng)、可穿戴設備、智慧電視、智慧家居、安防監(jiān)控、服務器、汽車電子、智能手機、平板電腦、智慧醫(yī)療等10個市場領域。在過去七年里，芯原在嵌入式AI/NPU領域全球領先，其NPU IP已被72家客戶用于上述市場領域的128款AI芯片中。芯原的NPU IP是一款高性能的AI處理器IP，采用了低功耗、可編程和可擴展的架構設計。它可以靈活配置，以滿足客戶對芯片尺寸和功耗的不同要求，使之成為具有成本效
  • 關鍵字： 芯原  NPU IP  AI芯片  

Ceva聯(lián)同汽車和邊緣人工智能領域全新合作伙伴,擴展業(yè)界領先NPU IP的人工智能生態(tài)系統(tǒng)

  • 幫助智能邊緣設備更可靠、更高效地連接、感知和推斷數(shù)據(jù)的全球領先硅產品和軟件IP授權許可廠商Ceva公司(納斯達克股票代碼：CEVA) 宣布與兩家瞄準汽車和視覺邊緣人工智能(Edge AI)應用的新合作伙伴結盟，擴大業(yè)界領先的NeuPro-M NPU IP人工智能生態(tài)系統(tǒng)。?????? Ceva副總裁兼視覺業(yè)務部門總經(jīng)理Ran Snir表示：“我們熱烈歡迎Visionary.ai和ENOT.ai加入支持智能邊緣客戶群的合作伙伴生態(tài)系統(tǒng)。這些合作伙伴
  • 關鍵字： Ceva  NPU IP  人工智能  CES  
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