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Cadence 推出開拓性的 Virtuoso Studio

  • ·       這是一個(gè)業(yè)界用于打造差異化定制芯片的領(lǐng)先平臺(tái)，可借助生成式 AI 技術(shù)顯著提升設(shè)計(jì)生產(chǎn)力；·       Virtuoso Studio 與 Cadence 最前沿的技術(shù)和最新的底層架構(gòu)集成，助力設(shè)計(jì)工程師在半導(dǎo)體和 3D-IC 設(shè)計(jì)方面取得新突破；·       依托 30 年來(lái)在全線工藝技術(shù)方面取得的行業(yè)領(lǐng)先
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Cadence Virtuoso定制IC設(shè)計(jì)平臺(tái)助力WillSemi提升模擬IC設(shè)計(jì)的穩(wěn)健性和交付速度

  • 　　楷登電子(美國(guó)Cadence公司)今日宣布，WillSemi采用Cadenceò Virtuosoò 定制集成電路設(shè)計(jì)平臺(tái)，增強(qiáng)了模擬集成電路設(shè)計(jì)的可靠性，并縮短了產(chǎn)品的總體上市時(shí)間。較此前部署的行業(yè)解決方案，WillSemi采用Cadence定制集成電路設(shè)計(jì)流程不僅將模擬設(shè)計(jì)和實(shí)現(xiàn)時(shí)間減半，總設(shè)計(jì)周期時(shí)間也縮短了三分之一?！　adence定制設(shè)計(jì)流程工具幫助WillSemi集成電路設(shè)計(jì)團(tuán)隊(duì)實(shí)現(xiàn)了如下目標(biāo)：　　· 采用Virtuoso電路原理圖編輯器與Virtuoso版
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全新Cadence Virtuoso系統(tǒng)設(shè)計(jì)平臺(tái)幫助實(shí)現(xiàn)IC、封裝和電路板無(wú)縫集成的設(shè)計(jì)流程

  • 　　楷登電子(美國(guó)Cadence公司)今日發(fā)布全新Cadence? Virtuoso? System Design Platform(Virtuoso系統(tǒng)設(shè)計(jì)平臺(tái))，結(jié)合Cadence Virtuoso平臺(tái)與Allegro? 及Sigrity?技術(shù)，打造一個(gè)正式的、優(yōu)化的自動(dòng)協(xié)同設(shè)計(jì)與驗(yàn)證流程。多項(xiàng)跨平臺(tái)技術(shù)的高度集成幫助設(shè)計(jì)工程師實(shí)現(xiàn)芯片、封裝和電路板的同步和協(xié)同設(shè)計(jì)。這一過程在此之前只能通過手動(dòng)完成，全新Virtuoso系統(tǒng)設(shè)計(jì)平臺(tái)可以實(shí)現(xiàn)流
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Cadence發(fā)布7納米工藝Virtuoso先進(jìn)工藝節(jié)點(diǎn)擴(kuò)展平臺(tái)

  • 　　楷登電子(美國(guó)Cadence公司)今日正式發(fā)布針對(duì)7nm工藝的全新Virtuoso® 先進(jìn)工藝節(jié)點(diǎn)平臺(tái)。通過與采用7nm FinFET工藝的早期客戶展開緊密合作，Cadence成功完成了Virtuoso定制設(shè)計(jì)平臺(tái)的功能拓展，新平臺(tái)能幫助客戶管理由于先進(jìn)工藝所導(dǎo)致的更復(fù)雜的設(shè)計(jì)以及特殊的工藝效應(yīng)。新版Virtuoso先進(jìn)工藝平臺(tái)同樣支持所有主流FinFET先進(jìn)節(jié)點(diǎn)，性能已得到充分認(rèn)證;同時(shí)提高了7nm工藝的設(shè)計(jì)效率。 　　為了應(yīng)對(duì)7nm設(shè)計(jì)的眾多技術(shù)挑戰(zhàn)，Virtuoso先進(jìn)工藝平臺(tái)提供豐富
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Cadence物理驗(yàn)證系統(tǒng)通過FinFET制程認(rèn)證

  • 　　重點(diǎn)：　　·?認(rèn)證確保精確性方面不受影響，并包含用于65納米至14納米FinFET制程的物理驗(yàn)證簽收的先進(jìn)技術(shù)　　·?雙方共同的客戶可通過它與Cadence?Virtuoso及Encounter平臺(tái)的無(wú)縫集成進(jìn)行版圖設(shè)計(jì)和驗(yàn)證版圖　　全球電子設(shè)計(jì)創(chuàng)新領(lǐng)先企業(yè)Cadence設(shè)計(jì)系統(tǒng)公司今天宣布Cadence??Physical?Verification?System?(PVS)通過了GLOBALFOUNDRIES的認(rèn)證，可用于65納米
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Cadence采用全新可支持電學(xué)感知設(shè)計(jì)的Virtuoso版圖套件

  • 全球電子設(shè)計(jì)創(chuàng)新領(lǐng)先企業(yè)Cadence設(shè)計(jì)系統(tǒng)公司(NASDAQ:CDNS) 日前宣布推出用于實(shí)現(xiàn)電學(xué)感知設(shè)計(jì)的Virtuoso?版圖套件，它是一種開創(chuàng)性的定制設(shè)計(jì)方法，能提高設(shè)計(jì)團(tuán)隊(duì)的設(shè)計(jì)生產(chǎn)力和定制IC的電路性能。
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臺(tái)積電TSMC擴(kuò)大與Cadence在Virtuoso定制設(shè)計(jì)平臺(tái)的合作

  • 為專注于解決先進(jìn)節(jié)點(diǎn)設(shè)計(jì)的日益復(fù)雜性，全球電子設(shè)計(jì)創(chuàng)新領(lǐng)先企業(yè)Cadence設(shè)計(jì)系統(tǒng)公司(NASDAQ:CDNS) 日前宣布，臺(tái)積電已與Cadence在Virtuoso定制和模擬設(shè)計(jì)平臺(tái)擴(kuò)大合作以設(shè)計(jì)和驗(yàn)證其尖端IP。
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Cadence的Virtuoso平臺(tái)的高級(jí)定制化設(shè)計(jì)介紹

  • 大型多領(lǐng)域模擬混合信號(hào)(AMS)系統(tǒng)在電子行業(yè)中越來(lái)越常見，此類設(shè)計(jì)必須同時(shí)滿足進(jìn)度和準(zhǔn)確度要求，從而給設(shè)計(jì)工程師帶來(lái)了極大的挑戰(zhàn)。本文介紹了一種結(jié)合自上而下和自下而上的方法來(lái)實(shí)現(xiàn) “中間相遇”，
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國(guó)民技術(shù)選擇Cadence作為先進(jìn)工藝系統(tǒng)SOC設(shè)計(jì)的優(yōu)選供應(yīng)商

  • 　　全球電子設(shè)計(jì)創(chuàng)新領(lǐng)先企業(yè)Cadence設(shè)計(jì)系統(tǒng)公司今天宣布，中國(guó)領(lǐng)先的無(wú)工廠IC設(shè)計(jì)企業(yè)國(guó)民技術(shù)股份有限公司在對(duì)Cadence® Virtuoso®、Encounter®、以及系統(tǒng)級(jí)封裝(SiP)技術(shù)進(jìn)行了縝密的評(píng)估后，認(rèn)為Cadence技術(shù)和方法學(xué)的強(qiáng)大組合，可幫助國(guó)民技術(shù)更好地實(shí)現(xiàn)在先進(jìn)工藝條件下，復(fù)雜的系統(tǒng)級(jí)SOC的高品質(zhì)設(shè)計(jì)。寄予這樣的評(píng)估國(guó)民技術(shù)選擇Cadence公司作為公司設(shè)計(jì)的EDA優(yōu)選供應(yīng)商，應(yīng)用其EDA軟件開發(fā)安全、通信電子市場(chǎng)尖端的系統(tǒng)級(jí)芯片(SoC)。 國(guó)
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華虹設(shè)計(jì)采用多種Cadence解決方案用于高級(jí)半導(dǎo)體設(shè)計(jì)

  • 　　全球電子設(shè)計(jì)創(chuàng)新領(lǐng)先企業(yè)Cadence設(shè)計(jì)系統(tǒng)公司宣布中國(guó)領(lǐng)先的無(wú)工廠半導(dǎo)體公司上海華虹集成電路有限責(zé)任公司(以下簡(jiǎn)稱華虹設(shè)計(jì))已經(jīng)采用多種Cadence解決方案及服務(wù)，為中國(guó)快速發(fā)展的電子市場(chǎng)設(shè)計(jì)高級(jí)芯片。華虹設(shè)計(jì)之所以采用Cadence的技術(shù)，是看中其技術(shù)實(shí)力，包括可制造性設(shè)計(jì)(DFM)的低功耗與模擬/射頻產(chǎn)品，以及Cadence的技術(shù)支持服務(wù)的優(yōu)勢(shì)。 　　華虹設(shè)計(jì)目前已經(jīng)獲得Cadence多種產(chǎn)品與解決方案的使用權(quán)，包括Cadence Incisive 功能驗(yàn)證、Encounter 數(shù)字IC設(shè)
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Cadence 端對(duì)端解決方案助華亞微實(shí)現(xiàn)一次性芯片成功

  • 　　【中國(guó)上海，2009年3月23日】- 全球設(shè)計(jì)創(chuàng)新領(lǐng)先企業(yè)Cadence設(shè)計(jì)系統(tǒng)公司(NASDAQ: CDNS)，今天宣布世界級(jí)數(shù)字電視與視頻處理解決方案系統(tǒng)級(jí)芯片IC供應(yīng)商華亞微電子有限公司 ( 華亞微 )已經(jīng)實(shí)現(xiàn)一次性芯片成功，目前已經(jīng)將一個(gè)面向液晶電視市場(chǎng)的0.162微米系統(tǒng)級(jí)芯片設(shè)計(jì)投入量產(chǎn)，實(shí)現(xiàn)了超過10%的尺寸縮減程度。 　　華亞微在選擇了Cadence作為其首要的EDA供應(yīng)商，并采用Cadence端到端企業(yè)解決方案后實(shí)現(xiàn)了此次成功，為高清電視、機(jī)頂盒和多媒體市場(chǎng)提供高性能芯片。該公
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Cadence強(qiáng)化的高級(jí)節(jié)點(diǎn)設(shè)計(jì)解決方案對(duì)定制IC設(shè)計(jì)實(shí)現(xiàn)經(jīng)過實(shí)際生產(chǎn)驗(yàn)證的改良

  • 　　全球電子設(shè)計(jì)創(chuàng)新領(lǐng)先企業(yè)Cadence設(shè)計(jì)系統(tǒng)公司(納斯達(dá)克: CDNS)，今天公布了一系列新的定制IC設(shè)計(jì)功能，幫助芯片制造商加快大型復(fù)雜設(shè)計(jì)的量產(chǎn)化，尤其是在65納米及以下的高級(jí)節(jié)點(diǎn)工藝。這些經(jīng)過實(shí)際生產(chǎn)證明對(duì)Virtuoso?技術(shù)的提升，進(jìn)一步強(qiáng)化了Cadence用于降低風(fēng)險(xiǎn)和提升生產(chǎn)力的同時(shí)管理幾何尺寸與復(fù)雜性的全套解決方案。 　　對(duì)Virtuoso? 定制設(shè)計(jì)平臺(tái)的主要改進(jìn)將會(huì)出現(xiàn)在最新版本中，提供更為緊密的可生產(chǎn)性整合、更好的寄生分析，更快的仿真工具，用于精確而高效地驗(yàn)證
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Cadence新技術(shù)加速模擬和混合信號(hào)驗(yàn)證

  • 　　全球電子設(shè)計(jì)創(chuàng)新領(lǐng)先企業(yè)Cadence設(shè)計(jì)系統(tǒng)公司(納斯達(dá)克: CDNS)，今天宣布Cadence®Virtuoso® Spectre® Circuit Simulator中的高級(jí)“turbo”技術(shù)目前已經(jīng)推出，這是業(yè)界領(lǐng)先的模擬SPICE電路仿真器，獲得了全面的晶圓廠支持。這種turbo技術(shù)能夠在提升性能的同時(shí)，確保硅片的精確性，讓設(shè)計(jì)師能夠驗(yàn)證他們復(fù)雜的大型模擬設(shè)計(jì)，例如PLL(phase-locked loops)、ADC(analog-to-di
  • 關(guān)鍵字： Cadence  turbo  Cadence?Virtuoso? Spectre? Circuit Simulator  

基于Virtuoso平臺(tái)的單片射頻收發(fā)系統(tǒng)電路設(shè)計(jì)

  • 本文基于對(duì)Cadance Virtuoso 平臺(tái)的研究，結(jié)合單片射頻收發(fā)芯片的設(shè)計(jì)實(shí)踐，討論了利用Virtuoso 完成的自頂向下、從系統(tǒng)到模塊、從前端到后端的整個(gè)設(shè)計(jì)流程，最終實(shí)現(xiàn)了一個(gè)完整的射頻芯片。
  • 關(guān)鍵字： 收發(fā)  系統(tǒng)  電路設(shè)計(jì)  射頻  單片  Virtuoso  平臺(tái)  基于  
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