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EEPW首頁(yè) >> 主題列表 >> 流水線

一個(gè)用于流水線模數(shù)轉(zhuǎn)換器的高精度、低功耗采樣保持電路

  • 介紹了一個(gè)用于高精度模數(shù)轉(zhuǎn)換器，采用0.25μmCMOS工藝的高性能采樣保持電路。該采樣保持電路的采樣頻率為20MHz，允許最大采樣信號(hào)頻率為10MHz，在電源
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關(guān)于處理器流水線，此流水線非彼流水線

  • 　　本文將討論處理器的一個(gè)重要的基礎(chǔ)知識(shí)：“流水線”。熟悉計(jì)算機(jī)體系結(jié)構(gòu)的讀者一定知道，言及處理器微架構(gòu)，幾乎必談其流水線。處理器的流水線結(jié)構(gòu)是處理器微架構(gòu)最基本的一個(gè)要素，猶如汽車底盤對(duì)于汽車一般具有基石性的作用，它承載并決定了處理器其他微架構(gòu)的細(xì)節(jié)。本文將簡(jiǎn)要介紹處理器的一些常見(jiàn)流水線結(jié)構(gòu)，讓您真正讀懂處理器流水線。　　1?從經(jīng)典的五級(jí)流水線說(shuō)起　　流水線的概念來(lái)源于工業(yè)制造領(lǐng)域，以汽車裝配為例來(lái)解釋流水線的工作方式，假設(shè)裝配一輛汽車需要四個(gè)步驟：　　第一步?jīng)_壓：制作車身外殼和底盤等部件?！?/li>
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Xilinx哈夫曼編碼系統(tǒng)設(shè)計(jì)　

  • 在圖像處理、文件傳真、視頻壓縮編碼中，哈夫曼編碼是最常用的一種編碼方式。本文設(shè)計(jì)并實(shí)現(xiàn)了對(duì)一段數(shù)字序列進(jìn)行哈夫曼編碼并將編碼結(jié)果串行輸出的電路模塊，電路由輸入數(shù)據(jù)的排序、數(shù)據(jù)的哈夫曼編碼、數(shù)據(jù)序列編碼的結(jié)果輸出三個(gè)核心模塊組成，在Xilinx平臺(tái)上通過(guò)硬件描述語(yǔ)言實(shí)現(xiàn)該電路。仿真結(jié)果表明，該電路編碼正確，并具有較高的工作頻率和編碼效率。
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數(shù)字電視CAS中DES加密模塊的FPGA實(shí)現(xiàn)

  • 一種基于FPGA的數(shù)據(jù)加密標(biāo)準(zhǔn)算法的實(shí)現(xiàn)。就資源優(yōu)先和性能優(yōu)先分別使用循環(huán)法和流水線法對(duì)DES加密算法進(jìn)行了設(shè)計(jì)，并對(duì)其進(jìn)行了比較。通過(guò)采用子密鑰簡(jiǎn)單產(chǎn)生和ROM優(yōu)化S盒的方法，對(duì)流水線法進(jìn)行改進(jìn)，達(dá)到了資源占用率低、加密速度快的效果。
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基于并行流水線技術(shù)的RS255/RS233譯碼器設(shè)計(jì)

  • 近年來(lái)，關(guān)于RS(255，223)碼譯碼器實(shí)現(xiàn)的算法得到了廣泛的關(guān)注，但是這些算法的實(shí)現(xiàn)速度都不太快，即便有速度稍高的，其占用硬件資源也較多，而一些占用硬件資源較少的算法速度卻很慢。本文采用基于ME算法的8倍并行設(shè)計(jì)方案，結(jié)合流水線技術(shù)，克服了上述算法的缺陷，利用盡可能少的硬件資源獲得了極高的譯碼速度。
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基于PLB總線的H.264整數(shù)變換量化軟核的設(shè)計(jì)

  • 提出了在FPGA上實(shí)現(xiàn)H.264中整數(shù)變換量化的方法，設(shè)計(jì)了基于動(dòng)態(tài)數(shù)據(jù)寬度和流水線技術(shù)的軟核(IP)，在處理速度和硬件資源方面分別進(jìn)行優(yōu)化。此軟核作為PowerPC的一個(gè)硬件加速模塊在Xilinx Virtex-ⅡPRO中進(jìn)行了驗(yàn)證。
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基于流水線及混合濾波技術(shù)的H．264去塊效應(yīng)模塊設(shè)計(jì)

  • 引 言圖像的編解碼技術(shù)是多媒體技術(shù)的關(guān)鍵，H．264／AVC是國(guó)際上最先進(jìn)的視頻壓縮技術(shù)，其主要特點(diǎn)是采用小尺寸整數(shù)余弦變換、1／4像素的運(yùn)動(dòng)估計(jì)精度、多參考幀預(yù)測(cè)，基于上下文可變長(zhǎng)度編碼和環(huán)路內(nèi)去塊效應(yīng)濾波器
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基于FPGA流水線結(jié)構(gòu)并行FFT的設(shè)計(jì)與實(shí)現(xiàn)

  • 離散傅里葉變換DFT在通信、控制、信號(hào)處理、圖像處理、生物信息學(xué)、計(jì)算物理、應(yīng)用數(shù)學(xué)等領(lǐng)域中有著廣泛的應(yīng)用。FFT算法是作為DFT快速算法提出的，它將長(zhǎng)序列的DFT分解為短序列的DFT，大大減少了運(yùn)算量。FFT的FPGA實(shí)
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針對(duì)Flash存儲(chǔ)特性的航天器大容量固態(tài)存儲(chǔ)技術(shù)

  • 隨著航天任務(wù)的不斷豐富、航天探測(cè)技術(shù)的不斷提高(如探測(cè)器種類增多，相機(jī)分辨率提高等)，中國(guó)空間站等重大戰(zhàn)略規(guī)劃的逐步實(shí)施，空間科技數(shù)據(jù)的采集速度與存儲(chǔ)總量需求大幅度攀升，對(duì)存儲(chǔ)器的容量、吞吐速率、數(shù)據(jù)管
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淺談機(jī)器視覺(jué)技術(shù)優(yōu)化流水線上的產(chǎn)品質(zhì)量控制

  • ThyssenKruppKrause有限公司是位于德國(guó)Bremen的全球性企業(yè)。該公司在整條流水線上使用康耐視的視覺(jué)技術(shù)來(lái)優(yōu)化產(chǎn)品的質(zhì)量控制，因此在質(zhì)量和成本效益方面體現(xiàn)了重要的優(yōu)勢(shì)作為向汽車行業(yè)提供流水線開(kāi)發(fā)和生產(chǎn)的復(fù)雜自
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流水線技術(shù)在編程器中的提速應(yīng)用

  • 　　摘要：美國(guó)思科公司總裁約翰·錢伯斯他在談到新經(jīng)濟(jì)的規(guī)律時(shí)說(shuō),現(xiàn)代競(jìng)爭(zhēng)已經(jīng)不是大魚(yú)吃小魚(yú),而是快的吃慢的.在現(xiàn)代競(jìng)爭(zhēng)中，效率有著決定性的作用。專業(yè)的燒錄器廠商是如何做到比山寨燒錄產(chǎn)品的快呢? 　　美國(guó)思科公司總裁約翰·錢伯斯他在談到新經(jīng)濟(jì)的規(guī)律時(shí)說(shuō),現(xiàn)代競(jìng)爭(zhēng)已“不是大魚(yú)吃小魚(yú),而是快的吃慢的.”在現(xiàn)代競(jìng)爭(zhēng)中，效率有著決定性的作用。 　　做嵌入式開(kāi)發(fā)的工程師都知道，一旦產(chǎn)品需要量產(chǎn)，批量生產(chǎn)的燒錄器必不可少。在調(diào)試階段，工程師可以用串口下載來(lái)實(shí)現(xiàn)代碼
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一種基于流水線的SpaceWire路由器研究

  • 　　近年來(lái)，隨著SpaceWire總線技術(shù)在航天航空領(lǐng)域的不斷應(yīng)用，SpaceWire路由器在理論和技術(shù)應(yīng)用方面也得到了飛速發(fā)展。國(guó)外，歐洲航天局 (ESA)已經(jīng)將速度為200 Mb/s抗輻射的SpaceWire路由器應(yīng)用到ESA的航天任務(wù)中。國(guó)內(nèi)，目前對(duì)SpaceWire路由器的研究還處于初級(jí)階段，設(shè)計(jì)的 SpaceWire路由器最高速度也只能達(dá)到100 Mb/s。為了提高路由器的傳輸速度，這里提出了一種基于流水線技術(shù)的SpaceWire路由器。 　　1 SpaceWire路由器概述 　　Space
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FPGA研發(fā)之道(10)架構(gòu)設(shè)計(jì)漫談(五)數(shù)字電路的靈魂-流水線

  • 　　流水線，最早為人熟知，起源于十九世紀(jì)初的福特汽車工廠，富有遠(yuǎn)見(jiàn)的福特，改變了那種人圍著汽車轉(zhuǎn)、負(fù)責(zé)各個(gè)環(huán)節(jié)的生產(chǎn)模式，轉(zhuǎn)變成了流動(dòng)的汽車組裝線和固定操作的人員。于是，工廠的一頭是不斷輸入的橡膠和鋼鐵，工廠的另一頭則是一輛輛正在下線的汽車。這種改變，不但提升了效率，更是拉開(kāi)了工業(yè)時(shí)代大生產(chǎn)的序幕。 　　如今，這種模式常常應(yīng)用于數(shù)字電路的設(shè)計(jì)之中，與現(xiàn)在流驅(qū)動(dòng)的FPGA架構(gòu)不謀而合。舉例來(lái)說(shuō)：某設(shè)計(jì)輸入為A種數(shù)據(jù)流，而輸出則是B種數(shù)據(jù)流，其流水架構(gòu)如下所示： 　　 ? 　　每個(gè)模塊只
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一種基于FPGA的流水線FIR濾波器設(shè)計(jì)

  • 　　摘要：有限沖擊響應(yīng)(FIR)濾波器是數(shù)字通信系統(tǒng)中常用的基本模塊。文章設(shè)計(jì)了一種流水結(jié)構(gòu)的FIR濾波器，通過(guò)FPGA對(duì)其進(jìn)行硬什加速控制。仿真結(jié)果驗(yàn)證了所設(shè)計(jì)的FIR流水結(jié)構(gòu)濾波器功能的正確性。 　　0 引言 　　隨著數(shù)字通信技術(shù)的快速發(fā)展，高質(zhì)量的信息處理對(duì)濾波器的性能和資源占有量提出了更高的要求。有限沖擊響應(yīng)(FIR)數(shù)字有限沖激響應(yīng)濾波器在語(yǔ)音、譜分析等數(shù)字信號(hào)處理領(lǐng)域有著廣泛的應(yīng)用，是信號(hào)處理系統(tǒng)中重要的組成部分，其性能往往對(duì)整個(gè)系統(tǒng)的性能和功耗產(chǎn)生至關(guān)重要的影響。因此，如何最大程度地優(yōu)化
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低功耗8-bit 200MSPS時(shí)間交織流水線ADC

  • 摘要：本文介紹了一款低功耗8位200MSPS的模數(shù)轉(zhuǎn)換器。ADC是由時(shí)間交織和逐級(jí)遞減技術(shù)來(lái)實(shí)現(xiàn)低功耗的。流水級(jí)和放大器的設(shè)計(jì)保證了低電流下滿足工藝、電壓、溫度(PVT)變化。本ADC采用0.35μm 雙層多晶硅柵三層金屬的CMOS工藝，在200MHz采樣頻率和41MHz輸入信號(hào)頻率下達(dá)到47.7dB的SNDR。
  • 關(guān)鍵字： ADC  放大器  無(wú)線通信  流水線  時(shí)鐘  201312  
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