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EEPW首頁 >> 主題列表 >> (synopsys)

R&S和Synopsys為加速LTE/LTE-Advanced設(shè)計達(dá)成戰(zhàn)略合作

  • 全球領(lǐng)先的半導(dǎo)體設(shè)計、驗證和制造軟件及知識產(chǎn)權(quán)（IP）供應(yīng)商新思科技有限公司（Synopsys, Inc.， 納斯達(dá)克股票市場代碼：SNPS）與無線和移動行業(yè)測試與測量解決方案主要供應(yīng)商羅德與施瓦茨公司（Rohde & Schwarz，簡稱R&S公司）今天宣布形成戰(zhàn)略合作關(guān)系，以加速服務(wù)于下一代LTE和LTE- Advanced標(biāo)準(zhǔn)的芯片、手機(jī)和基站的設(shè)計和驗證。Synopsys為此項合作提供了其在算法設(shè)計和驗證解決方案領(lǐng)域內(nèi)的優(yōu)勢技術(shù)，包括符合標(biāo)準(zhǔn)的參考庫；R&S公司則提供了它的信號發(fā)生器方面的專長以及
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Synopsys推出動態(tài)解析度自適應(yīng)解碼器軟件優(yōu)化版本

  • 　　全球領(lǐng)先的半導(dǎo)體設(shè)計、驗證和制造軟件及知識產(chǎn)權(quán)(IP)供應(yīng)商新思科技有限公司(Synopsys, Inc.， 納斯達(dá)克股票市場代碼：SNPS)日前宣布推出動態(tài)解析度自適應(yīng)(DRA)解碼器軟件的優(yōu)化版本，主要面向已廣泛應(yīng)用的DesignWare? ARC? Sound AS211SFX 和各種AS221BD 音頻處理器。
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Synopsys和華虹NEC合作推出低功耗參考流程3.0

  • 　　全球領(lǐng)先的半導(dǎo)體設(shè)計、驗證和制造軟件及知識產(chǎn)權(quán)(IP)供應(yīng)商新思科技有限公司(Synopsys, Inc.， 納斯達(dá)克股票市場代碼：SNPS)，以及中國大陸領(lǐng)先的IC代工服務(wù)供應(yīng)商上海華虹NEC電子有限公司(HHNEC)今日宣布：即日起推出130納米參考流程版本3.0。該參考流程是Synopsys和華虹NEC共同合作的結(jié)晶，它將Synopsys Eclypse? 低功耗解決方案加入到之前為設(shè)計師所提供的各種參考流程之中。
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Synopsys宣布提供DesignWareTM數(shù)據(jù)轉(zhuǎn)換器IP

  • 　　全球領(lǐng)先的半導(dǎo)體設(shè)計、驗證和制造軟件及知識產(chǎn)權(quán)(IP)供應(yīng)商新思科技有限公司日前宣布：該公司所提供經(jīng)芯片生產(chǎn)驗證的DesignWareTM數(shù)據(jù)轉(zhuǎn)換器IP，已被應(yīng)用于中芯國際廣受歡迎的65納米低漏電(Low Leakage)工藝技術(shù)。這可幫助設(shè)計工程師更有效地提升其芯片的功率，并在集成設(shè)計上達(dá)事半功倍之效。
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Synopsys推出HAPS?-600 系列

  • 　　全球領(lǐng)先的半導(dǎo)體設(shè)計、驗證和制造軟件及知識產(chǎn)權(quán)(IP)供應(yīng)商新思科技有限公司(Synopsys, Inc.， 納斯達(dá)克股票市場代碼：SNPS)日前宣布推出HAPS?-600 系列，這是其HAPS系列基于現(xiàn)場可編程門陣列(FPGA)原型驗證系統(tǒng)中容量最高的一款產(chǎn)品。HAPS-600系列將基于FPGA的原型驗證系統(tǒng)容量擴(kuò)展到高達(dá)相當(dāng)于8100萬ASIC門，從而確保了各種更大SoC項目的早期軟件開發(fā)。
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Synopsys和中芯國際合作推出新SoC綜合設(shè)計解決方案

  • 　　全球領(lǐng)先的半導(dǎo)體設(shè)計、驗證、和制造軟件及知識產(chǎn)權(quán) (IP) 的供應(yīng)商新思科技有限公司(納斯達(dá)克市場交易代碼：SNPS)和中芯國際集成電路制造有限公司(中芯國際，紐約證券交易所交易代碼：SMI，香港聯(lián)交所交易代碼：00981.HK)宣布已正式提供用于中芯國際先進(jìn)65-nm 工藝的系統(tǒng)級芯片 (SoC) 綜合設(shè)計解決方案。該解決方案將 Synopsys 豐富的 DesignWare? 接口、模擬 IP 產(chǎn)品組合和其他基礎(chǔ)性 IP，通過可調(diào)參考流程與 Galaxy? 實(shí)現(xiàn)平臺集成在一起。
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新思科技為創(chuàng)意電子達(dá)成首次流片就試產(chǎn)成功的成果

  • 　　全球半導(dǎo)體設(shè)計、驗證及制造軟件暨IP領(lǐng)導(dǎo)廠商新思科技(Synopsys)今日宣布，利用新思科技完整的DesignWare® SATA IP解決方案，包含控制器、實(shí)體層以及驗證IP，使創(chuàng)意電子(Global Unichip Corp.) 之GP5080固態(tài)硬盤系統(tǒng)單芯片第一次流片就試產(chǎn)成功之成果。 　　系統(tǒng)單芯片設(shè)計代工服務(wù)的龍頭企業(yè)創(chuàng)意電子，肯定了新思科技的DesignWare SATA IP在品質(zhì)、功耗、性能和功能集上的卓越性。對創(chuàng)意電子來說SATA的互通性是一個關(guān)鍵的需求，而新思科技是唯
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新思科技助力英飛凌實(shí)現(xiàn)40納米3G基帶處理器芯片設(shè)計成功

  • 　　新思科技有限公司日前宣布：英飛凌科技(西安)有限公司通過采用新思完整的、基于統(tǒng)一功率格式(UPF)的低功耗綜合、物理實(shí)現(xiàn)和驗證流程，完成了國內(nèi)首款采用40nm工藝技術(shù)的3G智能手機(jī)基帶處理器設(shè)計，并按照時間計劃成功實(shí)現(xiàn)一次流片成功。 　　為了達(dá)到芯片設(shè)計目標(biāo)，英飛凌確定了在設(shè)計過程中采用了Synopsys全套實(shí)施流程，包括Design Compiler編譯器、ICC布局工具等，同時引入新思的知識產(chǎn)權(quán)(IP)和支持服務(wù)。同時，還結(jié)合了英飛凌在移動通信基帶芯片領(lǐng)域里豐富的經(jīng)驗和工程師的創(chuàng)新能力。 　　
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2009年EDA廠商排名出爐 Synopsys仍占榜首

  • 　　由Gary Smith的EDA小組及Nancy Wu與Marry Olsson共同編輯的市場統(tǒng)計已經(jīng)完成。2009年最大的變化是Mentor超過Cadence成為EDA市場全球銷售額依產(chǎn)品計的第二。這也意味著市場向ESL方法論過渡。Synopsys仍是首位。 　　Mentor在IC設(shè)計居第二。在兼并Valor后mentor成為PCB設(shè)計的第三。 　　在Walden Rhines的帶領(lǐng)下當(dāng)轉(zhuǎn)向RTL設(shè)計方法時，相信近期Cadence已經(jīng)停止它的市場份額下降，十分相似于Mentor的變化。 　　
  • 關(guān)鍵字： Synopsys  EDA  

新思科技與中芯國際推出DesignWare USB 2.0 nanoPHY

  • 　　全球半導(dǎo)體設(shè)計制造軟件和知識產(chǎn)權(quán)領(lǐng)先企業(yè)新思科技有限公司和全球領(lǐng)先的半導(dǎo)體制造商中芯國際集成電路有限公司今天宣布開始提供用于中芯國際65納米(nanometer)低漏電(Low Leakage)工藝技術(shù)的新思科技經(jīng)硅驗證的和獲得USB標(biāo)志認(rèn)證的DesignWare® USB 2.0 nanoPHY知識產(chǎn)權(quán)(IP)。作為一家提供包括控制器、PHY和驗證IP等USB2.0接口完整IP解決方案的領(lǐng)先供應(yīng)商，新思科技繼續(xù)致力于通過提供高品質(zhì)IP助力設(shè)計人員降低集成風(fēng)險，這些IP具備了驗證過的互操作性，
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Synopsys推出快速原型系統(tǒng)HAPS-60系列

  • 下一代系統(tǒng)提供最高的性能、最高的容量、預(yù)測試IP和獨(dú)有先進(jìn)驗證功能 美國加利福尼亞州山景城，2010年5月—— 全球領(lǐng)先的半導(dǎo)體設(shè)計、驗證和制造軟件及知識產(chǎn)權(quán)（IP）供應(yīng)商新思科技有限公司（Nasdaq:SNPS）今天宣布推出快速原型系統(tǒng)HAPS™-60系列，這是一種可降低復(fù)雜SoC設(shè)計和驗證挑戰(zhàn)的綜合解決方案。HAPS-60系列是Confirma™ Rapid Prototyping Platform快速原型平臺的一部分，是一種易于使用和具有高性價比的快
  • 關(guān)鍵字： Synopsys  HAPS-60  SoC  

Synopsys綜合和布局及布線生產(chǎn)效率提升兩倍

  • 　　Synopsys日前宣布，在其Galaxy設(shè)計實(shí)現(xiàn)平臺中推出了最新的RTL綜合工具Design Compiler 2010，它將綜合和物理層實(shí)現(xiàn)流程增速了兩倍。Design Compiler自1988年問世以來，隨著工藝技術(shù)從1.5微米到32納米的進(jìn)步，而不斷得到調(diào)整升級。而今時序與面積布線的優(yōu)化已成為主要的挑戰(zhàn)，最新版工具與時俱進(jìn)，針對拓?fù)浼夹g(shù)進(jìn)行擴(kuò)展，為Synopsys布局布線解決方案IC Compiler提供“物理層指引”;將時序和面積的一致性提升至5%的同時，還將IC
  • 關(guān)鍵字： Synopsys  RTL  32納米  

Design Compiler 2010將綜合和布局及布線的生產(chǎn)效率提高2倍

  • 　　全球領(lǐng)先的半導(dǎo)體設(shè)計、驗證和制造的軟件及知識產(chǎn)權(quán)(IP)供應(yīng)商新思科技有限公司日前宣布：該公司在其Galaxy™設(shè)計實(shí)現(xiàn)平臺中推出了最新的創(chuàng)新RTL綜合工具Design Compiler 2010，它將綜合和物理層實(shí)現(xiàn)流程增速了兩倍。為了滿足日益復(fù)雜的設(shè)計中極具挑戰(zhàn)性的進(jìn)度要求，工程師們需要一種RTL綜合解決方案，使他們盡量減少重復(fù)工作并加速物理實(shí)現(xiàn)進(jìn)程。為了應(yīng)對這些挑戰(zhàn)，Design Compiler 2010對拓?fù)浼夹g(shù)進(jìn)行擴(kuò)展，為Synopsys旗艦布局布線解決方案IC Compile
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Synphony：IC設(shè)計因此而改變

  • 　　假如IC設(shè)計的速度能夠加快數(shù)倍，那么擁有各種復(fù)雜功能的各類電子產(chǎn)品將再次改變我們的生活。 　　IC設(shè)計中設(shè)計與驗證的流程通常需要數(shù)月甚至數(shù)年，其中的人工重新編碼的過程費(fèi)時且容易出錯，Synopsys選擇這一環(huán)節(jié)為突破，開發(fā)出了Synphony高層次綜合EDA工具，通過其獨(dú)特的MATLAB語言、基于模型的解決方案，針對ASIC和FPGA芯片設(shè)計實(shí)現(xiàn)了10倍的設(shè)計與驗證能力。 　　據(jù)Synopsys公司總監(jiān)Chris Eddington介紹，Synphony的創(chuàng)意來自被收購的Synplicity公司，
  • 關(guān)鍵字： Synopsys  IC設(shè)計  EDA  

Synopsys推出Synphony高層次綜合

  • 　　全球領(lǐng)先的半導(dǎo)體設(shè)計、驗證和制造軟件、硬件及知識產(chǎn)權(quán)(IP)供應(yīng)商新思科技公司(NASDAQ: SNPS)，今天宣布推出其Synphony HLS (High Level Synthesis)解決方案。該解決方案集成了M語言和基于模型的綜合法，與 傳統(tǒng)RTL流程相比，能夠為通信和多媒體應(yīng)用提供高達(dá)10倍速的更高的設(shè)計和驗證能力。Synphony HLS為ASIC 和 FPGA的應(yīng)用、架構(gòu)和快速原型生成最優(yōu)化的RTL。此外，通過在虛擬平臺中為系統(tǒng)驗證和早期軟件開發(fā)生成C模型，Synphony HLS補(bǔ)充
  • 關(guān)鍵字： Synopsys  Synphony  HLS  
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