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RTL
Writing TestbenchesFunctional Verification of HDL Models
積分：0分
hdl
rtl
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wangderfvl
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Synopsys-RTL_coding
積分：0分
Synopsys
RTL
coding
|
Jason_Zhang
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新型高精度時鐘芯片RTL-4553
積分：0分
時鐘芯片
RTL-4553
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xilinxue
下載
ASIC設(shè)計驗證
積分：0分
SYNPLICITY
FPGA
ASIC
設(shè)計驗證
Certify
SOC
RTL
|
foolish_girl
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Verilog邏輯仿真(3)
積分：0分
Verilog
任務(wù)
函數(shù)
綜合
RTL
|
foolish_girl
下載
用多片F(xiàn)PGA進行ASIC設(shè)計驗證的分區(qū)和綜合技術(shù)
積分：0分
SYNPLICITY
FPGA
ASIC
設(shè)計驗證
Certify
SOC
RTL
|
foolish_girl
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pcit32_verilog_lattice代碼
積分：0分
Lattice
32-Bit
PCI
ispMACH
RTL
HDL
MACH
|
tvro_china
下載
基于FPGA的全數(shù)字Costas環(huán)的設(shè)計與實現(xiàn)
積分：0分
Costas環(huán)
載波恢復(fù)
FPGA
RTL
DDS
|
sylar
下載
跨時鐘域設(shè)計經(jīng)典
積分：0分
Multi-Asynchronous Clock Desings
ASIC
MTBF
SDF
RTL
FIFO
|
Jason_Zhang
下載
夏宇聞著作《從算法設(shè)計到硬線邏輯的實現(xiàn)》虛擬器件和虛擬接口模型
積分：0分
虛擬器件
虛擬接口模型
大型數(shù)字系統(tǒng)
宏單元
Cores
RTL
Verilog HDL
VHDL
|
tvro_china
下載
FPGACPLD數(shù)字電路設(shè)計經(jīng)驗分享
積分：0分
FPGA
CPLD
數(shù)字電路
時序設(shè)計
時延路徑
RTL
建立時間
保持時間
|
Jason_Zhang
下載
FPGACPLD數(shù)字電路設(shè)計經(jīng)驗分享
積分：0分
FPGA
CPLD
數(shù)字電路
RTL
時延路徑
時序模型
|
Jason_Zhang
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Lattice Designing a 33MHz, 32-Bit PCI Target
積分：0分
Lattice
PCI
ispMACH Devices
RTL
HDL
MACH
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tvro_china
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FFT_report
積分：0分
FFT
VHDL
RTL
HDL
IEEE
DFT
ROM
RAM
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tvro_china
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an360 設(shè)計仿真模型for the POS-PHY Level 4 MegaCore
積分：0分
Altera
Updating Simulation Models
POS-PHY
PLL
LVDS
RTL
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tvro_china
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FPGA應(yīng)用文檔：將YCrCb轉(zhuǎn)為RGB
積分：0分
Xilinx
YcrCb
RGB
HDL
RTL
Color-Space Converter
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tvro_china
下載
CIC Xilinx FPGA trainning HDL code guide
積分：0分
CIC
Xilinx Synthesis
FPGA
RTL
Verilog HDL
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Hongjun
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CIC Xilinx FPGA training - simulation flow with ModelSim
積分：0分
CIC
Xilinx FPGA
Simulation Flow
ModelSim
RTL
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Hongjun
下載
IC 設(shè)計行業(yè)的朋友們推薦優(yōu)秀的書籍和相關(guān)資料
積分：0分
IC設(shè)計
HDL
Test
Functional Verification
RTL
ASIC
FPGA
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Tony
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擴頻載波通信電路KT8341的設(shè)計
積分：0分
RTL
GDS2
邏輯綜合
直接序列擴頻
偽隨機碼序列
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電子產(chǎn)品世界
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TINIS400外部串口參考設(shè)計
積分：0分
Texas Instruments
TINIS400外部串口
DSTINIS400
Verilog RTL
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電子產(chǎn)品世界
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EDA學(xué)習(xí)資料
積分：0分
EDA技術(shù)
CPLD
FPGA
VHDL
寄存器傳輸級(RTL)
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電子產(chǎn)品世界
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用來實現(xiàn)DSP算法的C合成方法
積分：0分
DSP算法
C合成方法
RTL
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電子產(chǎn)品世界
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關(guān)于視頻壓縮
積分：0分
視頻壓縮
DCT/IDCT
RTL
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電子產(chǎn)品世界
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RTL代碼優(yōu)化的文章
積分：0分
RTL
代碼優(yōu)化
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電子產(chǎn)品世界
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Synopsys - Describing Synthesizable RTL in SystemC
積分：0分
Synopsys
Synthesizable RTL
SystemC
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Verilog RTL Coding and Synthesis Mismatch
積分：0分
Verilog
RTL Coding
Synthesis
Mismatch
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英偉達
CUDA
RISC-V
指令集架構(gòu)
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美國公司被禁止在華從事人工智能業(yè)務(wù)，AWS上海AI研究院一夜落幕
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AWS
AI
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Fluke 1770 系列電能質(zhì)量分析儀介
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STC32G12K128的I2C外設(shè)讀寫AT24C04
suncat0504
2025-07-24
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新編常用穩(wěn)壓電源電路
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2025-07-24
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2025-07-23
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二十種常見開關(guān)電源拓撲結(jié)構(gòu)及其工作原理.docx
wenliang37
2025-07-23
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嵌入式技術(shù)與應(yīng)用開發(fā)項目教程：STM32版
wenliang37
2025-07-23
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【干貨】工業(yè)機器人編程教程-邏輯編程.docx
wenliang37
2025-07-23
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干貨！一文為你講清楚火爆全網(wǎng)的STM32串口通信.pdf
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