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高性能SERDES及其在CPRI接口的應(yīng)用分析

  • 1引言
    隨著數(shù)據(jù)寬帶網(wǎng)絡(luò)的迅猛發(fā)展，需要不斷提高系統(tǒng)設(shè)備的業(yè)務(wù)容量。目前的趨勢是采用高速串行通信技術(shù)，即采用串行解串器SERDES，把低速的并行數(shù)據(jù)轉(zhuǎn)換為高速串行數(shù)據(jù)連接。SERDES串行接口可在背板或電纜/光纖等
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SERDES的數(shù)字系統(tǒng)中高效時(shí)鐘設(shè)計(jì)方案

  • 電子產(chǎn)品世界,為電子工程師提供全面的電子產(chǎn)品信息和行業(yè)解決方案,是電子工程師的技術(shù)中心和交流中心,是電子產(chǎn)品的市場中心,EEPW 20年的品牌歷史,是電子工程師的網(wǎng)絡(luò)家園
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嵌入式微處理器IP core設(shè)計(jì)與分析

  • 嵌入式微處理器IP core設(shè)計(jì)與分析,摘要：本文在對傳統(tǒng)微控制器進(jìn)行系統(tǒng)分析的基礎(chǔ)上，提出了一種較好的改進(jìn)設(shè)計(jì)方法?；乇芰藗鹘y(tǒng)微控制器基于累加器的ALU結(jié)構(gòu)及算術(shù)邏輯指令：并在指令執(zhí)行時(shí)序上盡量減少指令執(zhí)行所需的時(shí)鐘周期。通過仿真驗(yàn)證證明該設(shè)
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基于嵌入式Linux的TFT LCD IP及驅(qū)動(dòng)的設(shè)計(jì)

  • 系統(tǒng)總體設(shè)計(jì)方案本系統(tǒng)的總體設(shè)計(jì)框圖如圖1所示。
    圖1 系統(tǒng)框圖

    Nios II處理器在SDRAM中開辟幀緩沖(Frame buffer)，可以是單緩沖也可以是雙緩沖。以單緩沖為例。處理器將一幀圖像數(shù)據(jù)(640times;480times;2Byt
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AVR AT90S1200 IP核設(shè)計(jì)及復(fù)用技術(shù)

  • 1 引言　　隨著芯片集成程度的飛速提高，一個(gè)電子系統(tǒng)或分系統(tǒng)可以完全集成在一個(gè)芯片上，IC產(chǎn)業(yè)中形成了以片上系統(tǒng)SOC(System-on-Chip)技術(shù)為主的設(shè)計(jì)方式。同時(shí)IC設(shè)計(jì)能力和EDA工具卻相對落后于半導(dǎo)體工藝技術(shù)的發(fā)
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移動(dòng)操作SoC接口IP組件設(shè)計(jì)

  • 移動(dòng)操作SoC接口IP組件設(shè)計(jì),　1 引言

    　　移動(dòng)操作或移動(dòng)計(jì)算（mobile computing）原是通訊領(lǐng)域的研究方向，隨著數(shù)字無線通信技術(shù)和嵌入式計(jì)算技術(shù)的發(fā)展、應(yīng)用與融合，移動(dòng)操作已逐步成為嵌入式系統(tǒng)中很具發(fā)展?jié)摿Φ囊粋€(gè)領(lǐng)域［1］。SoC（Sy
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基于IP軟電話設(shè)計(jì)的端到端視頻通信技術(shù)

  • 擁有軟電話視頻許可的用戶，只需要在桌面電腦上安裝Avaya的IP軟件電話，并且配置一個(gè)普通的USB攝像頭，即具備了端到端視頻通信功能。Avaya IP語音通信系統(tǒng)可為使用Avaya IP軟件電話的用戶提供端到端的視頻通信能力。
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TCP/IP的浮標(biāo)網(wǎng)絡(luò)通信系統(tǒng)設(shè)計(jì)策略

  • 水聲信道匹配基礎(chǔ)研究是建立在水聲學(xué)、海洋物理聲學(xué)以及現(xiàn)代信號處理技術(shù)基礎(chǔ)上的新興研究領(lǐng)域。為滿足研究需要而構(gòu)建的局部海域水聲信道測量平臺（圖 1），能夠?qū)崿F(xiàn)環(huán)境信息和信道參量的系統(tǒng)采集和實(shí)時(shí)傳遞，對信道
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基于IP核及可重構(gòu)設(shè)計(jì)的信息安全SoC芯片的實(shí)現(xiàn)

  • 基于IP核及可重構(gòu)設(shè)計(jì)的信息安全SoC芯片的實(shí)現(xiàn),當(dāng)前,信息安全防護(hù)已經(jīng)從傳統(tǒng)的單點(diǎn)信息加密發(fā)展到了以芯片級硬件防護(hù)為基礎(chǔ),構(gòu)建覆蓋全網(wǎng)絡(luò)系統(tǒng)的信息保障體系?；谛酒壍挠布鉀Q方案已經(jīng)成為保證信息安全的最可靠的途徑?？芍貥?gòu)信息安全SoC芯片是基于信息安全
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USB2.0主機(jī)控制器IP核的設(shè)計(jì)

  • USB2.0主機(jī)控制器IP核的設(shè)計(jì),摘要 ：為了擺脫對USB2.0 主機(jī)控制器ASIC 芯片的依賴，提高產(chǎn)品集成度，本文設(shè)計(jì)了針對全速和高速USB 海量存儲設(shè)備的USB2.0 主機(jī)控制器IP 核。首先介紹USB2.0 主機(jī)控制器IP核中主要涉及的USB2.0 通信協(xié)議以及與物理層
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基于SIP協(xié)議的IP電話通信系統(tǒng)的組成原理

  • 0 概述
    IP電話以其通話費(fèi)率低、方便集成和智能化等優(yōu)勢而得到了眾多消費(fèi)者的極大認(rèn)可，并因此而對原有固定電話運(yùn)營者的長途電話和國際電話業(yè)務(wù)造成了巨大沖擊。因此，隨著以太網(wǎng)接口的直接入戶，開發(fā)出一種帶有RJ-4
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NGN IP地址分配和路由的設(shè)計(jì)及規(guī)劃

  • NGN業(yè)務(wù)具有端到端(Peer-to-Peer)及永久在線(Always-on-Line)的通信模式，需要分配大量IP地址，存在公網(wǎng)IP地址不足的問題。同時(shí)運(yùn)營商在城域網(wǎng)中必須采用靜態(tài)路由、動(dòng)態(tài)路由、策略路由和路由策略等技術(shù)設(shè)置城域網(wǎng)路由
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基于FPGA LPM多功能信號發(fā)生器設(shè)計(jì)

基于FPGA的電子設(shè)計(jì)競賽電路板的設(shè)計(jì)與實(shí)現(xiàn)

基于FPGA的像素探測器數(shù)據(jù)緩存設(shè)計(jì)

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serdes ip介紹

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