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Synopsys IC Compiler II改變?cè)O(shè)計(jì)游戲規(guī)則后端物理設(shè)計(jì)吞吐量提高10倍
- 亮點(diǎn): 設(shè)計(jì)規(guī)劃速度提升了10倍,實(shí)現(xiàn)速度提升了5倍,容量提升了2倍?–?它們共同使吞吐量加速了10倍 構(gòu)建于全新的可擴(kuò)展基礎(chǔ)架構(gòu)、時(shí)序和解析優(yōu)化引擎之上 已經(jīng)在成熟和新興的技術(shù)節(jié)點(diǎn)上成功生產(chǎn)流片 為加速芯片和電子系統(tǒng)創(chuàng)新而提供軟件、知識(shí)產(chǎn)權(quán)(IP)及服務(wù)的全球性領(lǐng)先供應(yīng)商新思科技公司日前宣布:正式推出將導(dǎo)致游戲規(guī)則發(fā)生改變的IC?Compiler?II,它是當(dāng)前領(lǐng)先業(yè)界的布局和布線解決方案IC?Compiler?的繼任產(chǎn)品,可用于基于成熟和新
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工程師設(shè)計(jì)手冊(cè):集成“硬”IP模塊的幾點(diǎn)建議
- 對(duì)“硬”IP模塊—那些以GDSII數(shù)據(jù)庫形式提交的模塊—的集成,讓系統(tǒng)設(shè)計(jì)工程師能夠把某些過去不得不在公...
- 關(guān)鍵字: IP模塊 工程師經(jīng)驗(yàn)談 GDSII
Cadence推出新一代Encounter RTL-to-GDSII流程
- 全球電子設(shè)計(jì)創(chuàng)新領(lǐng)先企業(yè)Cadence設(shè)計(jì)系統(tǒng)公司(NASDAQ: CDNS),日前宣布推出最新版Cadence? Encounter? RTL-to-GDSII流程,面向高性能千兆級(jí)設(shè)計(jì),包括在20納米最新技術(shù)節(jié)點(diǎn)上的新設(shè)計(jì)。這種最新的RTL-to-GDSII設(shè)計(jì)、實(shí)現(xiàn)與簽收流程是與領(lǐng)先的IP與晶圓廠合作伙伴及客戶合作開發(fā)的,能更有效地進(jìn)行SoC開發(fā),滿足并超越當(dāng)今市場所需的功耗、性能與面積需求。
- 關(guān)鍵字: Cadence RTL-to-GDSII
Synopsys綜合和布局及布線生產(chǎn)效率提升兩倍
- Synopsys日前宣布,在其Galaxy設(shè)計(jì)實(shí)現(xiàn)平臺(tái)中推出了最新的RTL綜合工具Design Compiler 2010,它將綜合和物理層實(shí)現(xiàn)流程增速了兩倍。Design Compiler自1988年問世以來,隨著工藝技術(shù)從1.5微米到32納米的進(jìn)步,而不斷得到調(diào)整升級(jí)。而今時(shí)序與面積布線的優(yōu)化已成為主要的挑戰(zhàn),最新版工具與時(shí)俱進(jìn),針對(duì)拓?fù)浼夹g(shù)進(jìn)行擴(kuò)展,為Synopsys布局布線解決方案IC Compiler提供“物理層指引”;將時(shí)序和面積的一致性提升至5%的同時(shí),還將IC
- 關(guān)鍵字: Synopsys RTL 32納米
Design Compiler 2010將綜合和布局及布線的生產(chǎn)效率提高2倍
- 全球領(lǐng)先的半導(dǎo)體設(shè)計(jì)、驗(yàn)證和制造的軟件及知識(shí)產(chǎn)權(quán)(IP)供應(yīng)商新思科技有限公司日前宣布:該公司在其Galaxy™設(shè)計(jì)實(shí)現(xiàn)平臺(tái)中推出了最新的創(chuàng)新RTL綜合工具Design Compiler 2010,它將綜合和物理層實(shí)現(xiàn)流程增速了兩倍。為了滿足日益復(fù)雜的設(shè)計(jì)中極具挑戰(zhàn)性的進(jìn)度要求,工程師們需要一種RTL綜合解決方案,使他們盡量減少重復(fù)工作并加速物理實(shí)現(xiàn)進(jìn)程。為了應(yīng)對(duì)這些挑戰(zhàn),Design Compiler 2010對(duì)拓?fù)浼夹g(shù)進(jìn)行擴(kuò)展,為Synopsys旗艦布局布線解決方案IC Compile
- 關(guān)鍵字: Synopsys Galaxy RTL
中芯國際和新思科技攜手推出Reference Flow 4.0
- 全球領(lǐng)先的半導(dǎo)體設(shè)計(jì)、驗(yàn)證和制造軟件及知識(shí)產(chǎn)權(quán)(IP)供應(yīng)商新思科技公司與中國內(nèi)地最大的芯片代工企業(yè)中芯國際集成電路制造有限公司日前宣布,將攜手推出全新的65納米R(shí)TL-to-GDSII參考設(shè)計(jì)流程4.0(Reference Flow 4.0)。作為新思科技專業(yè)化服務(wù)部與中芯國際共同開發(fā)的成果,該參考流程中增加了 Synopsys Eclypse™ 低功耗解決方案及IC Compiler Zroute布線技術(shù),為設(shè)計(jì)人員解決更精細(xì)工藝節(jié)點(diǎn)中遇到的低功耗和可制造性設(shè)計(jì)(DFM)等問題提供更多
- 關(guān)鍵字: 中芯國際 65納米 Galaxy RTL-to-GDSII參考設(shè)計(jì)流程4.0
Magma 最新版Talus Design面世
- 美國加州圣荷塞 2009年4月14日– 芯片設(shè)計(jì)解決方案供應(yīng)商微捷碼(Magma®)設(shè)計(jì)自動(dòng)化有限公司(納斯達(dá)克代碼:LAVA)日前宣布,該公司面向先進(jìn)集成電路的全芯片綜合產(chǎn)品Talus® Design的最新版本正式面市。新版Talus® Design包括了一個(gè)增強(qiáng)的時(shí)序優(yōu)化引擎、改善的內(nèi)存使用效率以及先進(jìn)的生產(chǎn)率改進(jìn),比如:創(chuàng)新性可用性、更為靈活的先進(jìn)腳本語言以及領(lǐng)先的第三方可測性設(shè)計(jì)(DFT)產(chǎn)品支持。同時(shí),Talus Design與Talus Vortex相結(jié)
- 關(guān)鍵字: Magma RTL DFT Talus
采用高級(jí)節(jié)點(diǎn)ICs實(shí)現(xiàn)從概念到推向消費(fèi)者的最快途徑(08-100)
- 在一個(gè)依靠消費(fèi)者對(duì)更精密產(chǎn)品的需求越來越高的市場里,半導(dǎo)體公司正在迅速地向45納米、以及更小的高級(jí)工藝節(jié)點(diǎn)發(fā)展。這些技術(shù)帶來了芯片質(zhì)量和性能的大大提升,在系統(tǒng)級(jí)芯片上實(shí)現(xiàn)了更高級(jí)的復(fù)雜應(yīng)用功能整合程度。然而,隨著更多的設(shè)計(jì)進(jìn)化到高級(jí)技術(shù),半導(dǎo)體公司面臨的設(shè)計(jì)挑戰(zhàn)也在激增,無法確保迅速量產(chǎn)的風(fēng)險(xiǎn)也在提高。
- 關(guān)鍵字: Cadence ICs GDSII
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