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CSIP與Mentor聯(lián)合舉辦SoC協(xié)同仿真培訓

  •     2005年5月16日至5月17日，信息產(chǎn)業(yè)部軟件與集成電路促進中心（CSIP）與著名EDA工具提供商Mentor Graphics公司（Mentor）聯(lián)合舉辦了為期兩天的“Seamless SoC系統(tǒng)軟硬件協(xié)同仿真技術(shù)培訓”。包括中星微、北大、計算所、NEC、Freescale等多家IC設計單位的工程師參加了此次培訓。  Mentor公司的Seamless產(chǎn)品可提供無縫的協(xié)同驗證環(huán)境，使設計者在嵌入式軟件執(zhí)行和硬件仿真之間建立聯(lián)系，更方便
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Cypress擴大PSoC產(chǎn)品陣營

  • PSoC器件是面向消費、工業(yè)、辦公自動化、電信和汽車應用中的大量嵌入式控制功能而開發(fā)的高性能、現(xiàn)場可編程、混合信號陣列。以其硬件的可配置性和動態(tài)重構(gòu)等特點，引起了業(yè)界的廣泛關(guān)注。Cypress MicroSystems 最新的CY8C24xxx和CY8C22xxx系列器件是真正的系統(tǒng)級芯片，均包括一個24MHz 8位MCU；分別含有4kbytes和2kbytes的快速擦寫存儲器；256bytes的SRAM；一個帶32位累加器的8
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SoC系統(tǒng)描述與SystemC

  • 摘    要：隨著VLSI工藝技術(shù)的發(fā)展，為了縮短開發(fā)周期，提高設計的可預見性，SoC設計已經(jīng)成為迫切需求。本文將比較C++、VHDL和SystemC，說明SystemC是一種非常好的系統(tǒng)描述語言。同時利用C++和VHDL的語法來深入介紹SystemC的語法。 引言在早期的集成電路設計過程中，由于低抽象層次的設計問題比高抽象層次的設計問題手工處理更難，這迫使研究者首先把注意力集中到低層次設計問題上。例如：電路仿真、布局、布線和布局規(guī)劃。隨著低層次設計問題變得易于處理，邏輯仿
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以系統(tǒng)為中心的全層次納米級SoC設計方法學

  • 引言2003年SoC的收入達到了310億美元，隨著通信行業(yè)及個人電子設備市場的快速發(fā)展，這一數(shù)字有望在2008年再翻上一番。其主要應用領域包括：數(shù)字蜂窩式移動電話及基礎設施、存儲設備、視頻游戲機、消費類顯示設備、圖形卡、數(shù)字電視、個人電腦用主板、寬帶接入設備以及DVD等。個人電子設備需求的持續(xù)上升表示SoC設計正發(fā)展到一個轉(zhuǎn)折點，因為此類系統(tǒng)的產(chǎn)品壽命一般都不會超過一年，而新產(chǎn)品的問世周期為兩年。研究表明，一項高科技新產(chǎn)品只要延遲上市6個月，其生命周期內(nèi)的收入就要減少大概30%。而且，近年來這種商業(yè)影響有
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測試復雜的多總線SoC器件

  • 使用多個復雜的總線已經(jīng)成為系統(tǒng)級芯片(SoC)器件的標準，這種總線結(jié)構(gòu)的使用使測試工程師面臨處理多個時鐘域問題的挑戰(zhàn)。早期器件的測試中，工程師可以依賴某些自動化測試設備(ATE)的雙時域能力測試相對簡單的總線結(jié)構(gòu)。目前測試工程師面臨更復雜的SoC器件，這些器件反應了越來越多使用多個高速總線結(jié)構(gòu)的趨勢。使用有效的技術(shù)和下一代測試系統(tǒng)，如Credence(科利登)的Octet，測試工程師能夠成功地管理與復雜SoC器件(如北橋器件)中多總線結(jié)構(gòu)相關(guān)的獨立時鐘域。通過掌握ATE的能力，測試開發(fā)過程中，測試工程師能
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低功耗SoC存儲器設計選擇

  • 當今的設計師面對無數(shù)的挑戰(zhàn)：一方面他們必須滿足高技術(shù)產(chǎn)品不斷擴展的特性需求，另一方面卻不得不受到無線和電池裝置的電源限制。沒有任何技術(shù)在這方面的要求比SoC的設計更為明顯，在這種設計中，高級工藝比從前復雜的多。然而，上述技術(shù)造成了新的電源問題。現(xiàn)代SoC系統(tǒng)的關(guān)鍵之一就是：嵌入存儲器在芯片中的比例在不斷增長。當存儲器開始主導SoC時，應用節(jié)能技術(shù)使存儲器獲得系統(tǒng)電源變得十分重要。重要問題之一就是：在系統(tǒng)結(jié)構(gòu)方面，是嵌入系統(tǒng)存儲器還是把存儲器放在SoC之外。在以前的技術(shù)中，電源不是要考慮的一個主要因素，而成
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基于ARM內(nèi)核的手持設備SoC

  •  摘    要：本文研究并開發(fā)了一款針對手持設備、內(nèi)嵌ARM7TDMI內(nèi)核的系統(tǒng)芯片。在設計這款芯片的過程中，MP3算法的軟硬件分割和芯片的低功耗設計是主要挑戰(zhàn)。本文介紹了該系統(tǒng)芯片的結(jié)構(gòu)，并著重介紹了軟硬件分割和低功耗設計技術(shù)。關(guān)鍵詞：系統(tǒng)芯片；低功耗；ARM；MP3 引言隨著半導體技術(shù)的進步和芯片設計方法—IP重用技術(shù)的出現(xiàn)，SoC在消費類電子產(chǎn)品中已經(jīng)越來越普遍。本課題組去年啟動了稱為Garfield的SoC項目。Garfield定義為一款面向中低端PDA的
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利用SoC單片機的多功能數(shù)據(jù)采集卡

  • 摘    要：本文介紹了一種SoC單片機控制的多功能數(shù)據(jù)采集卡，在輸入通道中增加程控濾波、程控增益放大器和多級陷波電路，采集卡的功能選擇和參數(shù)改變均由SoC單片機軟件控制。本文給出了關(guān)鍵部分的電路圖、元件參數(shù)和實測數(shù)據(jù)。關(guān)鍵詞：SoC 單片機；程控放大；程控陷波 引言目前大多數(shù)的數(shù)據(jù)采集卡并不能適應工業(yè)控制現(xiàn)場或像野外那樣存在多種噪聲干擾的使用環(huán)境，特別是對50Hz工頻干擾及其諧波干擾無法起到抑制作用。在這種情況下，采集到的數(shù)據(jù)往往有很多錯誤或者采集卡無法正常工作。本數(shù)據(jù)采
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基于C*SoC200的32位稅控機專用系統(tǒng)芯片設計

  • 摘    要：本文首先介紹了一個32位嵌入式稅控機專用系統(tǒng)芯片C3118的功能、結(jié)構(gòu)和特點，然后分析了一個自動化程度很高的SoC設計平臺——C*SoC200，對該平臺的主要結(jié)構(gòu)和功能進行了分析。關(guān)鍵詞：IP；SoC；平臺；仿真 引言2003年7月，中國國家質(zhì)量監(jiān)督檢驗檢疫總局發(fā)布了由稅控機國家標準制定委員會制定的稅控收款機國家標準。并將陸續(xù)出臺一系列的管理法規(guī)。為了滿足國家標準的要求，各稅控機生產(chǎn)廠家都在積極使用32位MCU開發(fā)符合新規(guī)范的稅控機。而32位的嵌入式稅控機專用
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可重定位的基于事務的系統(tǒng)級驗證

  • 功能驗證已經(jīng)成為開發(fā)SoC的主要問題。隨著一些復雜SoC的規(guī)模超過兩千萬門，以及對開發(fā)和集成嵌入式軟件的需求持續(xù)增加，軟件模擬器已經(jīng)力所不及。在設計過程需要幾百萬個時鐘周期來充分測試和驗證軟件功能的情況下，軟件仿真器的性能下降到1-5Hz。按照這種速率，軟件調(diào)試需要幾年的時間。如果設計項目組不能夠投入這么多的時間，則意味著SoC芯片制造出來之后，在加電后的幾秒內(nèi)就會出現(xiàn)錯誤?；谑聞盏尿炞C允許代表單個或者多個時鐘周期的大量數(shù)據(jù)不經(jīng)多次調(diào)用而直接進入模擬器，極大地提高了模擬性能。到目前為止，驗證環(huán)境都是基于
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合理選擇SoC架構(gòu)

  • 找到價格、性能和功耗的最佳結(jié)合點實際上就確保贏得了SoC設計，但說起來容易做起來難。在實際可用的雙芯核架構(gòu)、可編程加速器和數(shù)百萬門FPGA出現(xiàn)以前，一種80:20法則用起來很奏效：如果計算負荷的80%為數(shù)據(jù)處理，那么選擇RISC架構(gòu)，在RISC中實施信號處理。而當今面臨太多的架構(gòu)選擇，差別甚微，用單一處理器架構(gòu)來解決優(yōu)化問題已不可能。一種較為成功的方法是通過將計算資源與特性集匹配來實現(xiàn)。將一種復雜系統(tǒng)映射到硅中，在相當程度上依賴于設計是在現(xiàn)有SoC上實現(xiàn)還是從頭做起。對于前一種情況，系統(tǒng)設計師應從了解四個
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嵌入式視頻網(wǎng)絡服務器的開發(fā)及其應用

  • 摘    要：本文詳細介紹了一套嵌入式視頻網(wǎng)絡服務器系統(tǒng):視頻數(shù)據(jù)壓縮部分由MPEG-X協(xié)議的ASIC芯片完成,嵌入式CPU只負責控制。它采用了壓縮與控制分離的方式，提高了系統(tǒng)的靈活性和整體性價比。最后，本文給出了該視頻服務器在校園親子監(jiān)控系統(tǒng)中的一個應用實例。關(guān)鍵詞：MPEG-X； RISC CPU； 親子監(jiān)控系統(tǒng) 引言近幾年隨著嵌入式技術(shù)的蓬勃發(fā)展，出現(xiàn)了基于嵌入式視頻服務器技術(shù)的遠程網(wǎng)絡視頻監(jiān)控設備。嵌入式視頻服務器的主要工作原理是：模擬視頻信號經(jīng)A/D后，采用MPE
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可配置系統(tǒng)級驗證環(huán)境加速SoC開發(fā)

  • 利用嵌入式硅IP可以縮短SoC設計所需的開發(fā)時間，這已成為眾所公認的事實。但要從完工后的整個系統(tǒng)角度出發(fā)，整合及驗證來自多家廠商的元件，需要相當?shù)臅r間和努力，然而它們卻常被忽略。這會對嵌入式軟件開發(fā)人員造成額外負擔，因為他們需要SoC的外圍和接口以及處理器的精確模型，才能在設計投片之前，針對正在開發(fā)的SoC，迅速完成應用固件的測試及除錯。如果SoC平臺以可配置處理器和外圍IP為基礎，這些IP又來自多家供貨商，這種情形就更加重要，因為設計人員必須確認在特定配置下，每個元件的功能不會影響到其它元件的工作。除此
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雙層AMBA總線設計及其在SoC芯片設計中的應用

  • 摘    要：AMBA總線是目前主流的片上總線。本文給出的雙層AMBA總線設計能極大地提高總線帶寬，并使系統(tǒng)架構(gòu)更為靈活。文章詳細介紹了此設計的實現(xiàn)，并從兩個方面對兩種總線方式進行了比較。關(guān)鍵詞：雙層AMBA總線;總線帶寬;SoC 引言一般說來，SoC芯片是由片上芯核、用戶設計的IP核以及將這兩者集成在一起的總線組成的。片上芯核決定了使用何種片上總線以及芯片的體系結(jié)構(gòu)。ARM系列嵌入式微處理器憑借其高性能、低功耗的特點占據(jù)了市場的主要份額，ARM7TDMI因其相對低廉的價格
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從MATLAB看SoC設計途徑

  • 過去幾年中，SoC還是個讓業(yè)界摸索其定義和作法的階段，然而，這個階段很顯然已經(jīng)跨越，沒有多少人懷疑今日的晶片設計必須有系統(tǒng)化的架構(gòu)與能力了?，F(xiàn)階段IC設計業(yè)者所關(guān)注的問題已經(jīng)轉(zhuǎn)向：如何以又快又好的方式來發(fā)展SoC晶片
  • 關(guān)鍵字： MATLAB  SoC  
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