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EEPW首頁 >> 主題列表 >> risc-v 架構(gòu)

FSL總線IP核及其在MicoBlaze系統(tǒng)中的應(yīng)用

  • 　　引 言 　　隨著半導(dǎo)體制造工藝的發(fā)展，以FPGA(現(xiàn)場可編程門陣列)為代表的新一代可編程邏輯器件(PLD)的邏輯資源密度不斷增加，使得可編程技術(shù)很自然地就與系統(tǒng)芯片集成技術(shù)(SoC)的結(jié)合日益緊密，并逐步成為可配置平臺技術(shù)(configurable platform)的主流。 　　目前，各主要PLD廠商基于FPGA的可配置平臺雖然大都采用“微處理器十可編程邏輯”的架構(gòu)，但在開發(fā)基于FPGA的嵌入式系統(tǒng)時，卻采用了各自不同的方式來整合處理器系統(tǒng)與片上的其他邏輯資源(大多數(shù)以用
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利用MAXQ3210構(gòu)建水位監(jiān)測報警系統(tǒng)

  • 　　概述 　　MAXQ3210微控制器是一款功能強(qiáng)大的RISC微控制器，器件所具備的功能和特性使其非常適合電池供電的監(jiān)控和音頻報警系統(tǒng)。微控制器內(nèi)部集成了5V至9V穩(wěn)壓器、壓電揚(yáng)聲器驅(qū)動器和模擬比較器，大大降低了系統(tǒng)的元件數(shù)量。另外，停機(jī)模式、喚醒模式等多種低功耗特性使其在9V電池供電時能有效延長工作時間。 　　本應(yīng)用筆記提供了一個利用MAXQ3210微控制器實(shí)現(xiàn)水位監(jiān)測及音頻報警的系統(tǒng)，該系統(tǒng)利用礦物質(zhì)對水的電導(dǎo)率的影響來檢測水位，并在必要時給出報警信號。本文介紹的方案還不能直接用作最終產(chǎn)品，只是說
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為頻率捷變應(yīng)用選擇信號發(fā)生器

8位微控制器體系架構(gòu)的設(shè)計研究

  • 　　摘  要: 本文分析了目前8位微控制器的更新和設(shè)計趨勢，主要討論其RISC體系架構(gòu)的產(chǎn)品設(shè)計，并重點(diǎn)從體系架構(gòu)的角度出發(fā)，就高性能、低功耗兩方面對在設(shè)計中采用的關(guān)鍵技術(shù)進(jìn)行了探討研究。  　　關(guān)鍵詞： RISC；微控制器；低功耗；流水線  　　1．引言 　　微控制器(Microcontroller)自上世紀(jì)70年代出現(xiàn)以來，在將近30年的時間里得到了迅猛的發(fā)展和廣泛的應(yīng)用。隨著微電子技術(shù)的飛速發(fā)展，微控制器以其性能好、體積小、價格優(yōu)、功能齊全等突出優(yōu)點(diǎn)被廣泛應(yīng)用于家
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針對EDGE/GSM手機(jī)發(fā)送電路的四種架構(gòu)分析

  • 為采用8PSK調(diào)制支持2.75G EDGE標(biāo)準(zhǔn)，手機(jī)設(shè)計工程師和芯片組供應(yīng)商面臨著新的挑戰(zhàn)。為滿足成本、功耗和制造工藝的需求，我們提出如下四種發(fā)送電路架構(gòu)：極性反饋(Polar Feedback)“Lite”、極性反饋、極性開環(huán)、直接調(diào)制(零差)。
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開放性32位RISC處理器IP核的比較與分析

  • 　　引言 　　隨著VLSI設(shè)計技術(shù)和深亞微米制造技術(shù)的飛速發(fā)展， SOC (System on Chip ) 技術(shù)逐漸成為了集成電路設(shè)計的主流技術(shù)。SOC 已經(jīng)在便攜式手持設(shè)備、無線網(wǎng)絡(luò)終端和多媒體娛樂設(shè)備等領(lǐng)域得到了廣泛的應(yīng)用。 　　高性能的處理器核是SOC設(shè)計中最為關(guān)鍵和核心的部分。絕大多數(shù)SOC 的處理器都采用了RISC體系結(jié)構(gòu)。RISC 處理器具有指令效率高、電路面積小和功率消耗低等特點(diǎn)， 滿足了SOC 高性能、低成本和低功耗的設(shè)計要求。目前在SOC 設(shè)計中廣泛使用的32bit RISC 處理
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開放性32位RISC處理器IP核的比較與分析

  • 　　引言 　　隨著VLSI設(shè)計技術(shù)和深亞微米制造技術(shù)的飛速發(fā)展， SOC (System on Chip ) 技術(shù)逐漸成為了集成電路設(shè)計的主流技術(shù)。SOC 已經(jīng)在便攜式手持設(shè)備、無線網(wǎng)絡(luò)終端和多媒體娛樂設(shè)備等領(lǐng)域得到了廣泛的應(yīng)用。 　　高性能的處理器核是SOC設(shè)計中最為關(guān)鍵和核心的部分。絕大多數(shù)SOC 的處理器都采用了RISC體系結(jié)構(gòu)。RISC 處理器具有指令效率高、電路面積小和功率消耗低等特點(diǎn)， 滿足了SOC 高性能、低成本和低功耗的設(shè)計要求。目前在SOC 設(shè)計中廣泛使用的32bit RISC 處理
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解決手機(jī)射頻和混合信號集成問題

一種基于數(shù)字鎖相環(huán)的調(diào)頻發(fā)射器架構(gòu)

  • 為了克服傳統(tǒng)的調(diào)頻FM發(fā)射器架構(gòu)的這些缺點(diǎn)，KT Micro公司設(shè)計并發(fā)表了一款基于數(shù)字信號處理技術(shù)(DSP)的高集成調(diào)頻FM發(fā)射器芯片－KT0801。該芯片可以為便攜式設(shè)備應(yīng)用提供業(yè)界領(lǐng)先的性能和系統(tǒng)集成度。
  • 關(guān)鍵字： 發(fā)射器  架構(gòu)  調(diào)頻  相環(huán)  數(shù)字  基于  

開放性32位RISC處理器IP核的比較與分析

  • ???????? 比較和分析了LEON2，OpenRISC1200，NiosII 等3 種開放性RISC 處理器IP 核的結(jié)構(gòu)特點(diǎn)， 然后分以三種處理器為核心在FPGA 平臺上構(gòu)建了一個評測系統(tǒng)。 ???? ??? 采用Dhrystone 2.1 基準(zhǔn)測試程序評測了它們的性能最后在0.18um 的CMOS工藝下進(jìn)行了綜合， 給出了它們在ASIC 平臺下面積
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PDP顯示器電源管理架構(gòu)分析

基于nRF24E1的無線點(diǎn)菜系統(tǒng)架構(gòu)

革命性架構(gòu)推動閃存領(lǐng)域發(fā)展

  • 　　Spansion以非易失性存儲技術(shù)的持續(xù)創(chuàng)新推動閃存領(lǐng)域的發(fā)展。在本世紀(jì)初推出MirrorBit技術(shù)之后，Spansion以MirrorBit ORNAND技術(shù)和2006年推出的世界首款每單元4比特MirrorBit Quad技術(shù)，不斷引領(lǐng)市場?，F(xiàn)在，Spansion又推出了強(qiáng)大的革命性MirrorBit Eclipse架構(gòu)，為多功能手機(jī)及多媒體便攜設(shè)備提供更高性能和更低成本，顯著降低手機(jī)OEM廠商存儲子系統(tǒng)材料(BOM)成本。 　　MirroBit Eclipse工作原理 　　完整的陣列可以在相
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基于OMAP架構(gòu)的智能手持設(shè)備設(shè)計

  • 基于OMAP架構(gòu)的智能手持設(shè)備設(shè)計,本文結(jié)合手持設(shè)備的發(fā)展趨勢,介紹了TI公司的OMAP1510芯片,以及基于這款SoC的系統(tǒng)設(shè)計。
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采用0.13微米工藝實(shí)現(xiàn)低成本多處理器平臺

  • 有時候，用最新和最好的工藝技術(shù)設(shè)計一款SoC（單片系統(tǒng)），并不是影響成本敏感的消費(fèi)電子市場的方式。...
  • 關(guān)鍵字： 模塊  架構(gòu)  反饋  解碼  
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