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基于FPGA解決物聯(lián)網(wǎng)實(shí)現(xiàn)的核心3大挑戰(zhàn)

  • 物聯(lián)網(wǎng)(IoT)已成為一個(gè)廣受歡迎的名詞，幾乎每一個(gè)電子設(shè)備相互連接到互聯(lián)網(wǎng)上加以使用，并且呈現(xiàn)爆炸式增長(zhǎng)。但這種增長(zhǎng)卻恰恰帶來(lái)了它的實(shí)戰(zhàn)挑戰(zhàn)，一
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時(shí)序分析的一些基本概念

  • 時(shí)序分析時(shí)FPGA設(shè)計(jì)中永恒的話(huà)題，也是FPGA開(kāi)發(fā)人員設(shè)計(jì)進(jìn)階的必由之路。慢慢來(lái)，先介紹時(shí)序分析中的一些基本概念。
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掌握三大原則，輕松分配FPGA引腳

  • 現(xiàn)在的FPGA正變得越來(lái)越復(fù)雜，向引腳分配信號(hào)的任務(wù)曾經(jīng)很簡(jiǎn)單，現(xiàn)在也變得相當(dāng)繁復(fù)。下面這些用于向多用途引腳指配信號(hào)的指導(dǎo)方針有助于設(shè)計(jì)師根據(jù)最
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Verilog的語(yǔ)言要素有哪些？

  • 本章介紹Verilog HDL的基本要素，包括標(biāo)識(shí)符、注釋、數(shù)值、編譯程序指令、系統(tǒng)任務(wù)和系統(tǒng)函數(shù)。另外，本章還介紹了Verilog硬件描述語(yǔ)言中的兩種數(shù)據(jù)類(lèi)
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詳細(xì)介紹數(shù)字時(shí)鐘管理模塊與嵌入式塊RAM

  • 3.數(shù)字時(shí)鐘管理模塊(DCM)業(yè)內(nèi)大多數(shù)FPGA 均提供數(shù)字時(shí)鐘管理( 賽靈思公司的全部FPGA 均具有這種特性)。賽靈思公司推出最先進(jìn)的FPGA 提供數(shù)字時(shí)鐘管理
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詳解底層內(nèi)嵌功能單元與軟核、硬核以及固核

  • 6、底層內(nèi)嵌功能單元內(nèi)嵌功能模塊主要指DLL(Delay Locked Loop)、PLL(Phase Locked Loop)、DSP 等軟處理核(Soft Core)?，F(xiàn)在越來(lái)越豐富的內(nèi)嵌功能單元
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MSP430低功耗原理及其在海溫測(cè)量中的應(yīng)用解讀

  • MSP430系列單片機(jī)是一款具有精簡(jiǎn)指令集的16位超低功耗混合型單片機(jī)。采用MSP430系列單片機(jī)的一個(gè)最大優(yōu)勢(shì)是它具有低功耗和高集成度，非常適合于電池供
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全面解析超低功耗mcu的選型技巧與設(shè)計(jì)思路

  • 循序漸進(jìn)式的功耗優(yōu)化已經(jīng)不再是超低功耗mcu的游戲規(guī)則，而是ldquo;突飛猛進(jìn)rdquo;模式，與功耗相關(guān)的很多指標(biāo)都不斷刷新記錄。我們?cè)谶x擇合適的超低
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如何設(shè)計(jì)基于FPGA和USB2.0的高精度數(shù)據(jù)采集系統(tǒng)？

  • 現(xiàn)代電子偵查技術(shù)要求能夠?qū)ν獠磕M信號(hào)進(jìn)行精確提取和分析，從而對(duì)數(shù)據(jù)采集的精度提出了很高的要求，本文提出了一種以FPGA 作為主控制器的高精度500
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FPGA與CPU的關(guān)系

  • 說(shuō)起CPU，大家都已經(jīng)很熟悉了，是“中央處理器”的英文縮寫(xiě)，它是用來(lái)“運(yùn)算”的。而技術(shù)上來(lái)說(shuō)，F(xiàn)PGA也由非常多的核組成的，F(xiàn)PGA號(hào)稱(chēng)“萬(wàn)能芯片”，那
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如何基于多DSP互聯(lián)技術(shù)研究頻譜監(jiān)測(cè)儀？

  • 0 引言隨著微波技術(shù)的廣泛發(fā)展，空間和地面電磁環(huán)境越來(lái)越復(fù)雜，無(wú)線(xiàn)電頻譜資源作為公共資源的一種，需要頻譜管理部門(mén)進(jìn)行有效的分配和監(jiān)控。特別是在
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AWS詳述FPGA基本原理和市場(chǎng)發(fā)展

  • 在2016年底一年快要結(jié)束的時(shí)候，AWS(亞馬遜網(wǎng)絡(luò)服務(wù))宣布通過(guò)借助云傳輸模型可以采用Xilinx高端FPGA器件了，首次以開(kāi)發(fā)者的角度而不是擴(kuò)展高層次工具來(lái)
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幾組實(shí)用FPGA原理設(shè)計(jì)圖

  • FPGA(Field-Programmable Gate Array)，即現(xiàn)場(chǎng)可編程門(mén)陣列，它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。它是作為專(zhuān)用集成電路(ASIC
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采用FPGA方法的內(nèi)窺鏡系統(tǒng)解決方案

  • 醫(yī)療內(nèi)窺鏡的市場(chǎng)發(fā)展帶來(lái)了各種挑戰(zhàn)，例如，要求增強(qiáng)功能，更高的精度，更好的處理性能，以及更小的體積等。本文采用基于FPGA 的方法縮短高級(jí)醫(yī)療內(nèi)窺
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MCU開(kāi)發(fā)成本從硬件轉(zhuǎn)移到軟件

  • 嵌入式系統(tǒng)中的MCU(微控制器)正在經(jīng)歷著從8/16位到32位的轉(zhuǎn)移，雖然在量產(chǎn)上8/16位還是主流，但是新的設(shè)計(jì)采用32位占多數(shù)，32位MCU越來(lái)越多地采用ARM
  • 關(guān)鍵字： MCU  開(kāi)發(fā)成本  硬件轉(zhuǎn)移到軟件  
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