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萊迪思半導體不斷加強適用于低功耗、小尺寸FPGA的設(shè)計工具套件

  • 　　萊迪思半導體公司，客制化智能互連解決方案市場的領(lǐng)先供應(yīng)商，今日宣布Lattice Diamond?設(shè)計工具套件的最新升級版——3.7版本，現(xiàn)已上市。該版本支持更多的萊迪思器件并包含性能增強，可幫助客戶以盡可能最小的尺寸、功耗和成本基于萊迪思FPGA設(shè)計解決方案?！　attice Diamond設(shè)計軟件是一套完整的FPGA設(shè)計工具，具備易于使用的界面、高效的設(shè)計流程、卓越的設(shè)計探索等特性。3.7版本主要的全新特性包括對于ECP5?和MachXO2?/MachXO3? FP
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避免MCU或編程語言的干擾設(shè)計

  • 　　很多時候有人試圖讓你信服：他們的“東西”或最新的產(chǎn)品將成為或取代你的下一個產(chǎn)品設(shè)計。這是真的，每天我們都在采用零星的技巧來改進嵌入式設(shè)計，有些改進確實是挑戰(zhàn)，但是，如果不從可靠的、獨特的設(shè)計開始，沒有“新的技術(shù)”，產(chǎn)品不會成功。擺在我們面前的問題是，設(shè)計需要時間，時間是一種易消逝的資源，并且，所有這些新事物、新設(shè)備、新工具很重要，但并不是最重要的事情。需要防漏洞實時操作系統(tǒng)嗎?需要更快的CPU內(nèi)核嗎?微控制器中需要更密集集成的外圍設(shè)備嗎?把這些問題找出來，找到答案并為之利用，但要知道“IT”不是設(shè)計的
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高云半導體GW1N家族新增三款FPGA器件并開始提供GW1N-1工程樣片

  • 　　廣東高云半導體科技股份有限公司(以下簡稱“高云半導體”)今日宣布：在已經(jīng)發(fā)布的 GW1N-1與 GW1N-9兩款產(chǎn)品基礎(chǔ)上，新增了 GW1N-2、GW1N-4與 GW1N-6三款新的產(chǎn)品。隨著新器件的加入，GW1N 家族芯片可以提供最高近 9KLUTs;高達近 200Kbits的嵌入式塊存儲器及高達近 20Kbits的分布式存儲器;高達近 2Mbits的用戶閃存存儲器;高達20個18 位乘18位的乘法器
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集成電路：并購不能帶來自強

  • 　　2015年，海外并購貫穿了中國集成電路產(chǎn)業(yè)的始終——長電科技以7.8億美元的價格收購新加坡星科金朋;紫光集團230億美元收購存儲器巨頭美光科技;通富微電出資約3.7億美元收購AMD旗下的蘇州廠和馬來西亞檳城廠…… 　　自集成電路上升至國家戰(zhàn)略產(chǎn)業(yè)后，中國財團一夜間成為全球半導體領(lǐng)域的“財神爺”。 　　記者日前從“2015北京·亦莊國際金融創(chuàng)新峰會”得到一組統(tǒng)計數(shù)字：僅去年一年，半導體產(chǎn)
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萊迪思半導體為ECP5 FPGA產(chǎn)品系列添加新成員

  • 　　萊迪思半導體公司，客制化智能互連解決方案市場的領(lǐng)先供應(yīng)商，今日宣布低功耗、小尺寸，用于互連和加速應(yīng)用的ECP5™ FPGA產(chǎn)品系列迎來了新成員。本次新增的產(chǎn)品與ECP5 FPGA的引腳完全兼容，使得OEM廠商能夠?qū)崿F(xiàn)無縫升級，滿足工業(yè)、通信和消費電子等市場上不斷變化的接口需求。 　　ECP5-5G 　　萊迪思的ECP5-5G產(chǎn)品系列獨家支持5G SERDES和高達85K LUT，并采用小尺寸10x10 mm封裝。ECP5-5G器件支持多種5G協(xié)議，包括PCI Express Gen 2
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Xilinx 發(fā)布數(shù)據(jù)中心生態(tài)系統(tǒng)投資計劃致力于進一步壯大云計算及NFV加速解決方案

  • 　　賽靈思公司(Xilinx, Inc.)今天宣布一項新的數(shù)據(jù)中心生態(tài)系統(tǒng)投資計劃，并由賽靈思旗下的投資機構(gòu)“Xilinx 技術(shù)投資 (Xilinx Technology Ventures)”全權(quán)執(zhí)行。該計劃主要用于技術(shù)投資，以豐富賽靈思的數(shù)據(jù)中心產(chǎn)品與服務(wù)，并促進行業(yè)創(chuàng)新，加速產(chǎn)品上市進程及降低總擁有成本。新計劃專門針對新興工作負載應(yīng)用解決方案，如機器學習、圖像及視頻處理、數(shù)據(jù)分析、存儲數(shù)據(jù)庫加速以及網(wǎng)絡(luò)加速等。 　　作為該計劃的一部分，賽靈思近期完成了數(shù)據(jù)中心生態(tài)系統(tǒng)的首次投
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Xilinx發(fā)貨業(yè)界首批高端FinFET FPGA：16nm Virtex UltraScale+器件

  • 　　賽靈思公司(NASDAQ:XLNX)今天宣布其 Virtex? UltraScale+? FPGA面向首批客戶開始發(fā)貨，這是業(yè)界首款采用臺積公司(TSMC)16FF+工藝制造的高端FinFET FPGA。賽靈思在UltraScale+產(chǎn)品系列與設(shè)計工具上一直與100多家客戶積極接觸，目前已向其中60多家客戶發(fā)貨器件和/或開發(fā)板。Virtex UltraScale+器件加上Zynq? UltraScale+ MPSoC和Kintex?
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為什么瑞薩電子市場地位與在工程師中影響力不對等？

  • 這條新聞看的人很少很少，這已經(jīng)說明了一切，瑞薩已經(jīng)不是當年的瑞薩了。
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讓XDC時序與約束為您效力

  • 　　作者：Adam?Taylor?e2v?公司首席工程師?aptaylor@theiet.org　　時序和布局約束是實現(xiàn)設(shè)計要求的關(guān)鍵因素。本文是介紹其使用方法的入門讀物?！　⊥瓿?RTL?設(shè)計只是?FPGA?設(shè)計量產(chǎn)準備工作中的一部分。接下來的挑戰(zhàn)是確保設(shè)計滿足芯片內(nèi)的時序和性能要求。為此，您經(jīng)常需要定義時序和布局約束。我們了解一下在基于賽靈思?FPGA?和?SoC?設(shè)計系統(tǒng)時如何創(chuàng)建
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基于FPGA的模糊控制器管理蔗糖提取

  • 　　作者：Deepali?Vyas?在讀碩士研究生?印度拉賈斯坦?Lakshmangarh市Mody科技大學deepalivyas100@yahoo.com　　Yogesh?Misra?研究員?印度拉賈斯坦?Chittorgarh?市?Mewar?大學?yogeshmisra@yahoo.com　　H.?R.?Kamath?主任?印度中央邦&nbs
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利用Artix-7 FPGA設(shè)計高性能USB器件

  • 　　作者：Tom?Myers?高級硬件工程師，Anritsu?公司?tom.myers@anritsu.com　　低功耗的賽靈思?FPGA?系列使總線供電的?USB?器件設(shè)計垂手可得　　憑借在市場中數(shù)十億的端口數(shù)量，通用串行總線?(USB)?成為實現(xiàn)主機與外設(shè)之間千兆位以下連接的首選接口。不過，由于?USB?規(guī)范有著嚴格的浪涌電流和穩(wěn)態(tài)工作電流限值要求，因此由總線供電的器件應(yīng)用經(jīng)常忽視F
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Xilinx FPGA 推動人群自動監(jiān)測技術(shù)的發(fā)展

  • 　　基于?Spartan?6?的實時運動分類系統(tǒng)為人群的自動監(jiān)測和監(jiān)控開辟新途徑。　　人群的監(jiān)控與監(jiān)測已經(jīng)成為當前的一個重要領(lǐng)域。政府和安全部門都已經(jīng)開始尋求在公共場所智能監(jiān)測人群的更先進的方式，從而避免在來不及采取行動之前檢測到任何異?；顒?。但是在有效達成這一目的之前還需要克服一些障礙。例如，如果需要一天?24?小時同時監(jiān)測整個城市里所有可能的人群活動，僅靠全人工監(jiān)測是不可能的，尤其在安裝有數(shù)千部?CCTV?攝像頭的情況下更是如此?！?/li>
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STM32平臺化戰(zhàn)略，推動物聯(lián)生態(tài)發(fā)展

  • 　　第五屆EEVIA年度中國ICT媒體論壇暨2016產(chǎn)業(yè)和技術(shù)展望研討會　　時間：2016.01.19?下午　　地點：北京中關(guān)村創(chuàng)業(yè)大街?IC咖啡　　演講主題：STM32平臺化戰(zhàn)略，推動物聯(lián)生態(tài)發(fā)展　　演講人：于引?–?意法半導體微控制器北方區(qū)市場經(jīng)理　　主持人：作為第一家推出ARM?Cortex?MCU內(nèi)核并能提供極其廣泛產(chǎn)品現(xiàn)組合的意法半導體公司，今天將和我們談?wù)凷TM32平臺化戰(zhàn)略，并闡述如何推動物聯(lián)生態(tài)的發(fā)展。有請意法半導體微控制器業(yè)務(wù)的
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數(shù)字信號控制器的中斷系統(tǒng)分析與實現(xiàn)方法

  • 　　引言　　數(shù)字信號控制器(Digital Signal Controller, DSC)是將DSP內(nèi)核與MCU接口相結(jié)合的微處理器芯片。DSC同時具有數(shù)字信號處理能力和MCU控制接口，并且中斷系統(tǒng)功能非常豐富。中斷是指CPU正在處理某件事情時，突然發(fā)生的某一外部事件(如一個電平的變化，一個脈沖沿的發(fā)生或定時器的計數(shù)溢出等)請求CPU迅速去處理，此時，若條件允許，CPU暫時中斷當前的工作，轉(zhuǎn)去處理所發(fā)生的事件(中斷服務(wù)程序)，處理完后，再回到原來中斷的地方，繼續(xù)原來的工作，這
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為打破FPGA壟斷局面 科技巨鱷各耍手段

  • FPGA市場前景誘人，但是門檻之高在芯片行業(yè)里無出其右，排名前4公司手握9000余項專利，如此之多的技術(shù)專利構(gòu)成的技術(shù)壁壘當然高不可攀。
  • 關(guān)鍵字： FPGA  Xilinx  Altera  
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