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基于FPGA實(shí)現(xiàn)的音頻接口轉(zhuǎn)換電路
- I2S總線是一種用于音頻設(shè)備間傳輸數(shù)據(jù)的串行總線標(biāo)準(zhǔn)，該總線采用獨(dú)立的時(shí)鐘線與數(shù)據(jù)線，避免了時(shí)差誘發(fā)的失真。隨著多媒體的廣泛應(yīng)用，該總線已被應(yīng)用
- 關(guān)鍵字： FPGA 接口轉(zhuǎn)換 PCI
結(jié)合FPGA與結(jié)構(gòu)化ASIC進(jìn)行設(shè)計(jì)
- 由于結(jié)構(gòu)化ASIC具有單位成本低、功耗低、性能高和轉(zhuǎn)換快(fast turnaound)等特點(diǎn)，越來越多的先進(jìn)系統(tǒng)設(shè)計(jì)工程師正在考慮予以采用。在結(jié)構(gòu)化ASIC中，像
- 關(guān)鍵字： FPGA
PCB設(shè)計(jì)中都有哪些間距需要考慮？
- PCB設(shè)計(jì)中有諸多需要考慮到安全間距的地方。在此，暫且歸為兩類：一類為電氣相關(guān)安全間距，一類為非電氣相關(guān)安全間距?！ ?.電氣相關(guān)安全間距： 導(dǎo)線之間間距 據(jù)主流PCB生產(chǎn)廠家的加工能力，導(dǎo)線與導(dǎo)線之間的間距不得低于最小4mil。最小線距，也是線到線，線到焊盤的距離。從生產(chǎn)角度出發(fā)，有條件的情況下是越大越好，一般常規(guī)在10mil比較常見?！ 『副P孔徑與焊盤寬度 據(jù)主流PCB生產(chǎn)廠家的加工能力，焊盤孔徑如果以機(jī)械鉆孔方式，最小不得低于0.2mm，如果以鐳射鉆孔方式，最小不得低于4mil。而孔徑公差
- 關(guān)鍵字： PCB
【詳解】FPGA：機(jī)器深度學(xué)習(xí)的未來？
- 最近幾年數(shù)據(jù)量和可訪問性的迅速增長，使得人工智能的算法設(shè)計(jì)理念發(fā)生了轉(zhuǎn)變。人工建立算法的做法被計(jì)算機(jī)從大量數(shù)據(jù)中自動(dòng)習(xí)得可組合系統(tǒng)的能力所取
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FPGA擊敗GPU和GPP，成為深度學(xué)習(xí)的未來？
- 最近幾年，深度學(xué)習(xí)成為計(jì)算機(jī)視覺、語音識(shí)別、自然語言處理等關(guān)鍵領(lǐng)域中所最常使用的技術(shù)，被業(yè)界大為關(guān)注。然而，深度學(xué)習(xí)模型需要極為大量的數(shù)據(jù)和
- 關(guān)鍵字： FPGA GPU GPP 深度學(xué)習(xí)
云中的機(jī)器學(xué)習(xí)：FPGA 上的深度神經(jīng)網(wǎng)絡(luò)
- 憑借出色的性能和功耗指標(biāo)，賽靈思 FPGA 成為設(shè)計(jì)人員構(gòu)建卷積神經(jīng)網(wǎng)絡(luò)的首選 XE XE XE XE 。新的軟件工具可簡化實(shí)現(xiàn)工作。人工智能正在經(jīng)
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FPGA時(shí)序約束方法匯總，從易到難的都有
- 從最近一段時(shí)間工作和學(xué)習(xí)的成果中，我總結(jié)了如下幾種進(jìn)行時(shí)序約束的方法。按照從易到難的順序排列如下： 1. 核心頻率約束 這是最基本的，所以標(biāo)號(hào)為0?！ ?. 核心頻率約束+時(shí)序例外約束 時(shí)序例外約束包括FalsePath、MulticyclePath、MaxDelay、MinDelay。但這還不是最完整的時(shí)序約束。如果僅有這些約束的話，說明設(shè)計(jì)者的思路還局限在FPGA芯片內(nèi)部?！ ?. 核心頻率約束+時(shí)序例外約束+I/O約束 I/O約束包括引腳分配位置、空閑引腳驅(qū)動(dòng)方式、外部走線延時(shí)(Inpu
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PCB設(shè)計(jì)紛繁復(fù)雜，設(shè)計(jì)規(guī)范一定要搞懂
- PCB設(shè)計(jì)紛繁復(fù)雜，各種意料之外的因素頻頻來影響整體方案的達(dá)成，如何能馴服性格各異的零散部件?怎樣才能畫出一份整齊、高效、可靠的PCB圖?今天讓我們來盤點(diǎn)一下?！ CB設(shè)計(jì)看似復(fù)雜，既要考慮各種信號(hào)的走向又要顧慮到能量的傳遞，干擾與發(fā)熱帶來的苦惱也時(shí)時(shí)如影隨形。但實(shí)際上總結(jié)歸納起來非常清晰，可以從兩個(gè)方面去入手： 說得直白一些就是：“怎么擺”和“怎么連”?！ ÷犉饋硎遣皇欠浅asy?讓我們先來梳理下“怎么擺”： 1、遵照“先大后小，先難后易”的布置原則，即重要的單元電路、核心元器件應(yīng)當(dāng)優(yōu)先布局
- 關(guān)鍵字： PCB
FPGA學(xué)習(xí)及設(shè)計(jì)中的注意事項(xiàng)
- FPGA的基礎(chǔ)就是數(shù)字電路和HDL語言，想學(xué)好FPGA的人，建議床頭都有一本數(shù)字電路的書，不管是哪個(gè)版本的，這個(gè)是基礎(chǔ)，多了解也有助于形成硬件設(shè)計(jì)的思想
- 關(guān)鍵字： FPGA 設(shè)計(jì) 問題
給MCU工程師詳解FPGA硬件屬性
- 我的許多朋友都是經(jīng)驗(yàn)豐富的嵌入式設(shè)計(jì)工程師，但他們都是微控制器(MCU)背景，因此對(duì)于FPGA是什么以及FPGA能做什么只有一個(gè)模糊的概念。如果問急了，他
- 關(guān)鍵字： 單片機(jī) FPGA 可編程構(gòu)造
降低電源紋波噪聲只需三步
- 在應(yīng)用電源模塊常見的問題中，降低負(fù)載端的紋波噪聲是大多數(shù)用戶都關(guān)心的。那么模塊的紋波噪聲該如何降低?下文為大家從紋波噪聲的波形、測試方式、模塊設(shè)計(jì)及應(yīng)用的角度出發(fā)，闡述幾種有效降低輸出紋波噪聲的方法?！ ∫?、電源的紋波與噪聲介紹 紋波和噪聲即：直流電源輸出上疊加的與電源開關(guān)頻率同頻的波動(dòng)為紋波，高頻雜音為噪聲。具體如圖1所示，頻率較低且有規(guī)律的波動(dòng)為紋波，尖峰部分為噪聲?！ D1 二、紋波噪聲的測試方法 對(duì)于中小微功率模塊電源的紋波噪聲測試，業(yè)內(nèi)主要采用平行線測試法和靠接法兩種。其中，平行線測試
- 關(guān)鍵字： 電源紋波噪聲 PCB
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