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Altera公開業(yè)界第一款集成了HBM2 DRAM和FPGA的異構(gòu)SiP器件

　　Altera公司(Nasdaq)公開業(yè)界第一款異構(gòu)系統(tǒng)級(jí)封裝(SiP，System-in-Package)器件，集成了來(lái)自SK Hynix的堆疊寬帶存儲(chǔ)器(HBM2)以及高性能Stratix® 10 FPGA和SoC。Stratix 10 DRAM SiP代表了新一類器件，其特殊的體系結(jié)構(gòu)設(shè)計(jì)滿足了高性能系統(tǒng)對(duì)存儲(chǔ)器帶寬最嚴(yán)格的要求。　　數(shù)據(jù)中心、廣播、固網(wǎng)和高性能計(jì)算等系統(tǒng)要處理的數(shù)據(jù)量不斷攀升，需要的帶寬非常高。相對(duì)于目前的分立DRAM解決方案，Stratix 10 DRAM SiP的
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Altera公開業(yè)界第一款集成了HBM2 DRAM和FPGA的異構(gòu)SiP器件

　　Altera公司今天公開業(yè)界第一款異構(gòu)系統(tǒng)級(jí)封裝(SiP，System-in-Package)器件，集成了來(lái)自SK Hynix的堆疊寬帶存儲(chǔ)器(HBM2)以及高性能Stratix® 10 FPGA和SoC。Stratix 10 DRAM SiP代表了新一類器件，其特殊的體系結(jié)構(gòu)設(shè)計(jì)滿足了高性能系統(tǒng)對(duì)存儲(chǔ)器帶寬最嚴(yán)格的要求。　　數(shù)據(jù)中心、廣播、固網(wǎng)和高性能計(jì)算等系統(tǒng)要處理的數(shù)據(jù)量不斷攀升，需要的帶寬非常高。相對(duì)于目前的分立DRAM解決方案，Stratix 10 DRAM SiP的存儲(chǔ)器帶寬提
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小梅哥和你一起深入學(xué)習(xí)FPGA之串口調(diào)試（一）（下）

　　以上為小梅哥為了對(duì)特權(quán)同學(xué)的串口收發(fā)模塊進(jìn)行測(cè)試所展開的部分工作，到這里，仿真測(cè)試所需要的準(zhǔn)備工作我們就做好了，接下來(lái)將實(shí)際進(jìn)行仿真，通過(guò)仿真來(lái)分析該模塊的性能。　　這里極力推薦大家使用modelsim進(jìn)行仿真，因?yàn)閝uartusII自帶的仿真工具靈活性和功能都趕modelsim相差甚遠(yuǎn)。Modelsim作為一款強(qiáng)大的仿真軟件，在業(yè)界被廣泛使用。同時(shí)，modelsim針對(duì)不同的EDA廠家，也推出了OEM版本，modelsim-altera就是為Altera公司開發(fā)的OEM版本，此版本針對(duì)Altera公
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小梅哥和你一起深入學(xué)習(xí)FPGA之串口調(diào)試（一）(上)

　　大家好，這幾天在各個(gè)論壇上，經(jīng)常就有人在向我咨詢基于FPGA的串口通信代碼，大部分都是在網(wǎng)上下載一個(gè)現(xiàn)成的代碼，但是在使用中就遇到了各種問(wèn)題，于是就發(fā)到了論壇上來(lái)求助。在閱讀了他們的代碼之后，我發(fā)現(xiàn)幾乎出自同一個(gè)版本(目前確定為特權(quán)同學(xué)的基于EPM240入門實(shí)驗(yàn)的代碼)。他們?cè)谡{(diào)試這個(gè)代碼的時(shí)候，經(jīng)常存在這樣幾個(gè)問(wèn)題：1、部分人對(duì)該串口通訊模塊完全不理解，對(duì)每句話，甚至每個(gè)模塊的功能都不理解;2、部分人采用最原始的畫波形的方式來(lái)對(duì)該模塊進(jìn)行仿真，結(jié)果無(wú)法得到仿真結(jié)果;3、部分人不會(huì)使用modelsim
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ASDF：精細(xì)粒度異構(gòu)助力創(chuàng)新， Altera將進(jìn)入大FPGA時(shí)代

　　“數(shù)十個(gè)合作伙伴，數(shù)百家客戶，數(shù)千計(jì)的工程師，這三股強(qiáng)大的力量構(gòu)成了Altera SoC大的生態(tài)系統(tǒng)，也是Altera在SoC領(lǐng)域投入5年所獲得的成就。”Altera公司嵌入式處理營(yíng)銷資深總監(jiān)Chris Balough在一年一度的Altera SoC開發(fā)者大會(huì)上自豪地表示。　　
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芯片級(jí)尺寸的MCU如何適應(yīng)可穿戴設(shè)計(jì)中的尺寸限制？

　　消費(fèi)類電子產(chǎn)品經(jīng)過(guò)幾十年的發(fā)展已經(jīng)有無(wú)數(shù)種各類用途的設(shè)備，從專業(yè)設(shè)備到個(gè)人消費(fèi)品。雖然存在性能和功能的差異，但是消費(fèi)類電子產(chǎn)品往往遵循相同的設(shè)計(jì)趨勢(shì)：設(shè)備功能變得越來(lái)越強(qiáng)大、體積小巧和省電。可穿戴設(shè)備集中體現(xiàn)了這一趨勢(shì)，它是一種便攜、電池供電、高集成度的設(shè)備，負(fù)責(zé)從高精度模擬測(cè)量到直觀用戶界面的所有一切?？纱┐魇皆O(shè)備開發(fā)人員必須仔細(xì)的在多種集成電路(IC)中匹配產(chǎn)品的需求，有時(shí)還需要同時(shí)應(yīng)對(duì)相互矛盾的優(yōu)先選項(xiàng)。　　例如，讓我們仔細(xì)思考，在靈巧的可穿戴式設(shè)計(jì)中如何兼顧
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Altera榮獲Frost & Sullivan全球FPGA技術(shù)創(chuàng)新領(lǐng)先獎(jiǎng)

　　Altera公司榮獲分析公司Frost & Sullivan的全球FPGA技術(shù)創(chuàng)新領(lǐng)先獎(jiǎng)，表彰Altera在技術(shù)特性和未來(lái)業(yè)務(wù)價(jià)值方面更勝一籌。該獎(jiǎng)項(xiàng)彰顯Altera在其Arria® 10 FPGA中實(shí)現(xiàn)IEEE 754單精度硬核浮點(diǎn)DSP (數(shù)字信號(hào)處理)模塊——處理速率高達(dá)1.5 TFLOPS (每秒萬(wàn)億次浮點(diǎn)運(yùn)算)，進(jìn)一步提高了數(shù)字系統(tǒng)設(shè)計(jì)的能效和生產(chǎn)效率。Altera的可編程器件幫助客戶針對(duì)大數(shù)據(jù)和搜索應(yīng)用、數(shù)據(jù)中心加速、軍事通信和高性能計(jì)算等需要高精度
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使用面向FPGA的OpenCL設(shè)計(jì)兩百萬(wàn)點(diǎn)頻域?yàn)V波器

快速傅里葉變換(FFT)是信號(hào)處理應(yīng)用的基礎(chǔ)。FPGA供應(yīng)商一直以來(lái)提供了運(yùn)行良好的FFT庫(kù)，處理適配到FPGA片內(nèi)存儲(chǔ)器中的大量數(shù)據(jù)。但是，如果數(shù)據(jù)規(guī)模太大，應(yīng)該如何應(yīng)對(duì)? 為解決這一問(wèn)題，F(xiàn)PGA設(shè)計(jì)人員現(xiàn)在必須要做出設(shè)計(jì)決定，這些決定互相糾纏在一起，例如，片內(nèi)FFT內(nèi)核的配置選擇，其數(shù)量，它們?cè)鯓舆B接并訪問(wèn)外部存儲(chǔ)器，多個(gè)內(nèi)核之間的同步等。分析所有這類設(shè)計(jì)決定就是要能夠很好的結(jié)合現(xiàn)有產(chǎn)品，在HDL中編程，這會(huì)非常耗時(shí)，而且?guī)?lái)了性能問(wèn)題。采用OpenCL等高級(jí)編程語(yǔ)言，能夠很快的完成系統(tǒng)設(shè)計(jì)分析。本
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OpenPOWER+CAPI實(shí)現(xiàn)第二代分布計(jì)算

本文介紹了CAPI技術(shù)，并給出基于CAPI應(yīng)用的三個(gè)案例。
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在Xilinx FPGA上快速實(shí)現(xiàn)JESD204B

　　簡(jiǎn)介　　JESD204是一種連接數(shù)據(jù)轉(zhuǎn)換器(ADC和DAC)和邏輯器件的高速串行接口，該標(biāo)準(zhǔn)的 B 修訂版支持高達(dá) 12.5 Gbps串行數(shù)據(jù)速率，并可確保 JESD204 鏈路具有可重復(fù)的確定性延遲。隨著轉(zhuǎn)換器的速度和分辨率不斷提升，JESD204B接口在ADI高速轉(zhuǎn)換器和集成RF收發(fā)器中也變得更為常見(jiàn)。此外，F(xiàn)PGA和ASIC中靈活的串行器/解串器(SERDES)設(shè)計(jì)正逐步取代連接轉(zhuǎn)換器的傳統(tǒng)并行LVDS/CMOS接口，并用來(lái)實(shí)現(xiàn) JESD204B物理層。本文介紹如何快速在Xilinx?
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Altera：通信領(lǐng)域，我們做得更好

　　EEPW：我想了解一下Patrick Dorsey先生對(duì)英特爾收購(gòu)了Altera的一些看法，其次就是Altera也是OpenPower的一個(gè)成員，因?yàn)榧尤肓薎ntel之后，Altera這邊會(huì)不會(huì)繼續(xù)跟OpenPower合作。　　Patrick Dorsey：就像您所說(shuō)的，我們也是OpenPower機(jī)構(gòu)的一個(gè)成員。關(guān)于我們的看法，我們FPGA會(huì)繼續(xù)支持不同的架構(gòu)，包括ARM架構(gòu)，Power架構(gòu)還有Intel自己的架構(gòu)。　　6月份我看我們的新聞發(fā)布宣布我們的OpenCL這個(gè)工具可以支持普通的架構(gòu)，
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Xilinx跨界擴(kuò)張，五年預(yù)增5倍用戶

編者按：五年來(lái)，Xilinx正經(jīng)歷轉(zhuǎn)型: 從FPGA供應(yīng)商到可以支持系統(tǒng)和軟件工程師的全可編程技術(shù)(All Programmable technology )公司，致力于未來(lái)五年內(nèi)增長(zhǎng)5倍的潛在用戶，并為此推出了多處理器SoC和一系列軟件定義的設(shè)計(jì)環(huán)境。近日該公司的戰(zhàn)略規(guī)劃師Steve Glaser來(lái)華，向我們解釋了其構(gòu)想。
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Synopsys的全新HAPS-80基于FPGA的原型解決方案提供高達(dá)100MHz的系統(tǒng)性能

　　新思科技(Synopsys, Inc.)日前宣布：推出全新HAPS®-80基于FPGA的原型系統(tǒng)，該系統(tǒng)為Synopsys的端到端原型解決方案的一部分。HAPS-80系統(tǒng)提供了高達(dá)100MHz的多FPGA性能，以及全新的專用高速時(shí)分復(fù)用(HSTDM)技術(shù)。HAPS-80采用Xilinx最新的Virtex UltraScale VU440 FPGA器件，每顆FPGA可容納2600萬(wàn)個(gè)ASIC門，結(jié)合ProtoCompiler設(shè)計(jì)自動(dòng)化和調(diào)試軟件，可支持高達(dá)16億個(gè)ASIC門的設(shè)計(jì)。HAPS硬件與
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"推陳出新，重在應(yīng)用"——新唐新產(chǎn)品研討會(huì)在京召開

2015年9月14日上午十點(diǎn)，臺(tái)灣新唐科技股份有限公司在北京舉行NuMicro 微控制器新產(chǎn)品應(yīng)用研討會(huì)的第一站，現(xiàn)場(chǎng)氣氛十分熱烈。會(huì)議當(dāng)天，新唐就NuMicro 新產(chǎn)品做了介紹，并提出了一些基于NuMicro 微控制器的精彩方案分享。此外，新唐的技術(shù)人員還為廣大應(yīng)邀參會(huì)的企業(yè)工程師和管理者介紹了Nano系列微處理器在三表、電子貨架標(biāo)簽、IoT、微打和金融終端設(shè)備上的應(yīng)用解決方案。本次研討會(huì)的內(nèi)容十分豐富，獲得了參會(huì)人員的一致好評(píng)。
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MCU晶體旁邊電容的作用及振蕩電路的分析

　　簡(jiǎn)介：絕大多數(shù)的MCU愛(ài)好者對(duì)MCU晶體兩邊要接一個(gè)22pF附近的電容不理解，因?yàn)檫@個(gè)電容有些時(shí)候是可以不要的。參考很多書籍，講解的很少，往往提到最多的是起穩(wěn)定作用，負(fù)載電容之類的話，都不是很深入理論的分析。　　問(wèn)題是很多愛(ài)好者不去關(guān)心這兩個(gè)電容，他們認(rèn)為按參考設(shè)計(jì)做就行了，本人也是如此，直到有一次一個(gè)手機(jī)項(xiàng)目就因?yàn)檫@個(gè)電容出了問(wèn)題，損失了幾百萬(wàn)之后，才開始真正的考慮這個(gè)電容的作用。　　其實(shí)MCU的振蕩電路的真名叫“三點(diǎn)式電容振蕩電路”，請(qǐng)參考網(wǎng)頁(yè)中的圖片。　　
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