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一種應(yīng)用于OFDM系統(tǒng)中的符號精確定時算法的FPGA實現(xiàn)

  • 摘要：OFDM技術(shù)是下一代移動通信的主流技術(shù)，在信息量大，功率受限的多媒體傳感網(wǎng)的OFDM系統(tǒng)中，以突發(fā)模式傳輸數(shù)據(jù)...
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FLIR借助HDL代碼生成技術(shù)加速熱成像FPGA的開發(fā)

  • MathWorks 于本日宣布，F(xiàn)LIR Systems 通過使用 MATLAB 和 HDL Coder，將熱成像 FPGA 開發(fā)過程中從概念的形成到構(gòu)建可在現(xiàn)場測試的原型的時間縮短了 60%。
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Altera率先在業(yè)界推出全系列28-nm FPGA產(chǎn)品

  • Altera公司(NASDAQ: ALTR)日前宣布，開始成品發(fā)售28-nm FPGA系列所有三種產(chǎn)品，包括，Stratix? V、Arria? V和Cyclone? V 器件。Altera 最新發(fā)售低成本、低功耗產(chǎn)品系列中容量最大的Cyclone V FPGA， 為業(yè)界樹立了新 里程碑。
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一種應(yīng)用于OFDM系統(tǒng)中的符號精確定時算法的FPGA實

  • 摘要：OFDM技術(shù)是下一代移動通信的主流技術(shù)，在信息量大，功率受限的多媒體傳感網(wǎng)的OFDM系統(tǒng)中，以突發(fā)模式傳輸數(shù)據(jù)，要求快速精確地完成定時同步。這里分析了一種應(yīng)用于OFDM系統(tǒng)中基于長訓(xùn)練序列與本地序列互相關(guān)的
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基于FPGA的高速實時/回放分級復(fù)接器設(shè)計

  • 摘要：利用國際空間數(shù)據(jù)系統(tǒng)咨詢委員會 (CCSDS)高級在軌系統(tǒng)(AOS)建議，提出了兩級復(fù)用的方案，設(shè)計了一種具有載荷數(shù)據(jù)存儲功能的高速實時/回放分級復(fù)接器。該方案采用FPGA技術(shù),對星上載荷輸出的數(shù)據(jù)使用了兩級全異步
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基于FPGA的高精度時間數(shù)字轉(zhuǎn)換電路設(shè)計

  • 摘要：本文介紹一種基于 FPGA高精度時間數(shù)字轉(zhuǎn)換電路的設(shè)計方法，利用片內(nèi)鎖相環(huán)（PLL）和環(huán)形移位寄存器，采用不高的系統(tǒng)時鐘便可得到很高的時間分辨率，且占用較少邏輯資源?？勺鳛楣δ茈娐藩毩⑹褂?，也可作為 IP核
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FPGA提升智能手機設(shè)計差異化

  • 電子產(chǎn)品世界,為電子工程師提供全面的電子產(chǎn)品信息和行業(yè)解決方案,是電子工程師的技術(shù)中心和交流中心,是電子產(chǎn)品的市場中心,EEPW 20年的品牌歷史,是電子工程師的網(wǎng)絡(luò)家園
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加速SoC設(shè)計：把C代碼直接轉(zhuǎn)為SoC GDSII

  • *IC設(shè)計業(yè)中第一家提供從C模型的算法，直接轉(zhuǎn)為完整的SoC GDSII 的公司 *對于制程越小，設(shè)計越復(fù)雜、需要盡快上市的設(shè)計，就越適合。 問：Algotochip公司的規(guī)模是怎么樣的？ 答：Algotochip成立只有三年，公司員工約40人。但是Algotochip的團隊加起來，做過超過150個SoC的tapeout（芯片設(shè)計完成）。由日本某創(chuàng)投集團投資。 問：Algotochip的訣竅技術(shù)是什么？ 答：我們把C code（代碼）拿來，把它進行分析一下，一邊是一個可以可編程的，一邊是固定的
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DARPA授權(quán)RF-FPGA項目合同 開發(fā)可編程射頻前端技術(shù)

  • ?　　美國國防預(yù)先研究計劃局射頻和微波技術(shù)專家正在與6家國防企業(yè)和大學(xué)合作，開發(fā)可編程射頻前端元件，以減少軍事通信、電子戰(zhàn)和信號情報系統(tǒng)(SIGINT)的成本和開發(fā)時間。 　　迄今為止，DARPA授權(quán)了6份關(guān)于“現(xiàn)場可編程門陣列射頻技術(shù)(RF-FPGA)”項目的合同。該項目旨在通過收發(fā)器鏈編程，跨不同應(yīng)用程序重復(fù)使用同一組射頻前端元件。從根本上講， RF-FPGA項目試圖將現(xiàn)場可編程門陣列(FPGA)在數(shù)字計算方面的成功應(yīng)用經(jīng)驗轉(zhuǎn)移到射頻和微波技術(shù)，從而在廣泛應(yīng)用中減少
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ARM與Synopsys合作達成ARM架構(gòu)之SoC功耗能效最佳化

  •  　　ARM及新思科技(Synopsys)簽訂一項多年期協(xié)定，進一步擴大新思科技(Synopsys)使用ARM硅智財(IP)的權(quán)利。雙方將擴展合作關(guān)係，讓SoC設(shè)計人員透過新思科技Galaxy實作平臺及Discovery VIP達成以ARM架構(gòu)為基礎(chǔ)之SoC功耗及效能的最佳化，同時降低成本并加速上市時程。新的協(xié)定是以先前EDA工具及ARM Cortex-A15處理器授權(quán)協(xié)定為基礎(chǔ)，允許新思科技取得一系列Cortex處理器的使用權(quán)利，包括執(zhí)行ARM big.LITTLE處理的技術(shù)、ARM Arti
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電子工程師經(jīng)驗：FPGA設(shè)計風(fēng)格須知

  • 在進行FPGA設(shè)計時，有很多需要我們注意的地方。具有好的設(shè)計風(fēng)格才能做出好的設(shè)計產(chǎn)品，這一點是毋庸置疑的。那么，接下來，小編就帶大家一起來看看，再進行FPGA設(shè)計時，我們都要注意哪些呢?　　一.命名風(fēng)格：　　1不
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集成式比特誤碼率測試儀在FPGA中的應(yīng)用

  • 隨著高速數(shù)字系統(tǒng)的發(fā)展，高速串行數(shù)據(jù)被廣泛使用，內(nèi)嵌高速串行接口的FPGA也得到大量應(yīng)用，相應(yīng)的高速串行信號質(zhì)量的測試也越來越頻繁和重要。通常用示波器觀察信號波形、眼圖、抖動來衡量信號的質(zhì)量，Xilinx提供的
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傳授壓箱絕技：從SoC設(shè)計人員那都了解不到的功耗管

  • 當(dāng)今的系統(tǒng)設(shè)計人員受益于芯片系統(tǒng)（SoC）設(shè)計人員在芯片級功耗管理上的巨大投入。但是對于實際能耗非常小的系統(tǒng)，系統(tǒng)設(shè)計團隊必須要知道，實際是怎樣進行SoC功耗管理的。他們必須對整個系統(tǒng)進行功耗規(guī)劃。他們必須
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基于FPGA 的偽隨機序列的生成方法及應(yīng)用

  • 摘要：通過分析各種偽隨機序列生成方法，提出了一種基于M 序列的連續(xù)抽樣方法，可以生 成滿足自適應(yīng)光學(xué)系統(tǒng)SPGD 控制算法要求的多路、相互獨立以及服從伯努利分布的偽隨機序 列。該方法適合于用FPGA 等超大規(guī)模集成
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基于FPGA的DDS基本信號發(fā)生器的設(shè)計

  • 摘要：本設(shè)計基于DDS原理和FPGA技術(shù)按照順序存儲方式，將對正弦波、方波、三角波、鋸齒波四種波形的取樣數(shù)據(jù)依次全部存儲在ROM波形表里，通過外接設(shè)備撥扭開關(guān)和鍵盤控制所需波形信號的輸出，最終將波形信息顯示在LC
  • 關(guān)鍵字： FPGA  DDS  信號發(fā)生器    
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fpga soc介紹

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