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fpga ip 文章 最新資訊

基于Xilinx FPGA的片上系統(tǒng)無線保密通信終端設(shè)計(jì)

  • 0引言利用軟件實(shí)施加密算法已經(jīng)成為實(shí)時(shí)安全通信系統(tǒng)的重要瓶頸。標(biāo)準(zhǔn)的商品化CPU和DSP無法跟上數(shù)據(jù)...
  • 關(guān)鍵字： FPGA  片上系統(tǒng)  無線保密  通信終端  

TCP/IP協(xié)議單片機(jī)在網(wǎng)絡(luò)通信中的數(shù)據(jù)傳輸技術(shù)

基于FPGA+DSP的高速中頻采樣信號(hào)處理平臺(tái)的實(shí)現(xiàn)

  • 基于FPGA+DSP的高速中頻采樣信號(hào)處理平臺(tái)的實(shí)現(xiàn),摘要：高速中頻采樣信號(hào)處理平臺(tái)在實(shí)際應(yīng)用中有很大的前景，提出采用FPGA+DSP的處理結(jié)構(gòu)，結(jié)合高性能A／D和D／A處理芯片，設(shè)計(jì)了一個(gè)通用處理平臺(tái)，并對(duì)其主要性能進(jìn)行了測(cè)試。實(shí)驗(yàn)與實(shí)際應(yīng)用表明，該系統(tǒng)具有很強(qiáng)的
  • 關(guān)鍵字： 信號(hào)處理  平臺(tái)  實(shí)現(xiàn)  采樣  中頻  FPGA  DSP  高速  基于  

FPGA在數(shù)字式心率計(jì)中的電路組成及工作原理

  • 本心率計(jì)在數(shù)字式心率計(jì)的基礎(chǔ)上，采用FPGA和VHDL語言實(shí)現(xiàn)，減少了元器件使用數(shù)量，提高了測(cè)量精度和可靠性。該電路能夠?qū)崟r(shí)采集并測(cè)量人體心跳的瞬時(shí)和平均心跳速率，判斷并顯示心率狀態(tài)（即心跳是否正常、是否過快或過慢、是否有心率不齊現(xiàn)象）。如果心率過快或過慢或者有心率不齊現(xiàn)象，那么將用不同顏色發(fā)光管進(jìn)行閃爍報(bào)警顯示。

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基于POWER PC+FPGA架構(gòu)的飛行試驗(yàn)振動(dòng)數(shù)據(jù)實(shí)時(shí)分析

  • 摘要：飛行試驗(yàn)振動(dòng)信號(hào)具有采樣率高、數(shù)據(jù)量大、處理復(fù)雜的特點(diǎn)，在現(xiàn)有條件下，通過遙測(cè)鏈路很難將大量的振動(dòng)數(shù)據(jù)實(shí)時(shí)傳輸至地面監(jiān)控系統(tǒng)。針對(duì)試飛測(cè)試的需要，結(jié)合某型號(hào)的試飛關(guān)鍵技術(shù)攻關(guān)研究，突破試飛振動(dòng)數(shù)
  • 關(guān)鍵字： POWER  FPGA  PC  架構(gòu)    

基于Cyclone III FPGA的DDR2接口設(shè)計(jì)分析

  • DDR SDRAM是Double Data Rate SDRAM的縮寫，即雙倍速率同步動(dòng)態(tài)隨機(jī)存儲(chǔ)器。DDR內(nèi)存是在SDRAM內(nèi)存基礎(chǔ)上發(fā)展而來的，能夠在時(shí)鐘的上升沿和下降沿各傳輸一次數(shù)據(jù)，可以在與SDRAM相同的總線時(shí)鐘頻率下達(dá)到更高的數(shù)據(jù)傳輸率。雖然DDR2和DDR一樣,都采用相同采樣方式進(jìn)行數(shù)據(jù)傳輸，但DDR2擁有兩倍于DDR的預(yù)讀取系統(tǒng)命令數(shù)據(jù)的能力。
  • 關(guān)鍵字： Cyclone  FPGA  DDR2  III    

WCDMA/GSM核心網(wǎng)絡(luò)中的IP技術(shù)

  • 大多數(shù)移動(dòng)運(yùn)營商已經(jīng)在網(wǎng)絡(luò)中引入了基于分組的傳輸技術(shù)。無論是通過WAP服務(wù)器接入企業(yè)網(wǎng)，運(yùn)營商變成互聯(lián)網(wǎng)業(yè)務(wù)提供商，還是建立GPRS網(wǎng)絡(luò)，IP網(wǎng)絡(luò)都正在被引入。而與此同時(shí)，有些運(yùn)營商則引入了異步轉(zhuǎn)移模式骨干網(wǎng)來
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高性能FPGA中的高速SERDES接口

  • 引言　 串行接口常用于芯片至芯片和電路板至電路板之間的數(shù)據(jù)傳輸。隨著系統(tǒng)的帶寬不斷增加至多吉比特范圍，并行接口已經(jīng)被高速串行鏈接，或SERDES （串化器/ 解串器）所取代 。起初， SERDES是獨(dú)立的ASSP或ASIC器
  • 關(guān)鍵字： SERDES  FPGA  性能  接口    

基于Xilinx FPGA的片上系統(tǒng)無線保密通信終端

  • 本設(shè)計(jì)使用硬件描述語言VHDL在FPGA數(shù)字邏輯層面上實(shí)現(xiàn)AES加解密，為了系統(tǒng)的擴(kuò)展性和構(gòu)建良好的人機(jī)交互，設(shè)計(jì)通過PS/2鍵盤輸入加密密鑰，并將其顯示在LCD上。在軟核MicroBlaze上，通過SPI總線讀寫FIFO和RAM控制射頻芯片CC2420，使系統(tǒng)具有信道選擇、地址識(shí)別、自動(dòng)CRC校驗(yàn)功能，使系統(tǒng)更加安全、通信誤碼率更低。

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基于FPGA數(shù)據(jù)流控制動(dòng)態(tài)可重構(gòu)的實(shí)現(xiàn)

  • 摘要 基于FPGA基本數(shù)據(jù)流的下載控制方式，利用遺傳算法，通過單片機(jī)控制數(shù)據(jù)流的方式對(duì)FPGA進(jìn)行編程配置，實(shí)現(xiàn)自身重構(gòu)，使系統(tǒng)具有自適應(yīng)、自組織和自修復(fù)的特性。
    關(guān)鍵詞 FPGA；遺傳算法；動(dòng)態(tài)重構(gòu)；單片機(jī)
  • 關(guān)鍵字： FPGA  數(shù)據(jù)流  動(dòng)態(tài)可重構(gòu)    

異步FIFO在FPGA與DSP通信中的運(yùn)用

  • 摘要 利用異步FIFO實(shí)現(xiàn)FPGA與DSP進(jìn)行數(shù)據(jù)通信的方案。FPGA在寫時(shí)鐘的控制下將數(shù)據(jù)寫入FIFO，再與DSP進(jìn)行握手后，DSP通過EMIFA接口將數(shù)據(jù)讀入。文中給出了異步FIFO的實(shí)現(xiàn)代碼和FPGA與DSP的硬件連接電路。經(jīng)驗(yàn)證，利用
  • 關(guān)鍵字： 通信  運(yùn)用  DSP  FPGA  FIFO  異步  

基于FIash和JTAG接口的FPGA多配置系統(tǒng)

  • 摘要：針對(duì)需要切換FPGA器件的配置以實(shí)現(xiàn)不同功能的特殊應(yīng)用場(chǎng)合，提出了一種使用大容量的Flash存儲(chǔ)器作配置碼流載體的FPGA多配置系統(tǒng)。該系統(tǒng)采用傳輸速度快的JTAG接口提高了配置碼流的燒寫速度，采用并行從模式減少
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基于FPGA的CAN總線控制器SJA1000軟核的設(shè)計(jì)

  • 基于FPGA的CAN總線控制器SJA1000軟核的設(shè)計(jì)
    湯書森，劉 棟，李建明
    (蘭州大學(xué)信息科學(xué)與工程學(xué)院，蘭州 730000)
    摘要：分析了CAN控制器SJA1000的特點(diǎn)及CAN協(xié)議通信格式。設(shè)計(jì)了控制器SJA1000的IP軟核，能為應(yīng)用提
  • 關(guān)鍵字： SJA1000  軟核  設(shè)計(jì)  控制器  總線  FPGA  CAN  

基于USB和FPGA的隨機(jī)數(shù)發(fā)生器驗(yàn)證平臺(tái)

  • 摘要：為了方便基于FPGA實(shí)現(xiàn)的隨機(jī)數(shù)發(fā)生器的驗(yàn)證與演示，以CycloneII FPGA芯片EP2C20Q240C8N為核心，設(shè)計(jì)實(shí)現(xiàn)了隨機(jī)數(shù)發(fā)生器IP核下載與測(cè)試的開發(fā)驗(yàn)證平臺(tái)，并詳細(xì)闡述了各模塊的設(shè)計(jì)原理及關(guān)鍵技術(shù)。最后，通過下載
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基于ARM和FPGA的電力光纖信號(hào)分析儀的設(shè)計(jì)

  • 為了能更好地實(shí)現(xiàn)變電站的自動(dòng)化和數(shù)字化以及完成變電站系統(tǒng)的實(shí)時(shí)監(jiān)控、測(cè)試，更快捷、直觀地獲得設(shè)備的運(yùn)行狀態(tài)。介紹了一臺(tái)基于ARM+FPGA的電力光纖信號(hào)分析儀的設(shè)計(jì)與研究，從硬件方面提出了新的設(shè)計(jì)方案。這種光纖信號(hào)分析儀主要實(shí)現(xiàn)對(duì)數(shù)字化變電站中通過100 M BaseFX傳輸?shù)母鞣N格式報(bào)文的抓取、信息提取、報(bào)文解碼、實(shí)時(shí)存儲(chǔ)及波形顯示等功能。
  • 關(guān)鍵字： FPGA  ARM  電力光纖  信號(hào)分析    
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fpga ip介紹

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