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fpga ip 文章 最新資訊

基于FPGA的電梯控制器系統(tǒng)設(shè)計

  • 本文首先提出了一種基于有限狀態(tài)機(jī)的電梯控制器算法，然后根據(jù)該算法設(shè)計了一個三層電梯控制器，該電梯控制器的正確性經(jīng)過了仿真驗(yàn)證和硬件平臺的驗(yàn)證。本文的電梯控制器設(shè)計，結(jié)合了深圳信息職業(yè)技術(shù)學(xué)院的實(shí)際電梯
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基于FPGA的真彩VGA顯示的實(shí)現(xiàn)

  • Mif文件在FPGA中的應(yīng)用，主要是在RAM，ROM中，一般用來存儲字模、波形數(shù)據(jù)、信號采樣、數(shù)據(jù)序列等，可以看做是C語言中的數(shù)組，用來存儲數(shù)據(jù)。Bingo當(dāng)年也是郁悶的很啊，當(dāng)年做電子琴，在Quartus II Memory Initialza
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基于FPGA的UPFC控制器IP設(shè)計

  • 　0 引言 　　統(tǒng)一潮流控制器(Unified Power Flow Con-troller，簡稱UPFC)是一種可以較大范圍地控制電流使之按指定路經(jīng)流動的設(shè)備，它可在保證輸電線輸送容量接近熱穩(wěn)定極限的同時又不至于過負(fù)荷。控制系統(tǒng)是UPFC的核
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IP承載網(wǎng)絡(luò)規(guī)劃設(shè)計探討

  • 毋庸置疑，現(xiàn)代通信網(wǎng)絡(luò)的發(fā)展，是由業(yè)務(wù)需求和市場需求來決定的，而不是技術(shù)的發(fā)展。我們回頭看看互聯(lián)網(wǎng)（IP網(wǎng)絡(luò)）的發(fā)展歷程，這其中市場推動的痕跡非常明顯：這一種六七十年代就已經(jīng)誕生的IP網(wǎng)絡(luò)技術(shù)，在九十年代
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基于FPGA的新型脈沖電源控制系統(tǒng)

  • 1引言在同步輻射加速器的電源設(shè)備中，舊的脈沖電源控制系統(tǒng)采用通用的邏輯元器件進(jìn)行設(shè)計，電路復(fù)雜，調(diào)試...
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j基于FPGA EP2S60的SoPC系統(tǒng)設(shè)計的綜合優(yōu)化方案

  • j基于FPGA EP2S60的SoPC系統(tǒng)設(shè)計的綜合優(yōu)化方案,為了提高設(shè)計性能(有時甚至只是為了達(dá)到設(shè)計要求)，對所設(shè)計的SOPC系統(tǒng)進(jìn)行綜合優(yōu)化是非常必要的。論文結(jié)合具體工程，以Altera公司的FPGA EP2S60為例，探討了SOPC系統(tǒng)設(shè)計的綜合優(yōu)化方法。

    1 綜合優(yōu)化設(shè)計的一般流
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基于FPGA高精度浮點(diǎn)運(yùn)算器的FFT設(shè)計與仿真

  • 摘要 基于IEEE浮點(diǎn)表示格式及FFT算法，提出一種基2FFT的FPGA方法，完成了基于FPGA高精度浮點(diǎn)運(yùn)算器的FFT的設(shè)計。利用VHDL語言描述了蝶形運(yùn)算過程及地址產(chǎn)生單元，其仿真波形基本能正確的表示輸出結(jié)果。
    關(guān)鍵詞 快速
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基于Nios II處理器的SVPWM IP Core設(shè)計

  • 摘要 為降低FPGA實(shí)現(xiàn)3電平SVPWM算法的復(fù)雜性，減小SVPWM模塊所占用的資源，文中利用正弦函數(shù)和余弦函數(shù)的關(guān)系，采用小容量ROM提出了一種新的SVPWM控制算法。利用Verilog HDL實(shí)現(xiàn)了算法的硬件設(shè)計，并封裝成IP核以方便
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基于FPGA的智能驅(qū)動控制系統(tǒng)設(shè)計

  • 智能驅(qū)動器以及許多汽車和 ISM 廠商正面臨著滿足新的市場需求和不斷發(fā)展的標(biāo)準(zhǔn)要求所帶來的重重挑戰(zhàn)。在現(xiàn)代工業(yè)和汽車應(yīng)用中，電機(jī)必須具有高效、低噪聲、速度范圍寬、可靠性高、成本合理等特性。在當(dāng)今工廠里，電機(jī)
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基于FPGA高速數(shù)據(jù)采集與傳輸?shù)穆暦鶞y井系統(tǒng)

  • 摘要 針對測井中信號傳輸速度低、操作繁瑣等問題，提出一種高速數(shù)據(jù)采集與傳輸?shù)男路椒?。該設(shè)計系統(tǒng)采用高速AD轉(zhuǎn)換，以靈活、高效性價比FPGA芯片-EP1C6為平臺，利用USB傳輸，實(shí)現(xiàn)了基于Verilog的聲幅測井系統(tǒng)。最終，
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基于Nios II步進(jìn)電機(jī)控制器IP核的設(shè)計與實(shí)現(xiàn)

  • 摘要 根據(jù)Nios II處理器的Avalon總線規(guī)范，設(shè)計了一款面向步進(jìn)電機(jī)的控制器IP核。該定制IP核采用軟、硬件協(xié)同設(shè)計的方法，功能符合Avalon總線的讀寫傳輸時序，具有完備的步進(jìn)電機(jī)驅(qū)動能力。仿真結(jié)果表明，該IP核具有
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Stratix V現(xiàn)發(fā)售業(yè)界首款高性能成品28-nm FPGA

  • 以最低的功耗獲得業(yè)界最好的性能。現(xiàn)在開始成品批量發(fā)售Stratix? V FPGA，它在高端應(yīng)用中實(shí)現(xiàn)了業(yè)界最大帶寬和最高系統(tǒng)集成度，非常靈活，降低成本和總功耗。
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萊迪思推出升級版HDR-60攝像機(jī)開發(fā)套件

  • 萊迪思半導(dǎo)體公司(NASDAQ: LSCC)在2月28日至3月1日于德國紐倫堡舉辦的嵌入式世界展上，宣布發(fā)布升級版萊迪思HDR-60攝像機(jī)開發(fā)套件，新增加了Helion的圖形用戶界面(GUI)。
  • 關(guān)鍵字： 萊迪思  FPGA  HDR-60  

基于FPGA動態(tài)背光源及其驅(qū)動電路設(shè)計

  • 摘要：LCD 顯示離不開背光源的輔助，而現(xiàn)在絕大多數(shù)顯示器采用恒定亮度背光源，存在顯示效果動態(tài)模糊以及低對比度等問題，并且耗能也較為嚴(yán)重。文章著重敘述一種基于視頻內(nèi)容逐幀分析，然后選擇最佳背光亮度的一種由
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基于FPGA的慣導(dǎo)組合數(shù)據(jù)采集及控制系統(tǒng)設(shè)計

  • 摘要：利用FPGA并行處理的特點(diǎn)及其豐富的I／O接口，在此設(shè)計了一種針對捷聯(lián)慣導(dǎo)系統(tǒng)的組合數(shù)據(jù)采集和控制系統(tǒng)。該系統(tǒng)能夠?qū)崟r采集慣導(dǎo)系統(tǒng)所需的IMU和GPS數(shù)據(jù)，能夠根據(jù)需要產(chǎn)生任意占空比的PWM控制信號，該系統(tǒng)預(yù)留
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