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基于CPLD系統(tǒng)的信號發(fā)生器設(shè)計(jì)

  • 摘要：文中采用Quartus II開發(fā)平臺，基于可編程邏輯器件CPLD設(shè)計(jì)出多波形信號發(fā)生器，可輸出頻率、幅度可調(diào)的三角波、正弦波和方波。任意波形模塊可由用戶輸出用戶所需的特殊波形，滿足了教學(xué)實(shí)驗(yàn)和開發(fā)新的實(shí)驗(yàn)項(xiàng)目
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基于CPLD／PPGA的出租車計(jì)費(fèi)系統(tǒng)

  • 介紹了出租車計(jì)費(fèi)器系統(tǒng)的組成及工作原理，簡述了在EDA平臺上用單片CPLD器件構(gòu)成該數(shù)字系統(tǒng)的設(shè)計(jì)思想和實(shí)現(xiàn)過程。論述了車型調(diào)整模塊、計(jì)程模塊、計(jì)費(fèi)模塊、譯碼動態(tài)掃描模塊等的設(shè)計(jì)方法與技巧。

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基于CPLD／FPGA的USB讀寫控制器

  • 引言
    隨著計(jì)算機(jī)科技的發(fā)展，無紙辦公日益成為各單位日常辦公的主要形式。而隨著USB存儲設(shè)備日益廣泛的使用，數(shù)據(jù)泄漏的危害也越來越嚴(yán)重。因此在單位內(nèi)部對USB存儲設(shè)備的操作權(quán)限進(jìn)行控制是很有必要的。
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降低CPLD的功耗的嵌入式應(yīng)用

  • 　引言　　從事便攜式或手持產(chǎn)品設(shè)計(jì)的工程師都明白，在如今的設(shè)計(jì)中，必須要最大限度地降低功耗。但是，只有經(jīng)驗(yàn)豐富的工程師理解盡可能地延長系統(tǒng)的電池壽命的那些微妙但又重要的細(xì)節(jié)。本文中我們將重點(diǎn)放在這些經(jīng)
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DSP與CPLD的智能變電站電網(wǎng)IED設(shè)計(jì)

  • DSP與CPLD的智能變電站電網(wǎng)IED設(shè)計(jì),摘要：著重介紹基于CPLD與DSP架構(gòu)的智能變電站電網(wǎng)IED(Intelligent Electronic Device，智能電力監(jiān)測裝置)的硬件架構(gòu)和軟件流程。著重闡述了“高速A／D轉(zhuǎn)換器+CPLD”在信號采集過程中的優(yōu)勢，以及多路信號
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基于ARM和CPLD的溫度控制器的設(shè)計(jì)

  • 1 引言 隨著計(jì)算機(jī)技術(shù)的飛速發(fā)展，在日常生活和生產(chǎn)中，人們要求更精確測量和控制溫度等模擬物理量，不僅滿足 ...
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Linux和S3C2410的PROFIBUS-DP主站平臺設(shè)計(jì)

  • 摘要：針對標(biāo)準(zhǔn)PROFIBUS—DP主站在國內(nèi)研究較少，自主研發(fā)產(chǎn)品的功能有限、智能化不足的現(xiàn)狀，進(jìn)行了基于Linux操作系統(tǒng)的PROFIBUS—DP主站的設(shè)計(jì)和研究，實(shí)現(xiàn)了PROFIBUS—DP1類主站的主從通信功能。采
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用CPLD設(shè)計(jì)LED顯示屏控制電路

  • 　　引言　　近年來，隨著計(jì)算機(jī)技術(shù)和集成電路技術(shù)的飛速發(fā)展，得到廣泛應(yīng)用的大屏幕顯示系統(tǒng)當(dāng)屬視頻LED顯示系統(tǒng)。在LED顯示技術(shù)中，由于紅色、綠色發(fā)光二極管的亮度、光效色差等性能也得到了很大的提高，加之計(jì)算
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基于CPLD的雙屏結(jié)構(gòu)液晶控制器的研究與設(shè)計(jì)

  • 介紹了Verilog HDL設(shè)計(jì)CPLD作為液晶控制器的幾個基本部分，經(jīng)過驗(yàn)證，所設(shè)計(jì)控制器在單片機(jī)作用下正確完成液晶的顯示。本設(shè)計(jì)創(chuàng)新點(diǎn)在于控制器設(shè)計(jì)使用硬件描述語言Verilog而非傳統(tǒng)設(shè)計(jì)方法設(shè)計(jì)，易于理解，易于維護(hù)，調(diào)試電路速度快，有許多易于掌握的仿真綜合布局布線工具。若使用其他液晶屏，只需修改程序中相關(guān)參數(shù)，更多功能的擴(kuò)充，也只需增添CPLD中的模塊即可實(shí)現(xiàn)。
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CPLD在TMS320F2812系統(tǒng)中的應(yīng)用

  • CPLD在TMS320F2812系統(tǒng)中的應(yīng)用,1 引言　　TMS320F2812是美國德州儀器公司推出的C2000 家族中最新一代產(chǎn)品。先進(jìn)的內(nèi)部和外設(shè)結(jié)構(gòu)使得該處理器主要用于大存儲設(shè)備管理、高性能的控制場合。在F2812構(gòu)成的應(yīng)用系統(tǒng)中，需要設(shè)計(jì)一些邏輯控制電路來保證
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基于CPLD的圖像傳感器非均勻性校正

  • 圖像傳感器的非均勻性直接影響了成像系統(tǒng)的探測靈敏度和空間分辨率,用這樣的成像裝置觀察景物,成像質(zhì)量必然受到影響,甚至圖像會模糊不清. 因此,必須對非均勻性進(jìn)行校正. 盡管針對非均勻性校正的研究多種多樣,但目前在
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CPLD在DSP多分辨率圖像采集系統(tǒng)中的應(yīng)用

  • CPLD在DSP多分辨率圖像采集系統(tǒng)中的應(yīng)用,視頻采集系統(tǒng)是數(shù)字圖像獲取的最基本手段，是進(jìn)行數(shù)字圖像處理、多媒體和網(wǎng)絡(luò)傳輸?shù)那疤幔蔀楦鞣N圖像處理算法提供待處理的原始數(shù)字圖像和算法驗(yàn)證平臺。隨著圖像數(shù)字化處理技術(shù)的高速發(fā)展，對圖像采集的要求也越
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基于CPLD的TMS320F2812硬件平臺設(shè)計(jì)

  • 本系統(tǒng)的開發(fā)采用了 DSP+CPLD 的結(jié)構(gòu)，這種結(jié)構(gòu)將DSP 較強(qiáng)的數(shù)據(jù)運(yùn)算能力與CPLD 的高集成性、硬件可重復(fù)編程性結(jié)合在一起，使系統(tǒng)的設(shè)計(jì)過程更加的合理、緊湊和簡化
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CPLD的DSP多SPI端口通信設(shè)計(jì)

  • CPLD的DSP多SPI端口通信設(shè)計(jì),本文介紹一種采用運(yùn)動控制專用DSP芯片DSP56F801設(shè)計(jì)的超聲波電機(jī)運(yùn)動控制裝置。由于該超聲波電機(jī)需要采用兩相四路對稱PWM信號來實(shí)現(xiàn)驅(qū)動控制，而DSP芯片無法直接產(chǎn)生所需PWM信號，采用軟件方法又會占用大量的DSP計(jì)算
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VHDL語言在FPGA／CPLD開發(fā)中的應(yīng)用?

  • VHDL語言在FPGA／CPLD開發(fā)中的應(yīng)用?,【摘　要】　通過設(shè)計(jì)實(shí)例詳細(xì)介紹了用VHDL（VHSIC Hardware DescriptionLanguage）語言開發(fā)FPGA／CPLD的方法，以及與電路圖輸入和其它HDL語言相比，使用VHDL語言的優(yōu)越性。
    關(guān)鍵詞：VHDL，F(xiàn)PGA／CPLD，EDA
  • 關(guān)鍵字： 開發(fā)  應(yīng)用  CPLD  FPGA  語言  VHDL  
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