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基于CPCI總線(xiàn)的加固計(jì)算機(jī)設(shè)計(jì)

  • 摘要：介紹了CPCI總線(xiàn)的概念及特點(diǎn)，并介紹了用CPCI板卡CPCI-3915、MIC-3612、CBP-3206設(shè)計(jì)的加固計(jì)算機(jī)。試驗(yàn)和使用結(jié)果表明：該產(chǎn)品設(shè)計(jì)合理，工作穩(wěn)定，性能良好，性?xún)r(jià)比高，其可靠性、可維性均比以往的產(chǎn)品有了
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基于CPCI的嵌入式單板計(jì)算機(jī)電源的設(shè)計(jì)方案

  • 嵌入式運(yùn)行速度高，系統(tǒng)較復(fù)雜，常常集成超大規(guī)模FPGA器件、DSP器件、DDR存儲(chǔ)器以及各種接口電路。這對(duì)電源的輸出電壓值、功耗、電壓精度、上電順序以及電源完整性提出更高的要求。這里介紹一種基于CPCI的嵌入式單板
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CPCI總線(xiàn)的分布式系統(tǒng)設(shè)計(jì)應(yīng)用

  • 大規(guī)模系統(tǒng)應(yīng)采用分布式網(wǎng)絡(luò)架構(gòu)，同時(shí)應(yīng)具有開(kāi)放性和良好的可擴(kuò)展性，以適應(yīng)不斷變化的應(yīng)用環(huán)境和需求;系統(tǒng)中各模塊分工處理不同類(lèi)型數(shù)據(jù)，應(yīng)具有相對(duì)的獨(dú)立自主性，同時(shí)又在不同的層次上相互關(guān)聯(lián)，能實(shí)現(xiàn)相互訪(fǎng)問(wèn)和
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一種基于VC++程序的FPGA重配置方案設(shè)計(jì)

  • 引言隨著大規(guī)模集成電路的快速發(fā)展，系統(tǒng)設(shè)計(jì)已從傳統(tǒng)的追求大規(guī)模、高密度逐漸轉(zhuǎn)向提高資源利用率，...
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基于CPCI總線(xiàn)CPU主控模塊的設(shè)計(jì)與實(shí)現(xiàn)

  • 在一些惡劣環(huán)境和軍事應(yīng)用環(huán)境條件下，所應(yīng)用的計(jì)算機(jī)比普通商用計(jì)算機(jī)具有更高、更嚴(yán)的要求，提出基于CPCI總線(xiàn)的CPU主控模塊設(shè)計(jì)方案。該方案嚴(yán)格遵守CPCI規(guī)范，利用高性能、低功耗、集成度高的ETX PM模塊實(shí)現(xiàn)通用計(jì)算機(jī)的主板功能，采用TI公司的PCI2050B橋電路作為CPCI的接口模塊，實(shí)現(xiàn)了多級(jí)總線(xiàn)擴(kuò)展結(jié)構(gòu)。該設(shè)計(jì)方案簡(jiǎn)化了設(shè)計(jì)，節(jié)省了30％的研制費(fèi)用，縮短了1／2的研制周期。該模塊已經(jīng)通過(guò)艦栽的應(yīng)用測(cè)試，在-40～85℃的環(huán)境下，系統(tǒng)工作穩(wěn)定，各接口應(yīng)用正常，達(dá)到了該項(xiàng)目的技術(shù)指標(biāo)要求。
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基于CPCI體系的高性能監(jiān)測(cè)測(cè)向處理平臺(tái)研究

  • 摘要：提出一種新的高速并行采樣技術(shù)架構(gòu)以及基于可編程芯片技術(shù)和支持靈活配置的并行處理嵌入式硬件...
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基于研華CPCI總線(xiàn)架構(gòu)設(shè)計(jì)的實(shí)時(shí)圖像信號(hào)處理平臺(tái)

  • 摘要: 本文主要介紹了基于CPCI 總線(xiàn)設(shè)計(jì)的實(shí)時(shí)信號(hào)處理業(yè)務(wù)所需的一種專(zhuān)用設(shè)備平臺(tái)。平臺(tái)基本方案的主要部分是采用DSP+FPGA混用設(shè)計(jì)的業(yè)務(wù)板、電氣接口以及物理形狀因數(shù)。架構(gòu)設(shè)計(jì)選擇開(kāi)放式的Compact PCI總線(xiàn)作為基
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基于CPCI總線(xiàn)多DSP系統(tǒng)的高速主機(jī)接口設(shè)計(jì)

  • 基于CPCI總線(xiàn)多DSP系統(tǒng)的高速主機(jī)接口設(shè)計(jì),在現(xiàn)代通信、雷達(dá)和聲納系統(tǒng)中，隨著實(shí)時(shí)處理要求的不斷提高，對(duì)數(shù)字信號(hào)處理系統(tǒng)也提出了更高的要求。板載多片高性能的DSP芯片，配合大容量的SDRAM，可以很好地滿(mǎn)足上述要求，并且已經(jīng)成為了數(shù)字信號(hào)處理系統(tǒng)發(fā)展的
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CPCI總線(xiàn)在數(shù)字化電臺(tái)中的設(shè)計(jì)

  • 　隨著現(xiàn)代軍事通信技術(shù)的進(jìn)步，數(shù)字化短波電臺(tái)逐步往嵌入式、模塊化的方向發(fā)展。CPCI總線(xiàn)作為一種新興的總線(xiàn)技術(shù)，在短波電臺(tái)的模塊化設(shè)計(jì)上具有重要的應(yīng)用價(jià)值，可以較大程度地提高數(shù)字化短波電臺(tái)的可靠性和保障性
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基于CPCI總線(xiàn)的便攜式電磁閥測(cè)試設(shè)備設(shè)計(jì)

  • 1. 前言 由于某型號(hào)電磁閥熱真空試驗(yàn)需要出廠完成，在試驗(yàn)過(guò)程中需測(cè)試閥門(mén)響應(yīng)特性，傳統(tǒng)的測(cè)試設(shè)備體積無(wú)法滿(mǎn)足運(yùn)輸需求，因此需要配備便于攜帶的電磁閥測(cè)試設(shè)備。 CompactPCI簡(jiǎn)稱(chēng)CPCI，中文又稱(chēng)緊湊型PCI，
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基于CPCI總線(xiàn)的通用FPGA信號(hào)處理板的設(shè)計(jì)

  • 隨著雷達(dá)信號(hào)處理技術(shù)的不斷發(fā)展以及現(xiàn)代國(guó)防對(duì)雷達(dá)技術(shù)的需求，系統(tǒng)對(duì)雷達(dá)信號(hào)處理的要求也越來(lái)越高，需要實(shí)時(shí)處理更加龐大的數(shù)據(jù)。先進(jìn)的雷達(dá)信號(hào)處理設(shè)備不僅要求性能高、功能多樣化，而且要求信號(hào)處理設(shè)備
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基于CPCI總線(xiàn)的智能A／D，D／A模塊設(shè)計(jì)

  • A／D和D／A接口在工業(yè)控制應(yīng)用中普遍存在．這就促使了基于各種接口的A／D，D／A模塊的誕生?；贑PCI總線(xiàn)的A／D，D／A模塊通過(guò)CPCI總線(xiàn)與主機(jī)通信，通過(guò)A／D接口采集電壓信號(hào)，經(jīng)過(guò)伺服控制軟件處理，輸出模擬量驅(qū)動(dòng)執(zhí)行機(jī)構(gòu)。該模塊使用DSP芯片對(duì)數(shù)據(jù)進(jìn)行實(shí)時(shí)處理，通過(guò)CPCI總線(xiàn)進(jìn)行快速的數(shù)據(jù)傳輸。在實(shí)際應(yīng)用中得到了可靠性、實(shí)時(shí)性等方面驗(yàn)證。
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基于CPCI總線(xiàn)10／100 Mb／s以太網(wǎng)卡的設(shè)計(jì)與實(shí)現(xiàn)

  • 0 引 言
    基于PCI總線(xiàn)的以太網(wǎng)控制器是現(xiàn)在以致將來(lái)網(wǎng)絡(luò)應(yīng)用方面的一個(gè)主要發(fā)展方向。8位ISA網(wǎng)卡目前已被淘汰，市場(chǎng)上常見(jiàn)的是16位ISA接口的10 Mb／s網(wǎng)卡，它的惟一好處就是價(jià)格低廉，適合于一些如網(wǎng)吧等要求不高
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基于CPCI的嵌入式系統(tǒng)的電源設(shè)計(jì)

  • 1 引言
    嵌入式系統(tǒng)廣泛應(yīng)用于控制和通信領(lǐng)域。而這些系統(tǒng)運(yùn)行速度高，系統(tǒng)較復(fù)雜，常常集成超大規(guī)模FPGA器件、DSP器件、DDR存儲(chǔ)器以及各種接口電路。這對(duì)電源的輸出電壓值、功耗、電壓精度、上電順序以及電源完
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cpci介紹

　　一、CPCI簡(jiǎn)介 　　Compact PCI（Compact Peripheral Component Interconnect）簡(jiǎn)稱(chēng)CPCI，中文又稱(chēng)緊湊型PCI，是國(guó)際工業(yè)計(jì)算機(jī)制造者聯(lián)合會(huì)（PCI Industrial Computer Manufacturer's Group，簡(jiǎn)稱(chēng)PICMG）于1994提出來(lái)的一種總線(xiàn)接口標(biāo)準(zhǔn)。是以PCI電氣規(guī)范為標(biāo)準(zhǔn)的高性能工業(yè)用總線(xiàn)。CPCI的C [ 查看詳細(xì) ]

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