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asic ip 文章 最新資訊

精確時鐘同步確保IP網(wǎng)電信級特性

  • 回顧以太網(wǎng)同步技術(shù)的發(fā)展，我們曾在以太網(wǎng)上用過互聯(lián)網(wǎng)網(wǎng)絡(luò)時間協(xié)議NTP(Network Time Protocol)技術(shù)，簡單網(wǎng)絡(luò)時間協(xié)議SNTP(Simple Network Time Protocol)技術(shù)，GPS技術(shù)或用T1/E1和以太網(wǎng)組成混合網(wǎng)絡(luò)來增加以太網(wǎng)
  • 關(guān)鍵字： 電信  特性  IP  確保  時鐘  同步  精確  

新出現(xiàn)的SoC FPGA上的策略考慮

  • 集成了FPGA架構(gòu)、硬核CPU子系統(tǒng)以及其他硬核IP的半導(dǎo)體器件SoCFPGA已經(jīng)發(fā)展到了一個“關(guān)鍵點”，它在今...
  • 關(guān)鍵字： SoC  FPGA  硬核  IP  嵌入式系統(tǒng)  Altera  

IP視頻監(jiān)控系統(tǒng)存儲設(shè)備選型指導(dǎo)

  • 近年來，模擬視頻監(jiān)控系統(tǒng)的市場份額在不斷縮水，正如人們所期望的，IP視頻監(jiān)控逐漸深入人心。確實，IP視頻監(jiān)控解決了傳統(tǒng)監(jiān)控布線繁瑣的問題，可是它也帶來了新的問題?！　∧M攝像機達(dá)到650線便已是最高水平，然而
  • 關(guān)鍵字： 選型  指導(dǎo)  存儲設(shè)備  監(jiān)控系統(tǒng)  視頻  IP  

SPI IP核及其在微投影系統(tǒng)中的應(yīng)用

  • 摘要：介紹了SPI總線控制器IP核的硬件結(jié)構(gòu)與應(yīng)用方法，并著重介紹了該IP核在微投影系統(tǒng)中的使用，以完成微顯示芯片的初始化。實驗表明，該SPI總線接口使用靈活，便于移植，并且穩(wěn)定可靠。
    關(guān)鍵詞：SPI總線控制器；N
  • 關(guān)鍵字： 系統(tǒng)  應(yīng)用  投影  及其  IP  SPI  

FreeARM7 IP核的微處理器邏輯擴展與驗證

  • 摘要：介紹了FreeARM7 IP核的基本概況及其接口特點，以LPC2101為原型對該IP核進(jìn)行了擴展。結(jié)合USB 1．1設(shè)備控制器IP核和自定制硬件邏輯，構(gòu)建了一種微控制器功能驗證回路。在主機端開發(fā)了驗證程序、驅(qū)動和通信軟件。
  • 關(guān)鍵字： 擴展  驗證  邏輯  微處理器  IP  FreeARM7  

基于Wishbone總線的UART IP核設(shè)計

  • 摘要：介紹了一種基于Wishbone總線的UART IP核的設(shè)計方法。該設(shè)計采用了自頂向下的模塊化劃分和有限狀態(tài)機相結(jié)合的方法，由于其應(yīng)用了標(biāo)準(zhǔn)的Wishbone總線接口，從而使微機系統(tǒng)與串行設(shè)備之間的通信更加靈活方便。驗證
  • 關(guān)鍵字： IP  設(shè)計  UART  總線  Wishbone  基于  

ASIC原型驗證板DDR2 速率再攀高峰

  • 　　唐芯微電子(Infix-IP)Altera Stratix IV 530/820 FPGA單顆(MB3100-A5/8)和雙顆(D-MB3100A)原型驗證平臺半年來在用戶項目使用中，從性能、價格、穩(wěn)定性來說已得到了用戶的很高評價，當(dāng)然，唐芯微人還是不失抓住每一次售后機會，把握用戶提出的問題和建議，配合用戶完成項目的同時對這款產(chǎn)品進(jìn)行一次次優(yōu)化修正，不但用戶對唐芯微電子售后服務(wù)有了更進(jìn)一步體會，而且?guī)醉椉夹g(shù)成果的突破也讓用戶刮目相看。 　　比如，在這一定要再提一下的是，經(jīng)過唐芯微(Infix-IP)
  • 關(guān)鍵字： 唐芯微電子  ASIC  

ASIC原型驗證板DDR2 速率再攀高峰

  • 　　唐芯微電子(Infix-IP)Altera Stratix IV 530/820 FPGA單顆(MB3100-A5/8)和雙顆(D-MB3100A)原型驗證平臺半年來在用戶項目使用中，從性能、價格、穩(wěn)定性來說已得到了用戶的很高評價，當(dāng)然，唐芯微人還是不失抓住每一次售后機會，把握用戶提出的問題和建議，配合用戶完成項目的同時對這款產(chǎn)品進(jìn)行一次次優(yōu)化修正，不但用戶對唐芯微電子售后服務(wù)有了更進(jìn)一步體會，而且?guī)醉椉夹g(shù)成果的突破也讓用戶刮目相看。
  • 關(guān)鍵字： ASIC  DDR2  

臺積電和聯(lián)電爭搶IP授權(quán)商機 代工廠整合第三方設(shè)計工具已成趨勢

  • 　　芯片設(shè)計愈趨復(fù)雜，對已驗證IP的需求也愈來愈高，根據(jù)全球半導(dǎo)體協(xié)會(GSA)統(tǒng)計，2010年晶圓代工廠提供給IC設(shè)計業(yè)者的IP數(shù)量，已經(jīng)超過以IP授權(quán)為主要業(yè)務(wù)的第三方IP供貨商。為了縮短芯片設(shè)計至量產(chǎn)時間，臺積電旗下創(chuàng)意、聯(lián)電旗下智原等2家設(shè)計服務(wù)業(yè)者，已經(jīng)成為晶圓雙雄搶食IP授權(quán)市場趨勢下的主要受惠者。 　　根據(jù)GSA調(diào)查統(tǒng)計，IC設(shè)計業(yè)者的IP來源，雖然因為芯片設(shè)計功能區(qū)塊(design block)仍以自家技術(shù)為主，自有IP比例達(dá)到66%，但是去年一年當(dāng)中，已有愈來愈多的IC設(shè)計業(yè)者開始依賴
  • 關(guān)鍵字： 臺積電  IP  

FPGA基礎(chǔ)入門（二）

基于CPLD設(shè)計的電器定時開關(guān)控制系統(tǒng)

利用CPLD來替代微控制器的6種方法

我學(xué)習(xí)FPGA的總結(jié)

verilog中阻塞賦值和非阻塞復(fù)制的理解

選擇VHDL或者verilog HDL還是System Verilog？

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