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EEPW首頁(yè) >> 主題列表 >> asic ip核

安森美半導(dǎo)體擴(kuò)充ASIC系列，投資于110 nm技術(shù)及知識(shí)產(chǎn)權(quán)

  • 　　與LSI公司達(dá)成協(xié)議利用110 nm工藝、經(jīng)過(guò)硅驗(yàn)證的IP和靈活的支援選擇， 將先進(jìn)ASIC和SoC的成本減至最低，并將上市時(shí)間縮至最短。 　　2009年4月14日 - 全球領(lǐng)先的高性能、高能效硅方案供應(yīng)商安森美半導(dǎo)體(ON Semiconductor與LSI 公司達(dá)成的協(xié)議，進(jìn)一步擴(kuò)充專用集成電路(ASIC)系列。這協(xié)議讓安森美半導(dǎo)體的客戶能夠通過(guò)設(shè)在美國(guó)俄勒岡州Gresham的安森美半導(dǎo)體晶圓制造廠，獲得成熟及高性價(jià)比的110納米(nm)工藝技術(shù)，及相關(guān)的經(jīng)過(guò)硅驗(yàn)證的知識(shí)產(chǎn)權(quán)(IP)。 　　這
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USB IP核的設(shè)計(jì)和應(yīng)用

  • 摘要：由于USB接口廣泛應(yīng)用，現(xiàn)在眾多SoC中都嵌入了USBIP核。但當(dāng)前市場(chǎng)上的USB IP核一般僅僅針對(duì)某一種總線結(jié)構(gòu)的SoC，可重用性不強(qiáng)。介紹了一款可配置的USB IP核設(shè)計(jì)，重點(diǎn)描述USB IP核的結(jié)構(gòu)劃分，詳細(xì)闡述了各模
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MC8051單片機(jī)IP核的FPGA實(shí)現(xiàn)與應(yīng)用

  • 分析了與標(biāo)準(zhǔn)805l MCU兼容的MC805l IP核結(jié)構(gòu)原理與設(shè)計(jì)層次，詳細(xì)論述了MC8051 IP核的FPGA實(shí)現(xiàn)與應(yīng)用方法。通過(guò)試驗(yàn)驗(yàn)證，其性能比標(biāo)準(zhǔn)8051 MCU高，方便與系統(tǒng)其他模塊的集成。在各種嵌入式系統(tǒng)和片上系統(tǒng)中使用該IP核具有重要意義。
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AMD合資工廠任命前聯(lián)華電子高管為CMO

  • Globalfoundries日前任命前賽普拉斯半導(dǎo)體公司高管吉姆-庫(kù)拜克(Jim Kupec)擔(dān)任該公司首席營(yíng)銷官(CMO)。
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基于EDA技術(shù)的單片機(jī)IP核設(shè)計(jì)

  • 摘 要:本文介紹了利用EDA技術(shù)設(shè)計(jì)出與MCS-51系列微處理器指令集完全兼容的8位嵌入式微處理器芯片的IP核，并經(jīng)過(guò)驗(yàn)證獲得了滿意的效果。
    關(guān)鍵詞: 電子設(shè)計(jì)自動(dòng)化；知識(shí)產(chǎn)權(quán)核；設(shè)計(jì) 1. 引言EDA（Electronic De
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40nm FPGA搶灘登陸 ASIC尚能飯否

  • ??????? “我們新的管理團(tuán)隊(duì)大部分人來(lái)自ASIC公司?！痹赬ilinx二十五周年慶典之時(shí)，Xilinx全球副總裁湯立人風(fēng)趣的說(shuō)道，“他們也是因?yàn)榭吹搅薃SIC已達(dá)到局限性，因此決定‘棄暗投明’了。” ????????繼Altera于2008年底發(fā)布了首款基于40-nm技術(shù)的FPG
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采用ASIC技術(shù)的新一代電流傳感器

  • 目前在市場(chǎng)上我們可以采購(gòu)到很多霍爾-ASIC傳感器，我們可以用這些傳感器來(lái)測(cè)量位置、磁場(chǎng)以及電流。所有這些ASIC傳感器大多用于進(jìn)行精確快速的電流測(cè)量，比如電力電子行業(yè)，對(duì)于電磁干擾具有高抗干擾性的優(yōu)點(diǎn)。 這一
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數(shù)字RF存儲(chǔ)器用混合信號(hào)ASIC(05-100)

  • 　　數(shù)字RF存儲(chǔ)器(DRFM)用于現(xiàn)代脈沖壓縮雷達(dá)中合成相干信號(hào)的再生。DRFM系統(tǒng)有很多不同的實(shí)現(xiàn)方法。圖1示出1個(gè)特殊的類型，它是1個(gè)雙邊帶，4位，相位取樣系統(tǒng)，它的瞬時(shí)帶寬為500MHz。采用0.18祄 CMOS 工藝制造的混合信號(hào)專用集成電器(ASIC)可實(shí)現(xiàn)系統(tǒng)的基帶元件，這包括相位取樣電路、數(shù)字處理、信號(hào)重建和數(shù)/模輸出。
  • 關(guān)鍵字： RF  ASIC  

視頻監(jiān)控應(yīng)用拓寬兩種方案各有千秋

  •         盡管現(xiàn)在還面臨國(guó)際金融危機(jī)的考驗(yàn)，但業(yè)界仍然看好今年的視頻監(jiān)控市場(chǎng)。網(wǎng)絡(luò)視頻監(jiān)控技術(shù)的應(yīng)用，又將產(chǎn)業(yè)發(fā)展帶到了一個(gè)新的高度，它將引領(lǐng)產(chǎn)業(yè)的又一次變革。用戶對(duì)圖像清晰度、處理速度和智能分析方面更高的要求，將促使視頻監(jiān)控技術(shù)向高清化、系統(tǒng)化、智能化發(fā)展，這已經(jīng)成為當(dāng)前技術(shù)發(fā)展的重要方向。 中國(guó)視頻監(jiān)控市場(chǎng)規(guī)模預(yù)測(cè)（2007-2012） 數(shù)據(jù)來(lái)源：IDC      
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汽車系統(tǒng)ASIC、ASSP和電磁兼容性設(shè)計(jì)

  • 現(xiàn)代汽車中的電子設(shè)備不斷增多，因而越來(lái)越需要采用良好的設(shè)計(jì)，以滿足主要的電磁兼容性標(biāo)準(zhǔn)的要求。同時(shí)，越來(lái)越...
  • 關(guān)鍵字： ASIC  ASSP  電磁兼容  芯片  

有關(guān)可編程邏輯器件的發(fā)展歷程及其概述

  • 當(dāng)今社會(huì)是數(shù)字化的社會(huì)，是數(shù)字集成電路廣泛應(yīng)用的社會(huì)。數(shù)字集成電路本身在不斷地進(jìn)行更新?lián)Q代。它由早期的...
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FPGA在汽車ECU領(lǐng)域大有可為

  • 基于MCU、定制ASIC和體積龐大的電線束來(lái)實(shí)現(xiàn)引擎及控制電子的系統(tǒng)方案已發(fā)展至接近其技術(shù)和應(yīng)用極限，汽車工 ...
  • 關(guān)鍵字： MCU  引擎控制單元  ASIC  

新型MCU實(shí)現(xiàn)帶DRM的單芯片數(shù)字音頻解碼器

  • 　　近幾年，數(shù)字音頻市場(chǎng)發(fā)展非常迅速。獨(dú)立式音頻與多媒體播放器近幾年已成為數(shù)字音頻市場(chǎng)的主流。數(shù)以百萬(wàn)計(jì)的消費(fèi)者都在想辦法將其便攜式播放器與家用音響和車載立體聲音響進(jìn)行最佳連接。這激勵(lì)著目前的家用和車載音頻設(shè)備廠商為迎接數(shù)字時(shí)代的到來(lái)而開始準(zhǔn)備他們的HiFi系統(tǒng)。為了滿足人們對(duì)播放器不斷提高的要求，市場(chǎng)上也出現(xiàn)了大量芯片或芯片組。但這些進(jìn)入數(shù)字音頻市場(chǎng)的芯片往往有很多缺陷，問(wèn)題就出在合適處理硬件的選擇方面。 　　傳統(tǒng)解決方案 　　有些廠商試圖將計(jì)算機(jī)的一些組件用于音頻或多媒體播放器。盡管這些組件在一臺(tái)
  • 關(guān)鍵字： 數(shù)字音頻  ASIC  NAND  

業(yè)界容量最大的ASIC原型電路板采用了Altera Stratix III器件

  •  　　2008年11月11號(hào)，北京——Altera公司(NASDAQ: ALTR)今天宣布，Dini集團(tuán)在其業(yè)界容量最大的單板FPGA原型引擎中采用了具有340K邏輯單元(LE)的Stratix® III EP3SL340 FPGA。DN7020K10采用了1,760引腳封裝的20片EP3SL340 FPGA，每個(gè)器件提供1,104個(gè)用戶I/O，容量等價(jià)于5千萬(wàn)ASIC邏輯門?？蛻粼O(shè)計(jì)無(wú)線通信、網(wǎng)絡(luò)和圖形處理應(yīng)用等定制ASIC時(shí)，可以利用這一超大容量原型電路板來(lái)驗(yàn)
  • 關(guān)鍵字： Altera  Dini集團(tuán)  Altera Stratix III FPGA  ASIC  

如何仿真IP核（建立modelsim仿真庫(kù)完整解析）

  • 　　IP核生成文件：（Xilinx/Altera 同） 　　IP核生成器生成 ip 后有兩個(gè)文件對(duì)我們比較有用，假設(shè)生成了一個(gè) asyn_fifo 的核，則asyn_fifo.veo 給出了例化該核方式（或者在 Edit－>Language Template->COREGEN 中找到verilog/VHDL 的例化方式）。asyn_fifo.v 是該核的行為模型，主要調(diào)用了 xilinx 行為模型庫(kù)的模塊，仿真時(shí)該文件也要加入工程。（在 ISE中點(diǎn)中該核，在對(duì)應(yīng)的 processes 窗口中
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asic ip核介紹

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