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EEPW首頁(yè) >> 主題列表 >> 幀同步

VHDL語(yǔ)言實(shí)現(xiàn)的幀同步算法

  • 數(shù)字通信網(wǎng)中,幀同步是同步復(fù)接設(shè)備中最重要的部分,他包括幀同步碼的產(chǎn)生和幀同步碼的識(shí)別,其中接收端的幀同步識(shí)別電路的結(jié)構(gòu)對(duì)同步性能的影響是主
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一種精確幀同步算法及FPGA實(shí)現(xiàn)

  • 在衛(wèi)星通信系統(tǒng)中,發(fā)送端通常利用不同的分組時(shí)隙同步傳送處在同一傳輸頻帶內(nèi)的各路信號(hào),而接收端為了準(zhǔn)確識(shí)別和分離出數(shù)據(jù)流中的各路信號(hào),需要采用幀同步算法進(jìn)行分組檢測(cè)和符號(hào)同步,其中分組檢測(cè)用來(lái)識(shí)別數(shù)據(jù)分
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基于FPGA的PCM-FM遙測(cè)中頻接收機(jī)設(shè)計(jì)與實(shí)現(xiàn)

  • 本文設(shè)計(jì)實(shí)現(xiàn)了一款基于FPGA的PCM-FM遙測(cè)中頻接收機(jī),在FPGA中實(shí)現(xiàn)遙測(cè)信號(hào)解調(diào)、位同步、幀同步等功能,系統(tǒng)碼速率、幀長(zhǎng)、幀同步碼可靈活設(shè)置。接收機(jī)硬件結(jié)構(gòu)簡(jiǎn)單,主要包括FPGA、ADC、電源轉(zhuǎn)換芯片、USB接口芯片等常用器件,可單板實(shí)現(xiàn),達(dá)到低成本、小型化設(shè)計(jì)要求。性能測(cè)試表明,中頻接收機(jī)滿足設(shè)計(jì)指標(biāo)要求,目前該接收機(jī)已服務(wù)于多個(gè)項(xiàng)目。
  • 關(guān)鍵字: 遙測(cè)系統(tǒng)  中頻接收機(jī)  位同步  幀同步  FPGA  201506  

基于FPGA的幀同步系統(tǒng)設(shè)計(jì)方案

  • 在Xilinx的FPGA器件XC3S200-4FT200上對(duì)方案中設(shè)計(jì)的幀同步系統(tǒng)進(jìn)行了實(shí)現(xiàn),利用Modelsim 6.0軟件進(jìn)行了仿真測(cè)試。仿真結(jié)果表明,本方案設(shè)計(jì)的同步系統(tǒng)工作穩(wěn)定,滿足性能要求。
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基于疊加訓(xùn)練序列光OFDM系統(tǒng)幀同步算法FPGA實(shí)現(xiàn)

  • 光纖通信系統(tǒng)中引進(jìn)OFDM技術(shù)給O-OFDM系統(tǒng)帶來(lái)對(duì)同步、高峰均比等敏感問(wèn)題。疊加訓(xùn)練序列技術(shù)時(shí)IM/DDO-OFDM系統(tǒng)幀同步算法研究,設(shè)計(jì)了FPGA的算法實(shí)現(xiàn)結(jié)構(gòu),聯(lián)合Matlab,Modelsim等仿真工具驗(yàn)證算法開(kāi)發(fā)的有效性。實(shí)驗(yàn)結(jié)果表明,疊加的訓(xùn)練序列對(duì)數(shù)據(jù)影響較小,與傳統(tǒng)方法相比,具有更高的同步正確率,易于實(shí)現(xiàn),有較強(qiáng)的工程應(yīng)用前景。
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基于FPGA的幀同步提取方法的研究

  • 在可靠的通信系統(tǒng)中,要保證接收端能正確解調(diào)出信息,必須要有一個(gè)同步系統(tǒng),以實(shí)現(xiàn)發(fā)送端和接收端的同步,因此同步提取在通信系統(tǒng)中是至關(guān)重要的。一個(gè)簡(jiǎn)單的接收系統(tǒng)框圖如圖1所示。 本文介紹一種基于現(xiàn)場(chǎng)可編程門(mén)
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一種多體制通信時(shí)間同步算法及其FPGA實(shí)現(xiàn)

  • ??????? 適用多體制通信的時(shí)間同步算法   為了解決傳統(tǒng)時(shí)間同步算法不適用于多種無(wú)線通信體制且不適于硬件實(shí)現(xiàn)等問(wèn)題,本文提出了一種改進(jìn)的時(shí)間同步算法,如圖1所示。在改進(jìn)的時(shí)間同步算法中,本地同步序列分成和兩段,從而使幀同步和位同步都可以利用接收序列與本地同步序列的相關(guān)性實(shí)現(xiàn)。因此,只需要改變本地同步序列,改進(jìn)后的時(shí)間同步算法就可以適用于不同的通信體制。
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幀同步系統(tǒng)的FPGA設(shè)計(jì)與實(shí)現(xiàn)

  • 1 引言
    數(shù)字通信時(shí),一般以一定數(shù)目的碼元組成一個(gè)個(gè)“字”或“句”,即組成一個(gè)個(gè)“幀”進(jìn)行傳輸,因此幀同步信號(hào)的頻率很容易由位同步信號(hào)經(jīng)分頻得出,但每個(gè)幀的開(kāi)頭和末尾時(shí)刻卻無(wú)法由分頻器的輸出決定。為
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同步數(shù)字復(fù)接的設(shè)計(jì)及其FPGA實(shí)現(xiàn)

  • 摘要: 在簡(jiǎn)要介紹同步數(shù)字復(fù)接基本原理的基礎(chǔ)上,采用VHDL語(yǔ)言對(duì)同步數(shù)字復(fù)接各組成模塊進(jìn)行了設(shè)計(jì),并在ISE集成環(huán)境下進(jìn)行了設(shè)計(jì)描述、綜合、布局布線及時(shí)序仿真,取得了正確的設(shè)計(jì)結(jié)果,同時(shí)利用中小容量的FPGA實(shí)現(xiàn)了同步數(shù)字復(fù)接功能。 關(guān)鍵詞: 同步數(shù)字復(fù)接/分接 FPGA 位同步 幀同步檢測(cè)   基群速率數(shù)字信號(hào)的合成設(shè)備和分接設(shè)備是電信網(wǎng)絡(luò)中使用較多的關(guān)鍵設(shè)備,在數(shù)字程控交換機(jī)的用戶(hù)模塊、小靈通基站控制器和集團(tuán)電話中都需要使用這種同步數(shù)字復(fù)接設(shè)備。近年來(lái),隨著需要自建內(nèi)部通信系統(tǒng)的公司和企
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STM-1并行幀同步系統(tǒng)的設(shè)計(jì)與FPGA實(shí)現(xiàn)

基于USB2.0的高速無(wú)線數(shù)傳接收設(shè)備的數(shù)據(jù)接收存儲(chǔ)方法

  • 基于USB2.0的高速無(wú)線數(shù)傳接收設(shè)備的數(shù)據(jù)接收存儲(chǔ)方法 北京理工大學(xué)電子工程系(100081) 李新昌    摘 要:介紹了一種利用USB2.0接口芯片ISP1581并配合FPGA芯片EP1K30TI144和DSP芯片TMS320F206實(shí)現(xiàn)無(wú)線數(shù)傳接收設(shè)備中數(shù)據(jù)接收存儲(chǔ)的方法。這種方法具有接口簡(jiǎn)單、使用方便等特點(diǎn)。   關(guān)鍵詞:位同步 幀同步 USB2.0 差錯(cuò)控制   數(shù)據(jù)接收存儲(chǔ)技術(shù)是信號(hào)采集處理領(lǐng)域內(nèi)的一個(gè)重要課題。利用這種技術(shù),可以把信號(hào)的實(shí)時(shí)采集和精確處理在時(shí)間上分為兩個(gè)階段,
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幀同步電路的設(shè)計(jì)

  • 數(shù)字通信網(wǎng)中,常常把若干路低速數(shù)字信號(hào)合并成一個(gè)高速數(shù)字信號(hào),通過(guò)高速信道傳輸以擴(kuò)大傳輸容量,提高傳輸效率。
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一種基于二次擴(kuò)頻的幀同步提取的FPGA實(shí)現(xiàn)

  • 摘    要:本文介紹了一種利用擴(kuò)頻技術(shù)實(shí)現(xiàn)幀同步的方案,重點(diǎn)介紹了用補(bǔ)碼配對(duì)相減匹配濾波法實(shí)現(xiàn)同步提取的原理及其FPGA設(shè)計(jì)實(shí)現(xiàn),并在同步提取的基礎(chǔ)上簡(jiǎn)要敘述了幀同步信號(hào)的抵消。關(guān)鍵詞:相關(guān)峰;幀同步;補(bǔ)碼配對(duì)相減匹配濾波法 引言在時(shí)分復(fù)用通信系統(tǒng)中,實(shí)現(xiàn)幀同步的傳統(tǒng)方法是在復(fù)用幀中插入一個(gè)幀同步時(shí)隙,幀同步碼是一組特殊碼型的碼組,接收端利用幀同步碼的相關(guān)性實(shí)現(xiàn)幀同步。幀同步碼是具有良好自相關(guān)性和互相關(guān)性的獨(dú)特碼,當(dāng)和本地碼完全同步時(shí)的相關(guān)峰最大,其他任何時(shí)候的相關(guān)峰很小
  • 關(guān)鍵字: 補(bǔ)碼配對(duì)相減匹配濾波法  相關(guān)峰  幀同步  
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幀同步介紹

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