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賽普拉斯PSoC4芯片揭秘:玩轉SAR ADC模塊

作者: 時間:2013-11-05 來源:網絡 收藏
ING-LEFT: 0px; PADDING-RIGHT: 0px; FONT: 14px/25px 宋體, arial; WHITE-SPACE: normal; ORPHANS: 2; LETTER-SPACING: normal; COLOR: rgb(0,0,0); WORD-SPACING: 0px; PADDING-TOP: 0px; -webkit-text-size-adjust: auto; -webkit-text-stroke-width: 0px">  與 Cypress前一代產品PSoC3/5相同,PSoC4仍然使用PSoC Creator作為集成開發(fā)環(huán)境。PSoC Creator將硬件資源抽象成了眾多的功能模塊(Component),每個模塊實現一種基本功能,例如PWM模塊,I2C模塊,基本與門,中斷響應模塊,輸入輸出管腳等等。設計者像繪制原理圖一樣,選擇適當模塊,將其輸入輸出與其他模塊連接,然后通過每個模塊提供的圖形化配置向導設置模塊參數,之后編寫適當的軟件代碼,即可實現所需功能。這種模塊化的設計方法令設計者能夠將更多精力集中在實現應用的功能上,而無需關注許多底層硬件配置細節(jié)。PSoC Creator的詳細使用手冊可以在Cypress網站上獲得。

  PSoC4

  與前幾代PSoC相比,PSoC4增強了的功能。在結構上,PSoC4采用了可獲得較高采樣速率的逐次逼近式(Successive Approximation Register,)ADC,能夠實現最高1Msps的單通道采樣。PSoC4包含一個核心,通過切換采樣通道,可以實現多路輸入信號的轉換。為了減少通道切換對CPU運行時間的占用,PSoC4集成了一個8通道采樣輸入多路器,提供采樣通道硬件切換,從而去掉了通道切換的軟件開銷。

  該多路器最多支持8路單端輸入,或者4路差分輸入,或者同時包含單端輸入和差分輸入。圖2中實例(a)~(c)分別實現了全單端輸入,全差分輸入,和單端/ 差分混合輸入,如果應用所需的輸入信號小于SAR的最大允許值,通過設置SAR的配置可以隱藏未使用的輸入通道,如實例(d)使用了兩個單端輸入通道,此時多路器僅自動切換兩個通道,忽略未使用的其余六個通道。

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  圖2:四個SAR設計實例 - 處理單端輸入與差分輸入

  PSoC4 SAR一次完整的單通道采樣包含兩個階段:信號獲?。ˋcquisition)和采樣轉換(Convertion)。在信號獲取階段,SAR獲得當前輸入通道的信號值,儲存在內部的采樣保持器中;在采樣轉換階段,SAR通過不斷改變參考電壓值,與采樣保持器中的信號值做比較,從而將信號值數字化,得到采樣結果。PSoC4 SAR的信號獲取時間可以由用戶設定,而采樣轉換時間與采樣結果位數相關,以1Msps采樣率為例,默認的信號獲取時間為222.2納秒,采樣轉換時間為 777.8納秒。

  PSoC4 SAR將這兩個階段設計成了流水線的結構,兩個階段之間可獨立運行。因而,對于多通道采樣,當前輸入通道進行采樣轉換時,多路器可以切換至下一路通道,從而提供一個額外時間對電路中的寄生電容充放電,保證SAR在進入信號獲取階段之前,輸入信號已經達到穩(wěn)定。圖3是一個3通道采樣的工作示意圖,從圖中可以看出,PSoC4 SAR在具有較高采樣速度的同時,仍有充足時間獲得穩(wěn)定的采樣信號。

  圖3:3通道SAR采樣工作示意圖

  圖3:3通道SAR采樣工作示意圖

  圖 3中還有兩個重要的脈沖信號:SDONE和EOC。SDONE用來指示信號獲取階段已完成,PSoC4 SAR的內部多路器就是由該信號觸發(fā)通道切換;EOC用來指示一次完整的多通道采樣已完成,因此在圖3中當最后一個通道轉換結束,該脈沖信號輸出。EOC 信號可以觸發(fā)一個中斷,用來讀取SAR的采樣數據,也可以用于觸發(fā)芯片內的其他資源。PSoC4 SAR為每一個通道都提供了一個16位的結果寄存器,可以在一次多通道采樣結束后,一次性讀取數據以減少中斷程序對CPU時間的占用。圖4給出了兩個實例的波形,均使用1Msps采樣率,一個是8通道輸入,一個4通道輸入。注意到圖3中兩個SDONE信號的間隔是一個完成的采樣周期,在圖4的例子中應為1 微秒,與波形測量值(period)一致。

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  圖4:SDONE和EOC示意圖 - 8路輸入和4路輸入,1Msps采樣率

  PSoC4 SAR A

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