soc 2 type ii 文章最新資訊

SoC設(shè)計(jì)：復(fù)雜性為驗(yàn)證提出更高要求

由于片上系統(tǒng)(SoC)設(shè)計(jì)變得越來越復(fù)雜，驗(yàn)證面臨著巨大的挑戰(zhàn)。大型團(tuán)隊(duì)不斷利用更多資源來尋求最高效的方法，從而將新的方法學(xué)與驗(yàn)證整合在一起，并最終將設(shè)計(jì)與驗(yàn)證整合在一起。雖然我們知道實(shí)現(xiàn)驗(yàn)證計(jì)劃幾乎占去了整個(gè)芯片設(shè)計(jì)工作的2/3，但是我們還是發(fā)現(xiàn)有團(tuán)隊(duì)遲交芯片，錯(cuò)過計(jì)劃的流片最終期限。這種疏忽可能造成嚴(yán)重的商業(yè)后果，因?yàn)檫@意味著硬件和軟件錯(cuò)誤經(jīng)常被遺漏，直到設(shè)計(jì)周期的晚期。為了創(chuàng)建一個(gè)全面的驗(yàn)證解決方案，我們首先必須認(rèn)識(shí)到設(shè)計(jì)工程師和驗(yàn)證工程師所面臨的分歧和挑戰(zhàn)。在這個(gè)過程中，我們發(fā)現(xiàn)某些
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基于RVM的層次化SoC芯片平臺(tái)的設(shè)計(jì)及應(yīng)用

本文介紹了Synopsys的RVM驗(yàn)證方法學(xué)，采用Vera硬件驗(yàn)證工具以及OpenVera驗(yàn)證語(yǔ)言建立目標(biāo)模型環(huán)境，自動(dòng)生成激勵(lì)，完成自核對(duì)測(cè)試、覆蓋率分析等工作。
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三種常用SoC片上總線的分析與比較

嵌入式系統(tǒng)是當(dāng)今計(jì)算機(jī)工業(yè)發(fā)展的一個(gè)熱點(diǎn)。隨著超大規(guī)模集成電路的迅速發(fā)展，半導(dǎo)體工業(yè)進(jìn)入深亞微米時(shí)代，器件特征尺寸越來越小，芯片規(guī)模越來越大，可以在單芯片上集成上百萬到數(shù)億只晶體管。如此密集的集成度使我們現(xiàn)在能夠在一小塊芯片上把以前由CPU和若干I/O接口等數(shù)塊芯片實(shí)現(xiàn)的功能集成起來，由單片集成電路構(gòu)成功能強(qiáng)大的、完整的系統(tǒng)，這就是我們通常所說的片上系統(tǒng)SoC（System on Chip）。由于功能完整，SoC逐漸成為嵌入式系統(tǒng)發(fā)展的主流。　　SoC相比板上系統(tǒng)，具有許
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基于模式的SoC設(shè)計(jì)方法研究

引　言　　SoC(system on chip) 是微電子技術(shù)發(fā)展的一個(gè)新的里程碑，SoC不再是一種功能單一的單元電路，而是將信號(hào)采集、處理和輸出等完整的系統(tǒng)集成在一起，成為一個(gè)有專用目的的電子系統(tǒng)單片。其設(shè)計(jì)思想也有別于IC，在一個(gè)或若干個(gè)單片上完成整個(gè)系統(tǒng)的功能。　　SoC開發(fā)和設(shè)計(jì)存在一些問題，如描述語(yǔ)言不統(tǒng)一、抽象層次低、仿真速度慢、可重用性差、設(shè)計(jì)性能無法保障、RTL級(jí)發(fā)現(xiàn)的問題需要重新進(jìn)行整個(gè)的設(shè)計(jì)流程才能解決，因此SoC的建模與設(shè)計(jì)的方法成為當(dāng)前刻不容緩的課題。上述種種問題與曾經(jīng)困
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基于FPGA的步進(jìn)電機(jī)正弦波細(xì)分驅(qū)動(dòng)器設(shè)計(jì)

摘要：本設(shè)計(jì)應(yīng)用Altera 公司的Cyclone II系列的FPGA（現(xiàn)場(chǎng)可編程門陣列）實(shí)現(xiàn)了對(duì)步進(jìn)電機(jī)正弦波可變細(xì)分控制，并在FPGA中進(jìn)行了具體驗(yàn)證和實(shí)現(xiàn)。該方案綜合運(yùn)用了電流跟蹤型SPWM技術(shù)、PI調(diào)節(jié)、片上可編程系統(tǒng)SOPC技術(shù)、EDA技術(shù)等。步進(jìn)電機(jī)控制系統(tǒng)用FPGA實(shí)現(xiàn)了Nios II軟核處理器與硬件邏輯電路集于一體，發(fā)揮了處理器的靈活性和數(shù)字邏輯電路高速性，有效地解決了步距角的高細(xì)分問題，細(xì)分?jǐn)?shù)最高達(dá)4096，而且細(xì)分?jǐn)?shù)可自動(dòng)調(diào)節(jié)。實(shí)驗(yàn)
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基于雙Nios II的紅外圖像實(shí)時(shí)Otsu局部遞歸分割算法設(shè)計(jì)

摘要：針對(duì)傳統(tǒng)Otsu局部遞歸分割方法很難實(shí)時(shí)實(shí)現(xiàn)的局限性，提出了一種適合現(xiàn)場(chǎng)可編程門陣列(FPGA)中Nios II軟核處理器實(shí)現(xiàn)的快速Otsu局部遞歸分割算法，該算法的思路是把一次Otsu分割得到的目標(biāo)區(qū)域作為新的圖像再進(jìn)行一次Otsu分割，得到的結(jié)果作為最終分割閾值．利用并行Nios II和VHDL實(shí)現(xiàn)的硬件加速邏輯協(xié)同設(shè)計(jì)保證算法的實(shí)時(shí)實(shí)現(xiàn)。實(shí)驗(yàn)結(jié)果表明，在不同的背景下，利用本文設(shè)計(jì)能夠?qū)崟r(shí)穩(wěn)定地對(duì)目標(biāo)分割提取，具有較好的魯棒性。關(guān)鍵字：FPGA&nb
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μC/OS-II下通用驅(qū)動(dòng)框架的設(shè)計(jì)與實(shí)現(xiàn)

μC/OS-II下通用驅(qū)動(dòng)框架的設(shè)計(jì)與實(shí)現(xiàn),在μC/OS-II下，設(shè)計(jì)了一個(gè)通用的設(shè)備管理模型，稱為通用驅(qū)動(dòng)框架，通過該驅(qū)動(dòng)框架，可以實(shí)現(xiàn)對(duì)硬件設(shè)備的統(tǒng)一、一致的管理，同時(shí)，也為上層應(yīng)用程序提供了統(tǒng)一、一致的設(shè)備訪問接口，并在以ARM7TDMI-S為核心的LPC2210微控制器開發(fā)板上給出了一例實(shí)現(xiàn)。
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擴(kuò)大ARM SoC的驗(yàn)證覆蓋縮短仿真時(shí)間

驗(yàn)證復(fù)雜的SoC設(shè)計(jì)要耗費(fèi)極大的成本和時(shí)間。據(jù)證實(shí)，驗(yàn)證一個(gè)設(shè)計(jì)所需的時(shí)間會(huì)隨著設(shè)計(jì)大小的增加而成倍增加。在過去的幾年中，出現(xiàn)了很多的技術(shù)和工具，使驗(yàn)證工程師可以用它們來處理這類問題。但是，這些技術(shù)中很多基于動(dòng)態(tài)仿真，并依靠電路操作來發(fā)現(xiàn)設(shè)計(jì)問題，因此設(shè)計(jì)者仍面臨為設(shè)計(jì)創(chuàng)建激勵(lì)的問題。　　設(shè)計(jì)者可以使用運(yùn)行在處理器上的固件作為驗(yàn)證仿真激勵(lì)的一部分，這也是目前通常采用的方法----使用全功能處理器模型。與在HDL中編寫激勵(lì)相比，固件作為激勵(lì)速度更快，并且更容易創(chuàng)建
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如何利用嵌入式軟件設(shè)計(jì)SoC

美國(guó)Globalpress公司舉辦的2007電子高峰會(huì)議上，舉辦了一場(chǎng)SoC(系統(tǒng)芯片)的專題討論會(huì)：設(shè)計(jì)師如何利用嵌入式軟件作為SoC器件設(shè)計(jì)的關(guān)鍵。會(huì)議上的專家各抒己見?！　⊥暾桨副葐蝹€(gè)硬件重要主持人: Gartner公司的高級(jí)分析師John Barber軟件在嵌入式產(chǎn)品中的份量越來越重。自2000年來，價(jià)值觀念發(fā)生了巨大的變化，2000年以前，主張是器件，即讓我們的器件與競(jìng)爭(zhēng)對(duì)手的性能、品質(zhì)進(jìn)行對(duì)比具有優(yōu)勢(shì)，這就是那時(shí)形成鮮明特色的關(guān)鍵?，F(xiàn)今，制造商和客戶需要的是解決方案，而不僅僅是器件。我的價(jià)值
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基于RVM的層次化SoC芯片驗(yàn)證平臺(tái)設(shè)計(jì)及應(yīng)用

本文以SIM卡控制模塊的功能驗(yàn)證為例，介紹了運(yùn)用Synopsys Vera驗(yàn)證工具以及RVM驗(yàn)證方法學(xué)快速高效地搭建高質(zhì)量驗(yàn)證平臺(tái)的方法。文中詳細(xì)介紹了RVM驗(yàn)證方法學(xué)以及RVM驗(yàn)證平臺(tái)的結(jié)構(gòu)。
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Nios SoC系統(tǒng)中的BCH編解碼IP核的設(shè)計(jì)

引言　　循環(huán)碼是最重要的一類線性分組糾錯(cuò)碼，而BCH碼又是目前發(fā)現(xiàn)的性能很好且應(yīng)用廣泛的循環(huán)碼，它具有嚴(yán)格的代數(shù)理論，對(duì)它的理論研究也非常透徹。BCH碼的實(shí)現(xiàn)途徑有軟件和硬件兩種。軟件實(shí)現(xiàn)方法靈活性強(qiáng)且較易實(shí)現(xiàn)，但硬件實(shí)現(xiàn)方法的工作速度快，在高數(shù)據(jù)速率和長(zhǎng)幀應(yīng)用場(chǎng)合時(shí)具有優(yōu)勢(shì)。FPGA(現(xiàn)場(chǎng)可編程門陣列)為DSP算法的硬件實(shí)現(xiàn)提供了很好的平臺(tái)，但如果單獨(dú)使用一片F(xiàn)PGA實(shí)現(xiàn)BCH編解碼，對(duì)成本、功耗和交互速度都不利。最新的SoC(片上系統(tǒng))設(shè)計(jì)方法可以很好地解決這個(gè)問題。
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Stratix II FPGA系統(tǒng)電源設(shè)計(jì)

基于MAX1951的諸多特點(diǎn)，本文給出了采用該器件為Stratix II FPGA系統(tǒng)供電以降低其功耗的設(shè)計(jì)方案。
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基于μC／OS-II嵌入式系統(tǒng)的低功耗開發(fā)

　　隨著嵌入式系統(tǒng)應(yīng)用的日益廣泛，如何實(shí)現(xiàn)嵌入式系統(tǒng)的低功耗開發(fā)已經(jīng)成為嵌入式應(yīng)用發(fā)展的關(guān)鍵技術(shù)之一，是近幾年來人們?cè)谇度胧较到y(tǒng)的設(shè)計(jì)中普遍關(guān)注的難點(diǎn)與熱點(diǎn)。嵌入式系統(tǒng)正被廣泛應(yīng)用于移動(dòng)性較強(qiáng)的產(chǎn)品中去，而這些產(chǎn)品不是一直有充足的電源供應(yīng)，往往需要電池來供電，因此，設(shè)計(jì)人員需要從每一個(gè)細(xì)節(jié)來考慮降低系統(tǒng)的功率消耗，從各個(gè)方面去實(shí)現(xiàn)降低系統(tǒng)的功耗。同時(shí)功耗對(duì)終端設(shè)備的成本及體積大小有顯著影響。　　本文結(jié)合FM電臺(tái)手持式測(cè)試儀這一實(shí)例，從系統(tǒng)硬件設(shè)計(jì)、系統(tǒng)軟件設(shè)計(jì)、利用內(nèi)核擴(kuò)展接口和產(chǎn)品應(yīng)用特點(diǎn)這四個(gè)方
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“首個(gè)”無線傳感器網(wǎng)絡(luò)SoC問世

Dust Networks公司在Electronica大會(huì)上發(fā)布了世上首個(gè)無線傳感器網(wǎng)絡(luò)系統(tǒng)級(jí)芯片(SoC)。Dust Networks在這張名為“智能塵?！钡男酒霞闪藰?gòu)建分配式傳感器網(wǎng)絡(luò)所需的所有硬件和軟件功能，并表示它的功耗比Zigbee要低5倍，使系統(tǒng)不再需要路由器，而且使在現(xiàn)有網(wǎng)絡(luò)上添加新傳感器的總成本降低了10倍。 Dust Networks公司創(chuàng)始人之一，電氣工程師Rob Conant說：“我們的ASIC的功耗比使用802.15.4無線電
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Bluesocket借助Wind River Linux平臺(tái)加快產(chǎn)品上市速度

全球領(lǐng)先的設(shè)備軟件優(yōu)化（DSO）廠商風(fēng)河系統(tǒng)公司日前宣布，Bluesocket通過采用Wind River Platform for Network Equipment, Linux Edition，顯著加快了產(chǎn)品上市速度，并且能夠更專注于其核心競(jìng)爭(zhēng)力的提高。Wind River Platform for Network Equipment, Linux Editio
關(guān)鍵字： Bluesocket Linux River Wind 單片機(jī) 嵌入式系統(tǒng) SoC ASIC