siemens eda 文章進(jìn)入siemens eda技術(shù)社區(qū)

中科院：EDA驗(yàn)證評(píng)測(cè)技術(shù)

針對(duì)國(guó)產(chǎn)EDA工具應(yīng)用推廣的平臺(tái)化共性技術(shù)問題，研究基于國(guó)產(chǎn)EDA工具先進(jìn)工藝設(shè)計(jì)參考流程，以及關(guān)鍵EDA工具的評(píng)測(cè)技術(shù)，包括EDA工具的功能對(duì)比、性能測(cè)試、可兼容性、穩(wěn)定性、易用性等的測(cè)試驗(yàn)證，形成規(guī)范的EDA工具評(píng)測(cè)報(bào)告，以此促進(jìn)國(guó)產(chǎn)EDA 工具的改進(jìn)、更新和完善，并指導(dǎo)設(shè)計(jì)企業(yè)選用合適的EDA工具完成芯片設(shè)計(jì)。該研究?jī)?nèi)容獲得北京市科技計(jì)劃項(xiàng)目“國(guó)產(chǎn)EDA工具產(chǎn)業(yè)鏈應(yīng)用推廣示范平臺(tái)”項(xiàng)目的支持?；谌ㄖ圃O(shè)計(jì)流程的EDA評(píng)測(cè)技術(shù)：針對(duì)納米工藝全定制設(shè)計(jì)流程的系列EDA工具開展EDA評(píng)測(cè)技術(shù)研
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中科院：物聯(lián)網(wǎng)新型體系結(jié)構(gòu)

基于新型非易失存儲(chǔ)的高能效終端架構(gòu)技術(shù)：為解決資源受限物聯(lián)網(wǎng)終端的“存儲(chǔ)墻”問題，利用MRAM、PCM等新型存儲(chǔ)器，構(gòu)建異構(gòu)非揮發(fā)存儲(chǔ)架構(gòu)。通過研究軟、硬件協(xié)同的異構(gòu)存儲(chǔ)架構(gòu)管理技術(shù)，達(dá)到降低內(nèi)存功耗、減小I/O延時(shí)的目的。此項(xiàng)工作得到國(guó)家重點(diǎn)研發(fā)計(jì)劃、北京市科技計(jì)劃、中科院先導(dǎo)專項(xiàng)的支持。AI計(jì)算加速技術(shù)：GPU、ASIC、FPGA等AI加速器是實(shí)現(xiàn)高能效AI計(jì)算的重要手段，然而受限于移動(dòng)計(jì)算環(huán)境對(duì)芯片面積、功耗等的要求，AI加速芯片片上緩存容量有限，當(dāng)計(jì)算深度模型時(shí)需要頻繁訪問片外存儲(chǔ)，因此“內(nèi)存墻”
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中科院：硅集成驗(yàn)證技術(shù)

EDA中心硅集成驗(yàn)證技術(shù)，聚焦于利用EDA技術(shù)及設(shè)計(jì)、工藝、封測(cè)技術(shù)，實(shí)現(xiàn)多環(huán)節(jié)集成、交叉技術(shù)集成，解決高品質(zhì)、高精度、新工程技術(shù)的難題。尤其在硅基芯片+光、+生物、+MEMS等跨學(xué)科創(chuàng)新領(lǐng)域，形成了獨(dú)特的解決方案，并成功實(shí)現(xiàn)芯片功能驗(yàn)證?！?nbsp;設(shè)計(jì)與工藝集成 ★&nb
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中科院：EDA軟件與先進(jìn)算力平臺(tái)服務(wù)技術(shù)

研發(fā)基于Web的EDA工具授權(quán)管理技術(shù)、安全可靠的網(wǎng)絡(luò)架構(gòu)及VPN解決方案，構(gòu)建EDA軟件管理系統(tǒng)，實(shí)現(xiàn)license的分時(shí)復(fù)用策略，解決昂貴EDA工具靈活授權(quán)問題。該系統(tǒng)支持EDA工具授權(quán)的全信息化管理模式，可實(shí)現(xiàn)License授權(quán)管理及分析服務(wù)，幫助用戶優(yōu)化EDA軟件采購方案，降低用戶軟件成本。研究EDA資源的平臺(tái)化技術(shù)與智能EDA計(jì)算技術(shù)，構(gòu)建集成電路高性能EDA平臺(tái)，實(shí)現(xiàn)SaaS化的EDA應(yīng)用創(chuàng)新服務(wù)模式，平臺(tái)提供從EDA工具授權(quán)、IP庫選擇、項(xiàng)目管理到高性能計(jì)算支撐等完整的云端芯片設(shè)計(jì)解決方案，
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中科院微電子研究所EDA中心研究方向匯總

納米芯片可制造性設(shè)計(jì)(DFM)技術(shù)：已形成Art-DFMx工具套件，支持65nm-28nm-14nm-7nm的版圖可制造性設(shè)計(jì)分析，用于面向良率提升和性能提升的版圖優(yōu)化，先進(jìn)工藝CMP工藝后芯片形貌預(yù)測(cè)；提出了多物理機(jī)理耦合建模、基于LDE的有效平坦化長(zhǎng)度特征提取、多粒度算法并行技術(shù)。部分成果被行業(yè)龍頭企業(yè)應(yīng)用。獲國(guó)家科技重大專項(xiàng)支持。極低功耗設(shè)計(jì)：研發(fā)了多款性能指標(biāo)優(yōu)于公開文獻(xiàn)報(bào)道的亞閾值極低功耗IP以及用于底層低功耗電路優(yōu)化的電路結(jié)構(gòu)-器件尺寸-版圖優(yōu)化工具；研發(fā)亞閾值電路特征化、統(tǒng)計(jì)延時(shí)建模、統(tǒng)計(jì)時(shí)
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中科院微電子所EDA中心參加國(guó)家重點(diǎn)研發(fā)計(jì)劃“高性能計(jì)算”重點(diǎn)專項(xiàng)2020年度匯報(bào)評(píng)估交流會(huì)

　2020年12月15日至16日，國(guó)家重點(diǎn)研發(fā)計(jì)劃“高性能計(jì)算”重點(diǎn)專項(xiàng)2018年度匯報(bào)評(píng)估交流會(huì)在北京召開，本次交流會(huì)由科技部高技術(shù)中心發(fā)起，2017年立項(xiàng)項(xiàng)目“面向高性能計(jì)算環(huán)境的集成電路設(shè)計(jì)自動(dòng)化業(yè)務(wù)平臺(tái)”的6名項(xiàng)目成員參加了會(huì)議?！　?huì)上，項(xiàng)目負(fù)責(zé)人陳嵐研究員重點(diǎn)匯報(bào)了項(xiàng)目的考核指標(biāo)完成情況、關(guān)鍵技術(shù)和創(chuàng)新點(diǎn)、組織宣傳成果以及后續(xù)的工作計(jì)劃。項(xiàng)目立項(xiàng)至今，構(gòu)建了面向EDA行業(yè)的高性能計(jì)算平臺(tái)，能夠提供從EDA工具授權(quán)、IP庫選擇、項(xiàng)目管理到計(jì)算資源智能調(diào)度等完整的云端芯片設(shè)計(jì)解決方案，全方位助力設(shè)
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2021集成電路設(shè)計(jì)自動(dòng)化前沿技術(shù)研討會(huì)圓滿召開

2021年6月1日，2021集成電路設(shè)計(jì)自動(dòng)化前沿技術(shù)研討會(huì)在北京國(guó)際會(huì)議中心成功舉辦，會(huì)議由中國(guó)科學(xué)院微電子研究所主辦，中國(guó)科學(xué)院微電子研究所EDA中心（三維及納米集成電路設(shè)計(jì)自動(dòng)化技術(shù)北京市重點(diǎn)實(shí)驗(yàn)室）承辦。國(guó)家02專項(xiàng)專家組總體組組長(zhǎng)葉甜春、中科院微電子研究所黨委書記戴博偉、華大九天董事長(zhǎng)劉偉平、概倫電子董事長(zhǎng)劉志宏、以及來自清華大學(xué)、北京大學(xué)、中科院計(jì)算所、中科院上海微系統(tǒng)所、鴻芯微納、芯華章、新思科技、全芯智造等50余家單位的150余名專家學(xué)者出席了會(huì)議，會(huì)議由中國(guó)科學(xué)院微電子研究所EDA中心主
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國(guó)家重點(diǎn)研發(fā)計(jì)劃“基于高性能計(jì)算的集成電路電子設(shè)計(jì)自動(dòng)化（EDA）平臺(tái)”項(xiàng)目順利通過綜合績(jī)效評(píng)價(jià)

2022年3月10日，由中科院微電子所EDA中心陳嵐研究員牽頭承擔(dān)的國(guó)家重點(diǎn)研發(fā)計(jì)劃“高性能計(jì)算”重點(diǎn)專項(xiàng)“基于高性能計(jì)算的集成電路電子設(shè)計(jì)自動(dòng)化（EDA）平臺(tái)”項(xiàng)目在北京順利通過項(xiàng)目綜合績(jī)效評(píng)價(jià)。本次會(huì)議由科技部高技術(shù)中心“高性能計(jì)算”重點(diǎn)專項(xiàng)組織，以“線上+線下”的形式召開，科技部高技術(shù)中心領(lǐng)導(dǎo)、項(xiàng)目綜合績(jī)效評(píng)價(jià)技術(shù)和財(cái)務(wù)專家組、項(xiàng)目承擔(dān)單位代表及科研骨干共37人參加了會(huì)議。由錢德沛院士組成的綜合績(jī)效評(píng)價(jià)專家組聽取了項(xiàng)目負(fù)責(zé)
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中國(guó) EDA 產(chǎn)業(yè)回顧：自研“熊貓系統(tǒng)”曇花一現(xiàn)，后錯(cuò)失 15 年，最終走上崛起之路

EDA 工具素有“芯片之母”的美譽(yù)，是芯片制造最上游的產(chǎn)業(yè)，是銜接集成電路設(shè)計(jì)、制造和封測(cè)的關(guān)鍵紐帶，對(duì)行業(yè)生產(chǎn)效率、產(chǎn)品技術(shù)水平都有重要影響。近年來，國(guó)產(chǎn) EDA 產(chǎn)業(yè)受到國(guó)家高度重視，且涌現(xiàn)出了大量的 EDA 公司。而事實(shí)上，早在上世紀(jì) 80 年代，中國(guó) EDA 產(chǎn)業(yè)也曾有過短暫的輝煌，但可惜，有如曇花一現(xiàn)，輝煌很快就沉寂下去，并長(zhǎng)達(dá) 15 年之久，這段歷史有著怎樣的“隱情”？國(guó)產(chǎn) EDA 產(chǎn)業(yè)的轉(zhuǎn)折點(diǎn)又是從何時(shí)到來？本期我們讓我們一起走進(jìn) EDA 的發(fā)展史。中國(guó) EDA 產(chǎn)業(yè)失去的 15 年（199
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Ansys成為英特爾晶圓代工服務(wù)生態(tài)系聯(lián)盟創(chuàng)始成員

Ansys宣布成為英特爾晶圓代工服務(wù)（Intel Foundry Services；IFS）加速計(jì)劃 – EDA聯(lián)盟（IFS Accelerator – EDA Alliance）的創(chuàng)始伙伴之一，將提供同級(jí)最佳的EDA工具和模擬解決方案，支持客戶創(chuàng)新，包括用于3D-IC設(shè)計(jì)的訂制芯片。 Ansys RedHawk-SC電源完整性模擬結(jié)果將用于驗(yàn)證單芯片與多芯片3D-IC系統(tǒng)透過運(yùn)用Ansys領(lǐng)導(dǎo)市場(chǎng)的多物理場(chǎng)解決方案，IFS加速計(jì)劃將為客戶提供硅科技，幫助其設(shè)計(jì)獨(dú)特創(chuàng)新的芯片。Ansys的頂尖E
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Google Cloud C2D采用AMD EPYC處理器提升EDA與CFD效能

AMD宣布AMD EPYC處理器，將為Google Cloud全新C2D虛擬機(jī)挹注動(dòng)能，在電子設(shè)計(jì)自動(dòng)化（EDA）與計(jì)算流體力學(xué)（CFD）等領(lǐng)域的高效能運(yùn)算（HPC）內(nèi)存密集型（memory-bound）工作負(fù)載，為客戶帶來強(qiáng)大的效能及運(yùn)算能力。C2D延續(xù)AMD EPYC處理器的發(fā)展動(dòng)能，加入T2D和N2D實(shí)例的行列，成為Google Cloud第3個(gè)搭載AMD第3代EPYC處理器的實(shí)例。憑借AMD EPYC處理器和其高核心密度，C2D虛擬機(jī)將成為Google Cloud運(yùn)算優(yōu)化型實(shí)例中，擁有最大容量的虛
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芯華章發(fā)布多款新產(chǎn)品，打造全面數(shù)字驗(yàn)證解決方案

近期，EDA（集成電路設(shè)計(jì)工具）智能軟件和系統(tǒng)領(lǐng)先企業(yè)芯華章正式發(fā)布四款擁有自主知識(shí)產(chǎn)權(quán)的數(shù)字驗(yàn)證EDA產(chǎn)品，以及統(tǒng)一底層框架的智V驗(yàn)證平臺(tái)，在實(shí)現(xiàn)多工具協(xié)同、降低EDA使用門檻的同時(shí)，提高芯片整體驗(yàn)證效率，是中國(guó)自主研發(fā)集成電路產(chǎn)業(yè)生態(tài)的重要里程碑。EDA作為數(shù)字化產(chǎn)業(yè)的底層關(guān)鍵技術(shù)，自始至終連接并貫穿了芯片與科技應(yīng)用的發(fā)展。未來的數(shù)字化系統(tǒng)，將是系統(tǒng)+芯片+算法+軟件深度融合集成的。芯華章在這一變局下，以面向未來發(fā)展、面向數(shù)字化系統(tǒng)的智能化設(shè)計(jì)流程為目標(biāo)，融合人工智能、云原生等技術(shù)，對(duì)EDA軟硬件底層
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芯華章宣布朱洪辰出任副總裁，強(qiáng)化技術(shù)解決方案的開發(fā)與部署

11月17日，芯華章科技股份有限公司宣布朱洪辰（Joyee Zhu）于2021年11月2日加盟芯華章，出任芯華章科技驗(yàn)證工程副總裁一職。他將專注為客戶項(xiàng)目需求，提供系統(tǒng)驗(yàn)證領(lǐng)域的專業(yè)技術(shù)解決方案，并加速芯華章產(chǎn)品升級(jí)迭代導(dǎo)入前沿市場(chǎng)需求的開發(fā)與部署。Joyee Zhu芯華章科技驗(yàn)證工程副總裁朱洪辰擁有20余年的EDA技術(shù)與產(chǎn)品研發(fā)經(jīng)驗(yàn)，是高速高容量FPGA、ASIC設(shè)計(jì)和驗(yàn)證工作領(lǐng)域的專家，在OVM、UVM，硬件加速器（accelerator/emulator）和軟硬件協(xié)同驗(yàn)證技術(shù)等方面都有深厚造詣。同時(shí)
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本土EDA芯和半導(dǎo)體擁抱異構(gòu)集成的新機(jī)遇

國(guó)內(nèi)EDA、濾波器行業(yè)的領(lǐng)軍企業(yè)芯和半導(dǎo)體，近日在上海成功舉辦了其2021年全國(guó)用戶大會(huì)。這場(chǎng)由上海市集成電路行業(yè)協(xié)會(huì)，上海集成電路技術(shù)與產(chǎn)業(yè)促進(jìn)中心聯(lián)合協(xié)辦的大會(huì)，集結(jié)了芯和半導(dǎo)體及其生態(tài)系統(tǒng)中的眾多合作伙伴：中興通訊、紫光展銳、新思科技、羅德與施瓦茨、微軟Azure、概倫電子等企業(yè)高層及專家，以“擁抱異構(gòu)集成的新機(jī)遇”為主題，向超過兩百名到場(chǎng)的業(yè)內(nèi)同仁分享了異構(gòu)集成時(shí)代半導(dǎo)體行業(yè)在EDA、設(shè)計(jì)、制造、封測(cè)以及云平臺(tái)等產(chǎn)業(yè)鏈上下游環(huán)節(jié)的現(xiàn)狀和趨勢(shì)。出席本次大會(huì)的領(lǐng)導(dǎo)有上海市經(jīng)濟(jì)和信息化委員會(huì)副主任傅新
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當(dāng)人工智能遇到EDA，Cadence Cerebrus以機(jī)器學(xué)習(xí)提升EDA設(shè)計(jì)效能

隨著算力的不斷提升，人工智能的應(yīng)用逐漸滲透到各個(gè)行業(yè)。作為人工智能芯片最關(guān)鍵的開發(fā)工具EDA，是否也會(huì)得到人工智能應(yīng)用的助力從而更好地提升服務(wù)效率呢？答案自然是肯定的。隨著半導(dǎo)體芯片設(shè)計(jì)的復(fù)雜度不斷提升，以及芯片包含功能的日漸廣泛，EDA的設(shè)計(jì)過程越來越需要借助人工智能來盡可能避免一些常見的設(shè)計(jì)誤區(qū)，并借助大數(shù)據(jù)的優(yōu)勢(shì)來實(shí)現(xiàn)局部電路設(shè)計(jì)的最優(yōu)化。在可以預(yù)見的未來，隨著人工智能技術(shù)的不斷引入，借助大數(shù)據(jù)和機(jī)器學(xué)習(xí)的優(yōu)勢(shì)，EDA軟件將可以提供更高效更強(qiáng)大的設(shè)計(jì)輔助功能。近日，楷登電子（Cadenc
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