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基于Nios的溫備份智能容錯(cuò)系統(tǒng)的設(shè)計(jì)

  • 　本文提出的軟硬件設(shè)計(jì)思想經(jīng)實(shí)踐證明是可行的，并且在實(shí)際的系統(tǒng)中工作良好。該思想可以進(jìn)一步推廣到多機(jī)容錯(cuò)系統(tǒng)中。在多機(jī)系統(tǒng)中，我們?cè)诙ㄖ坪酶髋_(tái)機(jī)器的工作計(jì)劃后，就可以利用本文提到的給每臺(tái)服務(wù)器一個(gè)計(jì)劃運(yùn)行時(shí)間這一思想來(lái)解決實(shí)際問(wèn)題。另外，使用Nios軟核處理器，可以定制很多的UART口，這一點(diǎn)就遠(yuǎn)遠(yuǎn)優(yōu)于需要擴(kuò)展串口電路的普通單片機(jī)，從而在硬件設(shè)計(jì)和軟件設(shè)計(jì)上大大降低了難度。
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基于FPGA-NIOS的多功能留言機(jī)設(shè)計(jì)

  • 摘要：隨著科技的進(jìn)步，人們生活中對(duì)于聯(lián)絡(luò)的需求越來(lái)越高，而傳統(tǒng)基于電話的留言機(jī)在沒(méi)有手機(jī)或電話的情況下具有諸多不便。針對(duì)上述需求，設(shè)計(jì)了一款應(yīng)用于家庭用戶中的多功能留言機(jī)?？紤]到FPGA的諸多特點(diǎn)，采用可
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基于Nios II的過(guò)程控制實(shí)驗(yàn)裝置研究

  • 基于Nios II的過(guò)程控制實(shí)驗(yàn)裝置研究,利用SOPC強(qiáng)大的IP核和容易配置的優(yōu)勢(shì)簡(jiǎn)化設(shè)計(jì)流程。充分發(fā)揮NiosⅡ強(qiáng)大的并行處理能力。該系統(tǒng)主要涉及多個(gè)下位機(jī)與FPGA的通信問(wèn)題。　　1. 功能描述　　1.1 整體設(shè)計(jì)思路　　利用SOPC強(qiáng)大的IP核和容易配置的優(yōu)勢(shì)簡(jiǎn)化
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基于Nios II的UART與PC間的數(shù)據(jù)通信

  • 基于Nios II的UART與PC間的數(shù)據(jù)通信,Nios II系列嵌入式處理器使用32位的指令集結(jié)構(gòu)ISA，完全與二進(jìn)制代碼兼容，它是Altera公司的第二代軟核嵌入式處理器，性能超過(guò)200DMIPS。允許設(shè)計(jì)者在很短的時(shí)間內(nèi)構(gòu)建一個(gè)完整的可編程芯片系統(tǒng)，風(fēng)險(xiǎn)和成本比中小規(guī)
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基于NIOS II的多串口數(shù)據(jù)通信的實(shí)現(xiàn)

  • 串口傳輸常用于基于FPGA和DSP結(jié)構(gòu)的信號(hào)處理板和外部設(shè)備之間的數(shù)據(jù)交換。以GPS RTK定位應(yīng)用為基礎(chǔ)，針對(duì)單個(gè)串口全雙工傳輸不足以應(yīng)對(duì)多種數(shù)據(jù)類型同時(shí)輸入輸出的情形，設(shè)計(jì)并實(shí)現(xiàn)了一種面向多串口不同類型數(shù)據(jù)的傳輸方案。該方案通過(guò)增加串口控制寄存器實(shí)現(xiàn)單個(gè)中斷信號(hào)即可控制所有串口，采用乒乓交替讀寫(xiě)實(shí)現(xiàn)數(shù)據(jù)持續(xù)高速輸入。測(cè)試表明該方案可獨(dú)立對(duì)各串口進(jìn)行配置，可同時(shí)實(shí)現(xiàn)GPS定位結(jié)果、差分GPS修正數(shù)據(jù)與外界的交換以及用戶控制命令的輸入，并且可減少硬件調(diào)試時(shí)間，節(jié)約硬件資源。
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基于Nios II的語(yǔ)音加密傳輸系統(tǒng)設(shè)計(jì)

  • 　摘 要： 設(shè)計(jì)并實(shí)現(xiàn)了一個(gè)基于Nios II的語(yǔ)音加密傳輸系統(tǒng)。介紹了進(jìn)行語(yǔ)音信號(hào)處理的功能模塊，包括語(yǔ)音采集回放模塊、基于G.729A的語(yǔ)音壓縮與解壓縮模塊和基于AES的數(shù)據(jù)加解密模塊。在控制模塊的協(xié)調(diào)下，使得語(yǔ)音
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基于Nios的FFT算法軟硬件協(xié)同設(shè)計(jì)

  • 摘要：在深入研究Nios自定制指令的軟硬件接口的基礎(chǔ)上，利用 Matlab／DSP Builder建立快速傅里葉變換FFT核心運(yùn)算指令基本模型，然后用Altera公司提供的Singacompiler工具對(duì)其進(jìn)行編譯，產(chǎn)生 QuartusⅡ能夠識(shí)別的VHDL
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μC／GUI在Nios II嵌入式平臺(tái)上的移植研究

  • 摘要：為了使便攜式心電監(jiān)護(hù)儀具有友好的人機(jī)交互和方便的顯示，移植了一個(gè)GUI界面系統(tǒng)。以DE2-70配套開(kāi)發(fā)板為驗(yàn)證平 臺(tái)，TFTLCD IP核是在QuartusⅡ9．0軟件平臺(tái)下，使用Verilog在FPGA上用硬件邏輯電路進(jìn)行設(shè)計(jì)。該
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一種基于SoPC的低應(yīng)變反射波檢測(cè)系統(tǒng)

  • 信息化、自動(dòng)化、智能化、高集成度已經(jīng)成為當(dāng)今工程技術(shù)領(lǐng)域的發(fā)展趨勢(shì)，并廣泛應(yīng)用于各個(gè)領(lǐng)域。可編程片...
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基于NIOSⅡ的LCD控制器和矩陣鍵盤(pán)的IP核的設(shè)計(jì)方法

  • 基于NIOSⅡ的LCD控制器和矩陣鍵盤(pán)的IP核的設(shè)計(jì)方法,　　0 引言　　NIOSⅡ是Altera公司推出的第二代IP軟核處理器。它與其他IP核可構(gòu)成SOPC系統(tǒng)的主要部分。Altera SOPC Builder提供有NiosⅡ處理器及一些常用外設(shè)接口，因此，對(duì)于一些庫(kù)中沒(méi)有提供的模塊，用戶就可以自己
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基于NiosⅡ處理器的總線架構(gòu)的SD卡設(shè)計(jì)

  • 基于NiosⅡ處理器的總線架構(gòu)的SD卡設(shè)計(jì),SD存儲(chǔ)卡以其大容量和小尺寸的特點(diǎn)，成為市面上各種嵌入式消費(fèi)產(chǎn)品最常見(jiàn)的存儲(chǔ)媒介，探討SD卡設(shè)備的設(shè)計(jì)具有廣泛的應(yīng)用價(jià)值。這里將結(jié)合NiosⅡ處理器的總線架構(gòu)，分析SD卡的接口協(xié)議和驅(qū)動(dòng)程序設(shè)計(jì)方法，并給出SD卡
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基于NIOSⅡ的矩陣鍵盤(pán)和液晶顯示外設(shè)組件的設(shè)計(jì)

  • 摘要：給出了利用SOPC Builder中元件編輯器Create New Component并通過(guò)自定義邏輯方法在SOPC設(shè)計(jì)中添加自己開(kāi)發(fā)的矩陣鍵盤(pán)和液晶顯示模塊IP核，同時(shí)將其集成到系統(tǒng)的實(shí)現(xiàn)方案。該方案可實(shí)現(xiàn)嵌入式NiosⅡ軟核處理器與
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基于Nios II的多功能數(shù)碼相框設(shè)計(jì)

  • 采用基于NiosⅡ軟核處理器的SOPC技術(shù)實(shí)現(xiàn)了多功能數(shù)碼相框的設(shè)計(jì)，充分利用了NiosⅡ軟核的特性，在SOPC Builder中搭建系統(tǒng)硬件模塊，通過(guò)SOPC Builder將各個(gè)功能模塊集成到一個(gè)系統(tǒng)中，并且結(jié)合嵌入式操作系統(tǒng)μC／OS-Ⅱ來(lái)完成調(diào)度各功能模塊的任務(wù)。實(shí)驗(yàn)證明，SOPC技術(shù)應(yīng)用使系統(tǒng)集成度大大提高，功耗大幅下降，穩(wěn)定性也有一定提升，并且成本不高，具有廣泛的應(yīng)用前景。
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Nios軟核在CT機(jī)掃描系統(tǒng)控制器設(shè)計(jì)中的應(yīng)用

  • Nios軟核在CT機(jī)掃描系統(tǒng)控制器設(shè)計(jì)中的應(yīng)用,1 引言近年來(lái)，可編程邏輯器件的發(fā)展，使得SOPC (System On A Programmable Chip，可編程片上系統(tǒng))成為可能, 即在一塊可編程芯片上實(shí)現(xiàn)整個(gè)系統(tǒng)。Nios是Altera公司研發(fā)的可用于SOPC設(shè)計(jì)的處理器軟核?；贜ios軟核的
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基于NiosⅡ的SD卡驅(qū)動(dòng)程序開(kāi)發(fā)

  • 基于NiosⅡ的SD卡驅(qū)動(dòng)程序開(kāi)發(fā),摘要：提出一種在FPGA NiosⅡ軟核處理器下SD卡驅(qū)動(dòng)設(shè)計(jì)的方法。采用Altera公司的FPGA可編程邏輯器件，構(gòu)建了NiosⅡ軟核處理器平臺(tái)，并在此之上實(shí)現(xiàn)了SD卡的驅(qū)動(dòng)設(shè)計(jì)。實(shí)驗(yàn)結(jié)果表明：設(shè)計(jì)提高了FPGA系統(tǒng)的設(shè)計(jì)靈活度，
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nios介紹

Nios II　　 前不久，Altera 正式推出了Nios II系列32位RSIC嵌入式處理器。Nios II系列軟核處理器是Altera的第二代FPGA嵌入式處理器，其性能超過(guò)200DMIPS，在Altera FPGA中實(shí)現(xiàn)僅需35美分。Altera的Stratix 、Stratix GX、 Stratix II和 Cyclone系列FPGA全面支持Nios II處理器，以后推出 [ 查看詳細(xì) ]

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