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詳解FPGA開發(fā)流程中每一環(huán)節(jié)的物理含義和實(shí)現(xiàn)目標(biāo)

  • 詳解FPGA開發(fā)流程中每一環(huán)節(jié)的物理含義和實(shí)現(xiàn)目標(biāo)-FPGA的開發(fā)流程是遵循著ASIC的開發(fā)流程發(fā)展的，發(fā)展到目前為止，F(xiàn)PGA的開發(fā)流程總體按照圖1進(jìn)行，有些步驟可能由于其在當(dāng)前項(xiàng)目中的條件的寬度的允許，可以免去，比如靜態(tài)仿真過程，這樣來達(dá)到項(xiàng)目時(shí)間上的優(yōu)勢。
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超低功耗mcu的選型技巧與設(shè)計(jì)思路

  • 超低功耗mcu的選型技巧與設(shè)計(jì)思路-選擇一款最適合您自己應(yīng)用的超低功耗mcu并非易事，并不像對比數(shù)據(jù)表前面的數(shù)據(jù)那么簡單。我們必須詳細(xì)對比 mcu 功能，包括：斷電模式 定時(shí)系統(tǒng) 事件驅(qū)動功能 片上外設(shè) 掉電檢測與保護(hù) 漏電流 處理效率。還可以關(guān)閉外設(shè)時(shí)鐘，注意I/O口的電平狀態(tài)等措施來降低功耗。
  • 關(guān)鍵字： mcu  超低功耗mcu  

一文了解FPGA與DSP的區(qū)別、特點(diǎn)及用途

  • 一文了解FPGA與DSP的區(qū)別、特點(diǎn)及用途-FPGA是一種可編程的硅芯片，DSP是數(shù)字信號處理，當(dāng)系統(tǒng)設(shè)計(jì)人員在項(xiàng)目的架構(gòu)設(shè)計(jì)階段就面臨到底采用FPGA還是DSP的重要問題。本文將首先分別介紹FPGA和DSP的特點(diǎn)，然后再從內(nèi)部資源、編程語言、功能多個(gè)角度解析兩者的不同。
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通過FPGA智能調(diào)試工具縮短驗(yàn)證時(shí)間

  • 通過FPGA智能調(diào)試工具縮短驗(yàn)證時(shí)間-設(shè)計(jì)人員選擇具有優(yōu)秀調(diào)試能力的FPGA器件，可以縮短開發(fā)周期并降低成本，同時(shí)顯著加快上市速度。
  • 關(guān)鍵字： FPGA  邏輯分析儀  

基于FPGA的虛擬現(xiàn)實(shí)定位系統(tǒng)

  • 基于FPGA的虛擬現(xiàn)實(shí)定位系統(tǒng)-虛擬現(xiàn)實(shí)技術(shù)是目前計(jì)算機(jī)信息科學(xué)中的前沿學(xué)科，文中設(shè)計(jì)了一種以FPGA 為核心的數(shù)據(jù)采集處理系統(tǒng).利用HMC5883L和ADXL345對虛擬場景中物體的方位和朝向進(jìn)行確定并通過以太網(wǎng)給虛擬場景主機(jī)發(fā)送數(shù)據(jù).整個(gè)系統(tǒng)以 FPGA作為主控制器，配以傳感器數(shù)據(jù)采集，內(nèi)部FIFO存儲，以太網(wǎng)高速傳輸，從而把定位系統(tǒng)參數(shù)實(shí)時(shí)傳送到上位機(jī)中，具有傳輸速度快.實(shí)時(shí)性等優(yōu)點(diǎn)，實(shí)現(xiàn)了虛擬現(xiàn)實(shí)高精度定位的功能.
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電路設(shè)計(jì)常見的八個(gè)誤區(qū)

  • 電路設(shè)計(jì)常見的八個(gè)誤區(qū)-電路設(shè)計(jì)常見的八個(gè)誤區(qū)：現(xiàn)象一：這板子的PCB設(shè)計(jì)要求不高，就用細(xì)一點(diǎn)的線，自動布吧；現(xiàn)象二：這些總線信號都用電阻拉一下，感覺放心些；現(xiàn)象三：CPU和FPGA的這些不用的I/O口怎么處理呢？先讓它空著吧，以后再說。
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MCU在手機(jī)和平板電腦中的應(yīng)用

  • MCU在手機(jī)和平板電腦中的應(yīng)用-CU在當(dāng)前手機(jī)與平板電腦應(yīng)用中主要用作諸如電容式觸摸感應(yīng)接口、觸摸屏接口、攝像頭接口、不同模擬傳感器輸入檢測、USB接口以及電池充電與監(jiān)控等眾多功能的協(xié)處理器。
  • 關(guān)鍵字： mcu  

MCU如何滿足可穿戴設(shè)備的設(shè)計(jì)需求

  • MCU如何滿足可穿戴設(shè)備的設(shè)計(jì)需求-隨著可穿戴設(shè)備行業(yè)的當(dāng)前變革，對于更小、更直觀的設(shè)備的需求正在迅猛增加。這個(gè)新興行業(yè)的當(dāng)前設(shè)備趨勢包括智能手表、智能眼鏡以及體育與健身活動跟蹤器。除了消費(fèi)類電子產(chǎn)品，它同時(shí)也在醫(yī)療行業(yè)催生令人關(guān)注的需求。
  • 關(guān)鍵字： mcu  可穿戴設(shè)備  

知識詳解：變頻器對電機(jī)的十種保護(hù)措施

  • 知識詳解：變頻器對電機(jī)的十種保護(hù)措施-我們都知道，變頻器靠內(nèi)部IGBT的開斷來調(diào)整輸出電源的電壓和頻率，根據(jù)電機(jī)的實(shí)際需要來提供其所需要的電源電壓，進(jìn)而達(dá)到節(jié)能、調(diào)速的目的。
  • 關(guān)鍵字： mcu  變頻器  電機(jī)  

FPGA實(shí)戰(zhàn)開發(fā)技巧（6）

  • FPGA實(shí)戰(zhàn)開發(fā)技巧（6）-時(shí)序性能是FPGA 設(shè)計(jì)最重要的指標(biāo)之一。造成時(shí)序性能差的根本原因有很多，但其直接原因可分為三類：布局較差、邏輯級數(shù)過多以及信號扇出過高。
  • 關(guān)鍵字： FPGA  時(shí)序性能  

FPGA實(shí)戰(zhàn)開發(fā)技巧（7）

  • FPGA實(shí)戰(zhàn)開發(fā)技巧（7）-通常我們會為工程添加UCF 約束指定時(shí)序要求和管腳約束。但是UCF 約束是給MAP，PAR 等實(shí)現(xiàn)使用的，綜合工具XST 并不能感知系統(tǒng)的時(shí)序要求。而為XST 添加XCF 約束卻是使實(shí)現(xiàn)結(jié)果擁有最高頻率的關(guān)鍵。
  • 關(guān)鍵字： FPGA  XCF  UCF  

利用FPGA的自身特性實(shí)現(xiàn)隨機(jī)數(shù)發(fā)生器

  • 利用FPGA的自身特性實(shí)現(xiàn)隨機(jī)數(shù)發(fā)生器-本文主要介紹利用FPGA的自身的特性實(shí)現(xiàn)隨機(jī)數(shù)發(fā)生器，在Virtex-II Pro開發(fā)板上用ChipScope觀察隨機(jī)數(shù)序列，以及在PCIe4Base（基于Virtex-4 FPGA）上實(shí)現(xiàn)。
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談?wù)勅绾卫肍PGA開發(fā)板進(jìn)行ASIC原型開發(fā)

  • 談?wù)勅绾卫肍PGA開發(fā)板進(jìn)行ASIC原型開發(fā)-ASIC設(shè)計(jì)在尺寸和復(fù)雜性上不斷增加，現(xiàn)代FPGA的容量和性能的新進(jìn)展意味著這些設(shè)計(jì)中的2/3能夠使用單個(gè)FPGA進(jìn)行建模。
  • 關(guān)鍵字： FPGA  ASIC  

FPGA實(shí)戰(zhàn)開發(fā)技巧（5）

  • FPGA實(shí)戰(zhàn)開發(fā)技巧（5）-一般來講，添加約束的原則為先附加全局約束，再補(bǔ)充局部約束，而且局部約束比較寬松。其目的是在可能的地方盡量放松約束，提高布線成功概率，減少ISE 布局布線時(shí)間。典型的全局約束包括周期約束和偏移約束。
  • 關(guān)鍵字： FPGA  周期約束  

FPGA實(shí)戰(zhàn)開發(fā)技巧（4）

  • FPGA實(shí)戰(zhàn)開發(fā)技巧（4）-在代碼編寫完畢后，需要借助于測試平臺來驗(yàn)證所設(shè)計(jì)的模塊是否滿足要求。ISE 提供了兩種測試平臺的建立方法，一種是使用HDL Bencher 的圖形化波形編輯功能編寫，另一種就是利用HDL 語言，相對于前者使用簡單、功能強(qiáng)大。
  • 關(guān)鍵字： FPGA  ISE  
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