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EEPW首頁 >> 主題列表 >> mcu-fpga

基于遺傳算法的組合邏輯電路設計的FPGA實現(xiàn)

  • 摘要：基于遺傳算法的組合邏輯電路的自動設計，依據(jù)給出的真值表，利用遺傳算法自動生成符合要求的組合邏輯電路。由于遺傳算法本身固有的并行性，采用軟件實現(xiàn)的方法在速度上往往受到本質是串行計算的計算機制約，因
  • 關鍵字： FPGA  算法  電路設計  組合邏輯    

基于ARM和FPGA的靶場破片測速系統(tǒng)的設計

  • 破片速度是戰(zhàn)斗部爆炸效能*估的一個重要參數(shù)。傳統(tǒng)的靶場破片測速系統(tǒng)多使用多路數(shù)據(jù)采集卡設置好的參數(shù)現(xiàn)場采集標靶的試驗波形，試驗完成后再交由計算機進行后期處理和解讀以獲取破片速度等參數(shù)。但隨著軍事科技的日
  • 關鍵字： FPGA  ARM  靶場破片測速  系統(tǒng)    

Altera發(fā)布最新版Quartus II開發(fā)軟件

  • Altera公司(Nasdaq: ALTR)日前發(fā)布業(yè)界成熟可靠的最新版Quartus? II開發(fā)軟件——對于FPGA設計，性能和效能在業(yè)界首屈一指的軟件。Quartus II軟件12.0版進一步提高了用戶的效能和性能優(yōu)勢，例如，對于高性能28-nm設計，編譯時間縮短了4倍。其他更新包括擴展28-nm器件支持，初次支持Altera SoC FPGA，增強Qsys系統(tǒng)集成和DSP Builder工具，以及經(jīng)過改進的知識產(chǎn)權(IP)內核等。
  • 關鍵字： Altera  FPGA  Quartus  

Xilinx攜手科通啟動Zynq-7000 EPP全國6地巡回專題研討會

  • 自賽靈思Zynq?-7000 EPP系列平臺發(fā)布以來，其強大靈活的處理能力便受到廣大嵌入式工程師的矚目，為了早日將這一創(chuàng)新產(chǎn)品引入本土設計，科通集團現(xiàn)正式宣布聯(lián)手All Programmable技術和器件的全球領先企業(yè)賽靈思公司(Xilinx, Inc. (NASDAQ:XLNX)聯(lián)合宣布將在全國六大城市舉辦“2012年賽靈思&科通全球首款可擴展處理平臺—Zynq?-7000系列專題研討會”。6月 19日該研討會將從武漢拉開帷幕，之后覆蓋上海、北京、成都、深圳、廣州。
  • 關鍵字： 賽靈思  FPGA  Zynq-7000  

基于FPGA實現(xiàn)DSP與Rapid IO網(wǎng)絡互聯(lián)系統(tǒng)

  • 電子產(chǎn)品世界,為電子工程師提供全面的電子產(chǎn)品信息和行業(yè)解決方案,是電子工程師的技術中心和交流中心,是電子產(chǎn)品的市場中心,EEPW 20年的品牌歷史,是電子工程師的網(wǎng)絡家園
  • 關鍵字： DSP  FPGA  Rapid網(wǎng)絡  

基于FPGA設計DSP的實踐與改進設計

  • 電子產(chǎn)品世界,為電子工程師提供全面的電子產(chǎn)品信息和行業(yè)解決方案,是電子工程師的技術中心和交流中心,是電子產(chǎn)品的市場中心,EEPW 20年的品牌歷史,是電子工程師的網(wǎng)絡家園
  • 關鍵字： DSP  FPGA  matlab  Simulink環(huán)境  

基于C語言在FPGA上實現(xiàn)DSP的解決方案

  • 基于C語言在FPGA上實現(xiàn)DSP的解決方案,硬件設計者已經(jīng)開始在高性能DSP的設計中采用FPGA技術，因為它可以提供比基于PC或者單片機的解決方法快上10-100倍的運算量。以前，對硬件設計不熟悉的軟件開發(fā)者們很難發(fā)揮出FPGA的優(yōu)勢，而如今基于C語言的方法可以讓
  • 關鍵字： DSP  解決方案  實現(xiàn)  FPGA  語言  基于  

解析基于FPGA的智能控制器設計及測試方法

  • 1引言隨著市場需求的增長，超大規(guī)模集成電路的集成度和工藝水平不斷提高，在一個芯片上完成系統(tǒng)級的...
  • 關鍵字： FPGA  VHDL  仿真測試  智能控制器  

使用LabVIEW FPGA模塊設計IP核

  • 對于利用LabVIEW FPGA實現(xiàn)RIO目標平臺上的定制硬件的工程師與開發(fā)人員，他們可以很容易地利用所推薦的組件設計構建適合其應用的、可復用且可擴展的代碼模塊?；谝呀?jīng)驗證的設計進行代碼模塊開發(fā)，將使現(xiàn)有IP在未來應
  • 關鍵字： LabVIEW  FPGA  IP核  模塊設計    

并聯(lián)式設計！解析本田IMA混合動力系統(tǒng)

基于FPGA的ISA總線／MMи總線數(shù)據(jù)轉換電路設計

  • 摘要：某型導彈測試設備控制總線為通用的ISA總線，而通信接口總線為非標準的MMи總線。在此以FPGA為核心設計了一種ISA總線／MMи總線轉換電路，該電路可以完成2種制式的數(shù)據(jù)和控制指令轉換。給出了轉換電路原理框圖、
  • 關鍵字： FPGA  ISA  總線  數(shù)據(jù)轉換    

單片機基礎3：MCU--51 CPU和存儲器

  • 單片機8051的CPU由運算器和控制器組成。一、運算器運算器以完成二進制的算術/邏輯運算部件ALU為核心，再加上暫存器TMP、累加器ACC、寄存器B、程序狀態(tài)標志寄存器PSW及布爾處理器。累加器ACC是一個八位寄存器，它是CP
  • 關鍵字： 存儲器  CPU  MCU--51  基礎  單片機  

采用VHDL和發(fā)接復用器的SDH系統(tǒng)設計及FPGA仿真

  • 采用VHDL和發(fā)接復用器的SDH系統(tǒng)設計及FPGA仿真,針對目前國內SDH系統(tǒng)中還沒有一個專門的E1分接復用芯征，本文介紹一種用高級硬件描述語言VHDL及狀態(tài)轉移圖完成該發(fā)接復用器的設計的新型設計方法及其FPGA實現(xiàn)。并給出了用Xilinx FoundaTIon tools EDA軟件設計的電路
  • 關鍵字： 設計  FPGA  仿真  系統(tǒng)  SDH  VHDL  復用器  采用  

基于FPGA+DSP的HDLC(高級數(shù)據(jù)鏈路控制)功能實現(xiàn)

  • 基于FPGA+DSP的HDLC(高級數(shù)據(jù)鏈路控制)功能實現(xiàn),引言　　HDLC的ASIC芯片使用簡易，功能針對性強，性能可靠，適合應用于特定用途的大批量產(chǎn)品中。但由于HDLC標準的文本較多，ASIC芯片出于專用性的目的難以通用于不同版本，缺乏應用靈活性。有的芯片公司還有自己的標
  • 關鍵字： 鏈路  控制  功能  實現(xiàn)  數(shù)據(jù)  高級  FPGA  DSP  HDLC  基于  

采用混合信號FPGA的功率管理解決方案

  • 采用混合信號FPGA的功率管理解決方案,　概述 　　Actel Fusionreg; 混合信號FPGA能夠實現(xiàn)功率管理，包括上電順序、運行時間功率監(jiān)控，以及關機控制。此外，愛特公司提供的混合信號功率管理工具(Mixed-Signal Power Manager, MPM)參考設計，更可在如AFS0
  • 關鍵字： 管理  解決方案  功率  FPGA  混合  信號  采用  
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