- 摘要：在軟件無(wú)線電數(shù)字接收機(jī)中，從AD前端采集過來(lái)的數(shù)字信號(hào)頻率高達(dá)72 MHz，如此高的頻率使得后端DSP不能直接完成相關(guān)的數(shù)字信號(hào)處理任務(wù)。因此合理的設(shè)計(jì)基于FPGA的DDC，以降低數(shù)字信號(hào)頻率，方便后端DSP實(shí)時(shí)完成
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FPGA DDC 仿真
- 摘要：針對(duì)調(diào)制樣式在不同環(huán)境下的變化，采用了FPGA部分動(dòng)態(tài)可重構(gòu)的新方法，通過對(duì)不同調(diào)制樣式信號(hào)的解調(diào)模塊的動(dòng)態(tài)加載，來(lái)實(shí)現(xiàn)了不同環(huán)境下針對(duì)不同調(diào)制樣式的解調(diào)這種方式比傳統(tǒng)的設(shè)計(jì)方式具有更高的靈活性、可
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FPGA 部分動(dòng)態(tài)可重構(gòu) 信號(hào)解調(diào)系統(tǒng)
- 嵌入式控制系統(tǒng)的MCU一般都需要一個(gè)穩(wěn)定的工作電壓才能可靠工作。而設(shè)計(jì)者多習(xí)慣采用線性穩(wěn)壓器件(如78xx系列三端穩(wěn)壓器件)作為電壓調(diào)節(jié)和 穩(wěn)壓器件來(lái)將較高的直流電壓轉(zhuǎn)變MCU所需的工作電壓。這種線性穩(wěn)壓電源的線性
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應(yīng)用 介紹 LM2576 設(shè)計(jì) 電源 MCU
- 摘要：在此利用VerilogHDL設(shè)計(jì)了一款CAN總線控制器，首先根據(jù)協(xié)議把整個(gè)CAN總線控制器劃分為接口邏輯管理、寄...
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CAN總線 控制器 FPGA Verilog HDL
- 摘要：為了解決傳統(tǒng)的光伏測(cè)試儀功能單一，只能夠測(cè)量光伏電池基本參數(shù)的問題，采用了增加采樣信道，由FPGA控制采樣模式的方法，設(shè)計(jì)完成了一款雙模式的光伏電池測(cè)試儀。在完成光伏電池I-V曲線等參數(shù)測(cè)量的同時(shí)可以實(shí)
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FPGA 雙模式 光伏電池 測(cè)試儀
- MP3數(shù)字播放機(jī)系統(tǒng)的FPGA設(shè)計(jì)介紹,1 引 言
MPEG（活動(dòng)影像專業(yè)人員組織）是為數(shù)字音頻確定單一編碼和解碼（壓縮/解壓縮）方法于1988年建立的。1992年，國(guó)際標(biāo)準(zhǔn)組織（ISO）和國(guó)際電工委員會(huì)（IEC）為音頻和視頻編碼建立了MPEG1（ISO/IEC11172）標(biāo)準(zhǔn)
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設(shè)計(jì) 介紹 FPGA 系統(tǒng) 數(shù)字 播放機(jī) MP3
- 時(shí)鐘系統(tǒng)是微控制器(MCU)的一個(gè)重要部分，它產(chǎn)生的時(shí)鐘信號(hào)要貫穿整個(gè)芯片。時(shí)鐘系統(tǒng)設(shè)計(jì)得好壞關(guān)系到芯片能否正常工作。在工作頻率較低的情況下，時(shí)鐘系統(tǒng)可以通過綜合產(chǎn)生，即用Verilog/VHDL語(yǔ)言描述電路，并用EDA
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MCU 時(shí)鐘 系統(tǒng)
- FPGA時(shí)序收斂分析,您編寫的代碼是不是雖然在仿真器中表現(xiàn)正常，但是在現(xiàn)場(chǎng)卻斷斷續(xù)續(xù)出錯(cuò)?要不然就是有可能在您使用更高版本的工具鏈進(jìn)行編譯時(shí)，它開始出錯(cuò)。您檢查自己的測(cè)試平臺(tái)，并確認(rèn)測(cè)試已經(jīng)做到 100% 的完全覆蓋，而且所有測(cè)試
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分析 收斂 時(shí)序 FPGA
- 基于VHDL和FPGA的多種分頻實(shí)現(xiàn)方法介紹,分頻器是數(shù)字系統(tǒng)設(shè)計(jì)中的基本電路，根據(jù)不同設(shè)計(jì)的需要，我們會(huì)遇到偶數(shù)分頻、奇數(shù)分頻、半整數(shù)分頻等，有時(shí)要求等占空比，有時(shí)要求非等占空比。在同一個(gè)設(shè)計(jì)中有時(shí)要求多種形式的分頻。通常由計(jì)數(shù)器或計(jì)數(shù)器的級(jí)聯(lián)
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方法 介紹 實(shí)現(xiàn) 多種 VHDL FPGA 基于
- 通過一個(gè)儀器抗干擾處理的實(shí)踐，分析干擾形成錯(cuò)誤的機(jī)理。首先對(duì)干擾進(jìn)行描述，然后分析錯(cuò)誤形成的可能性以及目前解決干擾問題的難點(diǎn)，最后提出對(duì)MCU改進(jìn)的建議。關(guān)鍵詞 抗干擾 容錯(cuò) Watchdog 長(zhǎng)久以來(lái)，計(jì)算機(jī)
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改進(jìn) MCU 分析 干擾 單片機(jī)
- 隨著 10Gb 以太網(wǎng)發(fā)展趨于成熟，且業(yè)界甚至已開始期待 40GbE 和 100GbE 以太網(wǎng)的出現(xiàn)，新一代網(wǎng)絡(luò)基礎(chǔ)架構(gòu)方興未艾。融合型網(wǎng)絡(luò)在流量處理方面向可擴(kuò)展開放式平臺(tái)提出了全新的挑戰(zhàn)。新一代融合型基礎(chǔ)設(shè)施底板通常由高
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FPGA 賽靈思
- 提起FPGA，我們首先想到的是美國(guó)的三大公司，在這個(gè)領(lǐng)域，除了美國(guó)之外，全球其他國(guó)家基本沒有話語(yǔ)權(quán)。但是從今以后，有一家代表中國(guó)FPGA產(chǎn)業(yè)的公司要這個(gè)舞臺(tái)上一展舞姿，請(qǐng)記住她的名字：京微雅格(Capital Microelectronics)。京微雅格公司CEO劉明博士比喻京微雅格在FPGA產(chǎn)業(yè)中的位置：我們已經(jīng)加入到這個(gè)俱樂部，成為其中的一員。
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京微雅格 FPGA
- 摘要：二維離散余弦(DCT)在H．264視頻編碼中承擔(dān)者信號(hào)從時(shí)域到頻域變換的作用。在現(xiàn)場(chǎng)可編程邏輯門陣列(FPGA)上設(shè)計(jì)了高效的采用流水線結(jié)構(gòu)的H．264 DCT硬件電路。首先，把二維4times;4 DCT變換轉(zhuǎn)換成二次一維DCT變
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FPGA 264 DCT 算法
- 使用EP2C35 FPGA 設(shè)計(jì)了多個(gè)串口工作,出現(xiàn)了幾個(gè)問題. 第一次, 由于內(nèi)核電源1.2V 供電不是完整平面,而是帶狀線供電,EP2C35 在代碼容量大的情況下,而且輸入FPGA 信號(hào)變換頻繁, 造成整個(gè)EP2C35 所有的D觸發(fā)器停止翻轉(zhuǎn).
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FPGA 線路 尖峰 毛刺
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