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EEPW首頁(yè) >> 主題列表 >> fsp:fpga-pcb

(多圖) PCB設(shè)計(jì)：如何減少錯(cuò)誤并提高效率

  • (多圖) PCB設(shè)計(jì)：如何減少錯(cuò)誤并提高效率-電路板設(shè)計(jì)是一項(xiàng)關(guān)鍵而又耗時(shí)的任務(wù)，出現(xiàn)任何問(wèn)題都需要工程師逐個(gè)網(wǎng)絡(luò)逐個(gè)元件地檢查整個(gè)設(shè)計(jì)?？梢哉f(shuō)電路板設(shè)計(jì)要求的細(xì)心程度不亞于芯片設(shè)計(jì)。下面我們一起來(lái)探討在PCB設(shè)計(jì)時(shí)如何減少錯(cuò)誤并提高效率？
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剖析FPGA在汽車系統(tǒng)設(shè)計(jì)中的關(guān)鍵作用

  • 剖析FPGA在汽車系統(tǒng)設(shè)計(jì)中的關(guān)鍵作用-選擇不同的微控制器系列時(shí)，軟件的兼容性是主要的障礙。大多數(shù)公司在軟件的開(kāi)發(fā)、測(cè)試和驗(yàn)證方面已經(jīng)進(jìn)行了大量的投入。因此，將設(shè)計(jì)轉(zhuǎn)換到一個(gè)新的架構(gòu)時(shí)，通常需要復(fù)雜且代價(jià)高昂的軟件移植。
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高速ADC PCB的布局布線技巧

  • 高速ADC PCB的布局布線技巧-在高速模擬信號(hào)鏈設(shè)計(jì)中，印刷電路板（PCB）布局布線需 要考慮許多選項(xiàng)，有些選項(xiàng)比其它選項(xiàng)更重要，有些選項(xiàng) 則取決于應(yīng)用。最終的答案各不相同，但在所有情況下， 設(shè)計(jì)工程師都應(yīng)盡量消除最佳做法的誤差，而不要過(guò)分計(jì) 較布局布線的每一個(gè)細(xì)節(jié)。
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降低噪聲與電磁干擾的PCB設(shè)計(jì)24個(gè)竅門

  • 降低噪聲與電磁干擾的PCB設(shè)計(jì)24個(gè)竅門-電子設(shè)備的靈敏度越來(lái)越高，這要求設(shè)備的抗干擾能力也越來(lái)越強(qiáng)，因此PCB設(shè)計(jì)也變得更加困難，如何提高PCB的抗干擾能力成為眾多工程師們關(guān)注的重點(diǎn)問(wèn)題之一。本文將介紹PCB設(shè)計(jì)中降低噪聲與電磁干擾的一些小竅門。
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如何用單個(gè)賽靈思FPGA數(shù)字化數(shù)百個(gè)信號(hào)

  • 如何用單個(gè)賽靈思FPGA數(shù)字化數(shù)百個(gè)信號(hào)-　　在新型賽靈思 FPGA 上使用低電壓差分信號(hào)（LVDS），只需一個(gè)電阻和一個(gè)電容就能夠數(shù)字化輸入信號(hào)。由于目前這一代賽靈思器件上提供有數(shù)百個(gè) LVDS 輸入，理論上使用單個(gè) FPGA 就能夠數(shù)字化數(shù)百個(gè)模擬信號(hào)。
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工程師談FPGA時(shí)序約束七步法

  • 工程師談FPGA時(shí)序約束七步法-時(shí)序例外約束包括FalsePath、MulticyclePath、MaxDelay、MinDelay。但這還不是最完整的時(shí)序約束。
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FMC+ 標(biāo)準(zhǔn)將嵌入式設(shè)計(jì)推到全新的高度

  • FMC+ 標(biāo)準(zhǔn)將嵌入式設(shè)計(jì)推到全新的高度-更新后的 FPGA 夾層卡規(guī)范提供無(wú)與倫比的高 I/O 密度、向后兼容性。
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如何擴(kuò)展 FPGA 的工作溫度范圍

  • 如何擴(kuò)展 FPGA 的工作溫度范圍-　　任何電子器件的使用壽命均取決于其工作溫度。在較高溫度下器件會(huì)加快老化，使用壽命會(huì)縮短。但某些應(yīng)用要求電子產(chǎn)品工作在器件最大額定工作結(jié)溫下。以石油天然氣產(chǎn)業(yè)為例來(lái)說(shuō)明這個(gè)問(wèn)題以及解決方案。
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如何使用FPGA加速機(jī)器學(xué)習(xí)算法

  • 如何使用FPGA加速機(jī)器學(xué)習(xí)算法-　　當(dāng)前，AI因?yàn)槠銫NN（卷積神經(jīng)網(wǎng)絡(luò)）算法出色的表現(xiàn)在圖像識(shí)別領(lǐng)域占有舉足輕重的地位?；镜腃NN算法需要大量的計(jì)算和數(shù)據(jù)重用，非常適合使用FPGA來(lái)實(shí)現(xiàn)。上個(gè)月，Ralph Wittig（Xilinx CTO Office的卓越工程師）在2016年OpenPower峰會(huì)上發(fā)表了約20分鐘時(shí)長(zhǎng)的演講并討論了包括清華大學(xué)在內(nèi)的中國(guó)各大學(xué)研究CNN的一些成果。
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基于ARM和FPGA的多路電機(jī)控制方案

  • 基于ARM和FPGA的多路電機(jī)控制方案-專用控制器由ARM(LPC2214)、FPGA(EP2C5T144C8)、驅(qū)動(dòng)器接口電路、編碼器接口電路、限位檢測(cè)電路和電源電路等組成，ARM通過(guò)串口實(shí)現(xiàn)與上位機(jī)之間的通信，解析從上位機(jī)獲得的控制指令，并通過(guò)FPGA產(chǎn)生相應(yīng)輸出信號(hào)給驅(qū)動(dòng)器接口，驅(qū)動(dòng)器接口外接驅(qū)動(dòng)器。
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電源模塊的PCB設(shè)計(jì)

  • 電源模塊的PCB設(shè)計(jì)-線性電源功率器件工作在線性狀態(tài)，如我們常用的穩(wěn)壓芯片LM7805、LM317、SPX1117等。下圖一是LM7805穩(wěn)壓電源電路原理圖。
  • 關(guān)鍵字： PCB  電源模塊  

專家支招：通過(guò)PCB分層堆疊設(shè)計(jì)控制EMI輻射

  • 專家支招：通過(guò)PCB分層堆疊設(shè)計(jì)控制EMI輻射-解決EMI問(wèn)題的辦法很多，現(xiàn)代的EMI抑制方法包括：利用EMI抑制涂層、選用合適的EMI抑制零配件和EMI仿真設(shè)計(jì)等。本文從最基本的PCB布板出發(fā)，討論P(yáng)CB分層堆疊在控制EMI輻射中的作用和設(shè)計(jì)技巧。
  • 關(guān)鍵字： 電磁干擾  PCB  

高精度ADC電路板的布局與布線案例

  • 高精度ADC電路板的布局與布線案例-在設(shè)計(jì)一個(gè)高性能數(shù)據(jù)采集系統(tǒng)時(shí)，勤奮的工程師仔細(xì)選擇一款高精度ADC，以及模擬前端調(diào)節(jié)電路所需的其他組件。在幾個(gè)星期的設(shè)計(jì)工作之后，執(zhí)行仿真并優(yōu)化電路原理圖，為了趕工期，設(shè)計(jì)人員迅速地將電路板布局布線組合在一起。一個(gè)星期之后，第一個(gè)原型電路板被測(cè)試。出乎預(yù)料，電路板性能與預(yù)期的不一樣。
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4個(gè)設(shè)計(jì)絕招教你減少PCB板電磁干擾

  • 4個(gè)設(shè)計(jì)絕招教你減少PCB板電磁干擾-電子設(shè)備的電子信號(hào)和處理器的頻率不斷提升，電子系統(tǒng)已是一個(gè)包含多種元器件和許多分系統(tǒng)的復(fù)雜設(shè)備。高密和高速會(huì)令系統(tǒng)的輻射加重，而低壓和高靈敏度會(huì)使系統(tǒng)的抗擾度降低。
  • 關(guān)鍵字： 電磁干擾  PCB  

大牛教你如何解決PCB設(shè)計(jì)中EMC問(wèn)題

  • 大牛教你如何解決PCB設(shè)計(jì)中EMC問(wèn)題-隨著高速設(shè)計(jì)時(shí)代的來(lái)臨，PCB設(shè)計(jì)已經(jīng)從以前簡(jiǎn)單的擺器件、拉線發(fā)展到一門以電工學(xué)為基礎(chǔ)，綜合電子、熱、機(jī)械、化工等多學(xué)科的專業(yè)了。PCB設(shè)計(jì)的好壞直接決定了產(chǎn)品開(kāi)發(fā)的質(zhì)量和周期，成為產(chǎn)品設(shè)計(jì)鏈中關(guān)鍵的一個(gè)環(huán)節(jié)。
  • 關(guān)鍵字： EMC  PCB  
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