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EEPW首頁 >> 主題列表 >> fsp:fpga-pcb

基于FPGA的脫機手寫體漢字識別系統(tǒng)

  • 　　1設計摘要 　　1.1項目背景 　　漢字作為非字母化、非拼音化的文字，在當今高度信息化的社會里，如何快速高效地將漢字輸入計算機，已成為影響人機交流信息效率的一個重要瓶頸。目前，漢字輸入主要分為人工鍵盤輸入和機器自動識別輸入兩種，其中人工鍵入速度慢且勞動強度大。自動識別輸入分為語音識別和漢字識別兩種，其中漢字識別是將漢字點陣圖形轉換成電信號，然后輸入給數字信號處理器或計算機進行處理，依據一定的分類算法在漢字字符集合中識別出與之相匹配的漢字。因此，研究脫機手寫體漢字識別的目的就是解決漢字信息如何高速輸
  • 關鍵字： FPGA  神經網絡  漢字識別  

基于USB3.0和FPGA的多串口傳輸系統(tǒng)設計

  • 　　多串口數據通信技術主要研究數據的多串口采集、存儲和處理。由于串口通信技術的廣泛應用，使得多串口采集卡一直是研究的熱點，從早期的基于PCI總線的多串口數據采集卡到后來的基于USB的多串口數據采集卡，以及現在的基于USB3.0的多串口數據采集卡。 　　PCI采集卡由于使用不方便，逐漸被淘汰，目前USB傳輸系統(tǒng)被廣泛應用。USB2.0理論傳輸速度為480Mb/s，而USB3.0的傳輸速率可高達5Gb/s，且在USB2.0的基礎上又增加了超高速傳輸模式。本文設計的系統(tǒng)中有80個485傳輸通道，每個通道的速率
  • 關鍵字： USB3.0  FPGA  PCI  

高云發(fā)布FPGA產品-朝云系列

  • 　　廣東高云半導體科技股份有限公司(以下簡稱“高云半導體”)今日宣布推出擁有完全自主知識產權的現場可編程門陣列(FPGA)朝云™產品系列?？蓮V泛用于通信網絡、工業(yè)控制、工業(yè)視頻、服務器、消費電子等領域，幫助用戶降低開發(fā)風險，迅速克服產品上市時間帶來的挑戰(zhàn)。 　　朝云™產品系列在目前FPGA市場上處于中密度范圍，邏輯單元從18K LUT到100K LUT。其中有兩個家族產品，分別為GW2A和GW3S。前者采用臺積電(TSMC)的55nm工藝，后者采用臺積電的
  • 關鍵字： 高云  FPGA  GW2A  

國產FPGA的“新聲”——高云半導體FPGA系列產品面世

  • 　　2014年10月29日 上海IC-China訊，廣東高云半導體科技股份有限公司(簡稱高云半導體)今日召開新產品發(fā)布會，宣布推出擁有我國完全自主知識產權的三大產品計劃： 　　 現場可編程門陣列(FPGA)朝云™產品系列; 　　 現場可編程門陣列(FPGA)云源™設計軟件; 　　 基于現場可編程門陣列(FPGA)的IP軟核平臺—星核計劃。 　　 擁有完全自主知識產權的現場可編程門陣列(FPGA)朝云™產品系列。 　　
  • 關鍵字： FPGA  高云  朝云  

基于FPGA的機載顯示系統(tǒng)架構設計與優(yōu)化

  • 　　隨著航空電子技術的不斷發(fā)展，現代機載視頻圖形顯示系統(tǒng)對于實時性等性能的要求日益提高。常見的系統(tǒng)架構主要分為三種： 　　(1)基于GSP+VRAM+ASIC的架構，優(yōu)點是圖形ASIC能夠有效提高圖形顯示質量和速度，缺點是國內復雜ASIC設計成本極高以及工藝還不成熟。 　　(2)基于DSP+FPGA的架構，優(yōu)點是，充分發(fā)揮DSP對算法分析處理和FPGA對數據流并行執(zhí)行的獨特優(yōu)勢，提高圖形處理的性能;缺點是，上層CPU端將OpenGL繪圖函數封裝后發(fā)給DSP，DSP拆分后再調用FPGA，系統(tǒng)的集成度不高
  • 關鍵字： FPGA  DSP  ASIC  

高云半導體FPGA系列面世 為國產FPGA注入活力

  • 　　廣東高云半導體科技股份有限公司(簡稱高云半導體)在IC-China上召開新產品發(fā)布會，宣布推出擁有我國完全自主知識產權的現場可編程門陣列(FPGA)朝云?產品系列、現場可編程門陣列(FPGA)云源?設計軟件、基于現場可編程門陣列(FPGA)的IP軟核平臺——“星核計劃”三大產品。 　　三大系列產品詳細情況如下： 　　1.擁有完全自主知識產權的現場可編程門陣列(FPGA)朝云?產品系列 　　朝云?產品系
  • 關鍵字： 高云  FPGA  

新思科技Synopsys與高云半導體就FPGA設計軟件簽署多年OEM協(xié)議

  • 　　為加速芯片和電子系統(tǒng)創(chuàng)新而提供軟件、知識產權(IP)及服務的全球性領先供應商新思科技公司日前宣布：已與廣東高云半導體科技股份有限公司(Gowin Semiconductor)就Synopsys SynplifyPro FPGA綜合工具簽署一項多年OEM協(xié)議。該協(xié)議將使高云的客戶能夠改善邏輯綜合運行時間，并為GowinGW2A/3S FPGA系列實現更高質量的時序、面積及功耗設計。高云半導體已與Synopsys合作把Synplify Pro集成到用于其GW2A/3S FPGA系列的GOWINTM設計套件
  • 關鍵字： Synopsys  FPGA  DSP  

FPGA研發(fā)之道(13)-設計不是湊波形(三)RAM

  • 　　在FPGA內部資源中，RAM是較為常用的一種資源。 　　通常實例化RAM中，一種使用為BLOCK RAM 也就是塊RAM 。另外資源可以通過寄存器搭，也就是分布式RAM。前者一般用于提供較大的存儲空間，后者則提供小的存儲空間。 　　在實際應用過程中，一般使用的包括，單端口、雙端口RAM，ROM等形式等不同的形式。 實際應用中FIFO也是利用RAM和邏輯一起實現的。 　　對于一塊RAM中，其能夠例化的深度是有限的。例如cyclone4的RAM9k中可以例化的資源如下所示： 　　 ?
  • 關鍵字： FPGA  RAM  ROM  

FPGA研發(fā)之道(12)-設計不是湊波形(二)FIFO(下)

  • 　　FIFO在FPGA設計中除了上篇所介紹的功能之外， 還有以下作為以下功能使用： 　　(1) 內存申請 　　在軟件設計中，使用malloc()和free()等函數可以用于內存的申請和釋放。特別是在有操作系統(tǒng)的環(huán)境下，可以保證系統(tǒng)的內存空間被動態(tài)的分配和使用，非常的方便。如果在FPGA內部實現此動態(tài)的內存分配和申請，相對來說較為復雜，例如某些需要外部數據存儲且需動態(tài)改變的應用需求下，需要對FPGA外部DDR(或SRAM等)的存儲空間，進行動態(tài)的分配和釋放。通過使用FIFO作為內存分配器，雖然比不上軟件
  • 關鍵字： FPGA  FIFO  SRAM  

FPGA研發(fā)之道(11)-設計不是湊波形(一)FIFO(上)

  • 　　FIFO是FPGA內部一種常用的資源，可以通過FPGA廠家的的IP生成工具生成相應的FIFO。FIFO可分為同步FIFO和異步FIFO，其區(qū)別主要是，讀寫的時鐘是否為同一時鐘，如使用一個時鐘則為同步FIFO，讀寫時鐘分開則為異步FIFO。一般來說，較大的FIFO可以選擇使用內部BLOCK RAM資源，而小的FIFO可以使用寄存器資源例化使用。 　　一般來說，FIFO的主要信號包括： 　　實際使用中，可編程滿的信號(XILINX 的FIFO)較為常用，ALTERA的FIFO中，可以通過寫深度(即寫入
  • 關鍵字： FPGA  FIFO  RAM  

七招教你規(guī)避嵌入式PCB工程更改

  • 　　工程更改(ECO)將推高設計成本，造成產品開發(fā)大量延遲，進而延遲產品上市時間。然而，通過認真思考經常發(fā)生問題的七大關鍵領域，可以規(guī)避大多數ECO。這七大領域是：元器件選擇，存儲器，濕度敏感等級(MSL)，可測性設計(DFT)，冷卻技術，散熱器以及熱膨脹系數(CTE)。 　　元器件選擇 　　為了規(guī)避ECO，全面通讀元器件規(guī)格書很重要。PCB設計師一般都會例行檢查元器件的電氣和工程數據以及產品壽命和可用性。但當元器件處于市場推廣的早期階段，數據手冊上可能還沒有全部的關鍵指標。如果元器件上市才幾個月，或
  • 關鍵字： PCB  ECO  IPC  

解析FPGA低功耗設計

  • 　　在項目設計初期，基于硬件電源模塊的設計考慮，對FPGA設計中的功耗估計是必不可少的。筆者經歷過一個項目，整個系統(tǒng)的功耗達到了100w,而單片FPGA的功耗估計得到為20w左右，有點過高了，功耗過高則會造成發(fā)熱量增大，溫度高最常見的問題就是系統(tǒng)重啟，另外對FPGA內部的時序也不利，導致可靠性下降。其它硬件電路的功耗是固定的，只有FPGA的功耗有優(yōu)化的余地，因此硬件團隊則極力要求筆者所在的FPGA團隊盡量多做些低功耗設計。筆者項目經歷尚淺，還是第一次正視功耗這碼事兒，由于項目時間比較緊，而且xilinx方
  • 關鍵字： FPGA  低功耗  RTL  

Mentor Graphics發(fā)布Xpedition System Designer

  • 　　印刷電路板(PCB)設計解決方案的行業(yè)先驅及技術領導者Mentor Graphics 公司今日發(fā)布其Xpedition?平臺的新產品及主要組件——用于多板系統(tǒng)連接的Xpedition Systems Designer。Xpedition Systems Designer產品抓取多板系統(tǒng)的硬件描述，從邏輯系統(tǒng)定義到個別的PCB，都能自動進行多層級系統(tǒng)設計同步處理，以確保設計過程中團隊能夠準確高效協(xié)作。 　　目前，高端電子系統(tǒng)的設計流程不容樂觀，系統(tǒng)定義過程使用多種無法相
  • 關鍵字： Mentor Graphics  PCB  Visio  

基于FPGA的報文數據分析模塊的設計

  • 　　摘要：網絡報文數據的記錄和分析在智能化變電站中尤為重要，通過對整個通信過程的記錄可以為事故分析及運行維護提供依據。本文提出了一種基于FPGA技術、結合相關通信協(xié)議的報文數據分析系統(tǒng)的設計方案，實現了報文數據分析系統(tǒng)的各功能子模塊，通過仿真運行驗證了系統(tǒng)良好的處理能力。 　　引言 　　隨著計算機技術、通信技術及網絡技術的迅速發(fā)展，基于這三種核心技術的自動化智能裝置在電網控制中的作用越來越突出。其中以交換式以太網和光纖光纜實現的網絡通信系統(tǒng)已經逐漸成為變電站的重要單元。 　　如何記錄、分析某個智能單
  • 關鍵字： FPGA  以太網  IEC61850  PHY  CPU  MAC  201411  

基于DaVinci?平臺的網絡視頻解碼系統(tǒng)分析與設計

  • 　　摘要：隨著視頻壓縮技術的不斷發(fā)展，單路1080p@60Hz分辨率的視頻可以壓縮到幾兆進行傳輸，一個百兆網口可以傳輸多達10多路的IP視頻信號。目前的服務器單純依靠CPU進行軟解碼已經顯得非常吃力[1];匹配高性能的服務器或者配置多臺服務器卻有存在高成本的壓力。針對這些現狀，本文設計了一個基于TI的DaVinci?平臺的網絡視頻解碼系統(tǒng)。驗證結果顯示，采樣該網絡視頻解碼系統(tǒng)，可以使得單臺服務器增加上百路的IP視頻解碼，同時不影響服務器的其它性能，性能可靠且成本有很大優(yōu)勢。 　　1 TI 8
  • 關鍵字： DaVinci  IP視頻  CPU  Linux  FPGA  201411  
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