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基于ARM體系的嵌入式系統(tǒng)BSP的程序設(shè)計(jì)方案

  • 電子產(chǎn)品世界,為電子工程師提供全面的電子產(chǎn)品信息和行業(yè)解決方案,是電子工程師的技術(shù)中心和交流中心,是電子產(chǎn)品的市場中心,EEPW 20年的品牌歷史,是電子工程師的網(wǎng)絡(luò)家園
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ARM指令中的條件代碼

  • ARM指令集中所有ARM指令都是可以帶條件執(zhí)行的。下面是條件代碼的列表: EQ : 等于 如果一次比較之后設(shè)置了 Z 標(biāo)志。   NE : 不等于 如果一次比較之后清除了 Z 標(biāo)志。   VS : 溢出設(shè)置 如果在一次算術(shù)操作之后設(shè)置了 V 標(biāo)志,計(jì)算的結(jié)果不適合放入一個(gè) 32bit 目標(biāo)寄存器中。   VC : 溢出清除 如果清除了 V 標(biāo)志,與 VS 相反。   HI : 高于(無符號) 如果一次比較之后設(shè)置了 C 標(biāo)志并清除了 Z 標(biāo)志。   LS : 低于或同于(無符號) 如果一次比較操作之后
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基于 FPGA 的 MPEG-4 編解碼器

  • 您是否曾想在您的FPGA設(shè)計(jì)中使用先進(jìn)的視頻壓縮技術(shù),卻發(fā)現(xiàn)實(shí)現(xiàn)起來太過復(fù)雜?現(xiàn)在您無需成為一名視頻專家就能在您的系統(tǒng)中使用視頻壓縮。賽靈思新推出的 MPEG-4 編碼器/解碼器核可以幫助您滿足視頻壓縮需求。 視頻和多媒體系統(tǒng)正變得日益復(fù)雜,因此能否獲得適用于您的系統(tǒng)的低成本的可靠 IP 核對您的產(chǎn)品上市極為關(guān)鍵。特別是,視頻壓縮算法與標(biāo)準(zhǔn)已變成極為復(fù)雜的電路,需要花費(fèi)很長時(shí)間來設(shè)計(jì),并且常常成為系統(tǒng)測試和發(fā)貨的瓶頸。這些 MPEG-4 簡易 (simple profile) 編碼器/解碼器核也許正好
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Altera推出低成本Arria GX FPGA系列

  • Altera公司(NASDAQ: ALTR)今天宣布推出低成本Arria™ GX系列,繼續(xù)擴(kuò)大了公司在收發(fā)器FPGA市場上的領(lǐng)先優(yōu)勢。Arria GX FPGA經(jīng)過優(yōu)化,支持速率高達(dá)2.5Gbps的PCI Express (PCIe)、千兆以太網(wǎng)(GbE)和Serial RapidIO™ (SRIO)標(biāo)準(zhǔn);這些標(biāo)準(zhǔn)迅速成為很多市場和應(yīng)用領(lǐng)域的主流協(xié)議。Arria GX系列的特性包括成熟的Str
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2007年5月9日,芯原與ARM擴(kuò)展合作關(guān)系

  •   2007年5月9日 芯原與ARM擴(kuò)展合作關(guān)系,滿足消費(fèi)和網(wǎng)絡(luò)應(yīng)用先進(jìn)片上系統(tǒng)設(shè)計(jì)的需求, 進(jìn)一步增強(qiáng)芯原為關(guān)鍵的垂直市場提供的片上系統(tǒng)應(yīng)用平臺(tái)。
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亞科鴻禹發(fā)布新版FPGA原型驗(yàn)證板StarFire6S-DARM

  •   亞科鴻禹科技有限公司(HyperSilicon)于近日在北京推出了名為StarFire6S-DARM的系列新型FPGA原型驗(yàn)證系統(tǒng)。該公司原有的StarFire5S-V系列主要針對各類視音頻SOC的設(shè)計(jì)驗(yàn)證,被國內(nèi)設(shè)計(jì)公司廣泛采用累計(jì)達(dá)20多套。這款新的StarFire6S-DARM系列繼承了StarFire5S-V系列的大部分優(yōu)點(diǎn),在容量、靈活性和性能指標(biāo)方面有了進(jìn)一步提高,同時(shí)支持采用各類型ARMTM處理器的SOC驗(yàn)證,從而適應(yīng)更廣泛的SOC/ASIC/IP/FPGA的原型驗(yàn)證和算法實(shí)現(xiàn)的要求。
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基于CPCI總線架構(gòu)設(shè)計(jì)的實(shí)時(shí)圖像信號處理平臺(tái)

  • 摘要:  本文主要介紹了基于CPCI 總線設(shè)計(jì)的實(shí)時(shí)信號處理業(yè)務(wù)所需的一種專用設(shè)備平臺(tái)。關(guān)鍵詞: CPCI BUS;平臺(tái);實(shí)時(shí)信號處理;DSP+FPGA 系統(tǒng)設(shè)計(jì)DSP+FPGA混用設(shè)計(jì)為了提高算法效率,實(shí)時(shí)處理圖像信息,本處理系統(tǒng)是基于DSP+FPGA混用結(jié)構(gòu)設(shè)計(jì)的。業(yè)務(wù)板以FPGA為處理核心,實(shí)現(xiàn)數(shù)字視頻信號的實(shí)時(shí)圖像處理,DSP實(shí)現(xiàn)了部分的圖像處理算法和FPGA的控制邏輯,并響應(yīng)中斷,實(shí)現(xiàn)數(shù)據(jù)通信和存儲(chǔ)實(shí)時(shí)信號。首先,本系統(tǒng)要求DSP可以滿足算法控制結(jié)構(gòu)復(fù)雜、運(yùn)算速度高、尋址靈
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基于FPGA的高階全數(shù)字鎖相環(huán)的設(shè)計(jì)與實(shí)現(xiàn)

  • 本文提出了一種基于PI 控制算法的三階全數(shù)字鎖相環(huán),采用EDA 技術(shù)進(jìn)行系統(tǒng)設(shè)計(jì),并用可編程邏輯器件予以實(shí)現(xiàn)。
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ARM啟動(dòng)代碼設(shè)計(jì)參考

  • 基于ARM的芯片多數(shù)為復(fù)雜的片上系統(tǒng),這種復(fù)雜系統(tǒng)里的多數(shù)硬件模塊都是可配置的,需要由軟件來設(shè)置其需要的工作狀態(tài)。因此在用戶的應(yīng)用程序之前,需要由專門的一段代碼來完成對系統(tǒng)的初始化。由于這類代碼直接面對處理器內(nèi)核和硬件控制器進(jìn)行編程,一般都是用匯編語言。一般通用的內(nèi)容包括:  l         中斷向量表  l       
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ARM開發(fā)經(jīng)驗(yàn)

  • 前一段時(shí)間做了arm的一些開發(fā),主要是編寫了arm的啟動(dòng)軟件和移植了uCOS-II到arm7。我做事情喜歡深入簡出,及從最簡單,最原理的方面先做一個(gè)框架,然后在這個(gè)框架里面進(jìn)行補(bǔ)充。我還是一個(gè)很喜歡和別人討論的人,希望有人可以給我提出意見和建議。我的這個(gè)心得很初級,都是一些基本的東西?,F(xiàn)在拿出來和大家分享,希望在我畢業(yè)之前能給大家留一些紀(jì)念。  由于這些東西發(fā)paper實(shí)在是沒有價(jià)值,但是我感覺可以作為arm開發(fā)的入門。由于我的水平和經(jīng)驗(yàn)有限,錯(cuò)誤也是難免的。但是如果不拿出來和大家分享,就
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使用ARM標(biāo)準(zhǔn)C庫進(jìn)行嵌入式應(yīng)用程序開發(fā)

  • 引 言    隨著對高處理能力、實(shí)時(shí)多任務(wù)、超低功耗等方面需求的增長,高端嵌入式處理器已經(jīng)進(jìn)入了國內(nèi)開發(fā)人員的視野,并在國內(nèi)得到了普遍的重視和應(yīng)用。ARM是目前嵌入式領(lǐng)域應(yīng)用最廣泛的RISC微處理器結(jié)構(gòu),憑借低成本、低功耗、高性能等優(yōu)點(diǎn)占據(jù)了嵌入式系統(tǒng)應(yīng)用領(lǐng)域的領(lǐng)先地位。ADS是ARM公司推出的ARM集成開發(fā)環(huán)境,提供了對C和C++的支持,是目前開發(fā)ARM的主要工具。本文針對日益縮短的嵌入式開發(fā)周期,結(jié)合ARM系統(tǒng)開發(fā)調(diào)試經(jīng)驗(yàn),對使用ARM標(biāo)準(zhǔn)庫進(jìn)行應(yīng)用程序開發(fā)作了比較系統(tǒng)的分析。 1
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FPGA與DS18B20型溫度傳感器通信的實(shí)現(xiàn)

  • DS18B20是DALLAS公司生產(chǎn)的一線式數(shù)字溫度傳感器,采用3引腳TO-92型小體積封裝;溫度測量范圍為-55℃~+125℃,可編程為9位~12位A/D轉(zhuǎn)換精度,測溫分辨率可達(dá)0.0625℃,被測溫度用符號擴(kuò)展的16位數(shù)字量方式串行輸出。  一線式(1-WIRE)串行總線是利用1條信號線就可以與總線上若干器件進(jìn)行通信。具體應(yīng)用中可以利用微處理器的I/O端口對DS18B20直接進(jìn)行通信,也可以通過現(xiàn)場可編程門陣列(FPGA)等可編程邏輯器件(PLD)實(shí)現(xiàn)對1-WIRE器件的通信。 
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ARM發(fā)布07年第一季度未審計(jì)財(cái)報(bào)

  •   近日,英國ARM公司(倫敦證交所:ARM;納斯達(dá)克:ARMHY)公布了截止至2007年3月31日的2007年第一季度未審計(jì)財(cái)務(wù)報(bào)告,報(bào)告顯示第一季度公司營業(yè)收入達(dá)到6650萬英鎊,以美元結(jié)算營業(yè)收入達(dá)到1.292億美元,比去年同期分別增長了3%和14%。由于美元對英鎊匯率的下跌(2007年第一季度1.94美元兌1英鎊,2006年第一季度1.75美元兌1英鎊),依照2006年第一季度的實(shí)際匯率,2007年第一季度英鎊營業(yè)收入將達(dá)到7400萬英鎊。   第一季度公司授權(quán)業(yè)務(wù)的營業(yè)收入達(dá)到5430萬美元,
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基于ADSP-BF537的視頻SOC驗(yàn)證方案

  • 本文介紹一種利用嵌入Blackfin處理器的ADSP-BF537作為處理器進(jìn)行SoC的FPGA實(shí)時(shí)驗(yàn)證的方案及其總線接口轉(zhuǎn)換...
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基于IP核的FPGA設(shè)計(jì)方法

  • 前 言 幾年前設(shè)計(jì)專用集成電路(ASIC) 還是少數(shù)集成電路設(shè)計(jì)工程師的事, 隨著硅的集成度不斷提高,百萬門的ASIC 已不難實(shí)現(xiàn), 系統(tǒng)制造公司的設(shè)計(jì)人員正越來越多地采用ASIC 技術(shù)集成系統(tǒng)級功能(System L evel In tegrete - SL I) , 或稱片上系統(tǒng)(System on a ch ip ) , 但ASIC 設(shè)計(jì)能力跟不上制造能力的矛盾也日益突出。現(xiàn)在設(shè)計(jì)人員已不必全部用邏輯門去設(shè)計(jì)ASIC, 類似于用集成電路( IC) 芯片在印制板上的設(shè)計(jì),ASIC 設(shè)計(jì)人員可以應(yīng)用等
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