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高性能MIPS32?24K?處理器內(nèi)核助力BroadLight新型GPON家庭網(wǎng)關(guān)SoC

  • 　　為數(shù)字消費、家庭網(wǎng)絡(luò)、無線、通信和商業(yè)應(yīng)用提供業(yè)界標準架構(gòu)、處理器及模擬 IP 的領(lǐng)先廠商 MIPS 科技公司（MIPS Technologies Inc.，納斯達克交易代碼：MIPS）今天宣布，BroadLight已經(jīng)選擇高性能 MIPS32® 24K® 內(nèi)核作為其新型 GPON 系統(tǒng)級芯片（SoC）的基礎(chǔ)核心。BroadLight 今天還宣布針對光纖到戶（fiber-to-the-home，F(xiàn)TTH）應(yīng)用的 BL2348 GPON 家庭網(wǎng)關(guān)（RG）SoC 解決方案已經(jīng)開始提供樣品。
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從誘發(fā)地震原因反思節(jié)能還是最好的方式

  • 　　5月12日，四川汶川大地震震驚了世界。有專家認為，誘發(fā)這次地震的原因可能與在該地震帶進行梯級水電開發(fā)有關(guān)。 　　十幾年來，尋找更多的能源成為各國的大事。目前的狀況是：化石燃料價格飛漲；太陽能、風能等可再生能源成熟還要等上數(shù)十年；生物燃料消耗的能源比化石燃料還要高，尤其糧食漲價更讓生物燃料前景黯淡；核能還不夠安全穩(wěn)定；燃料電池在試制，水能（水電站）帶來了氣候改變、地震…… 　　能源和環(huán)保，真是令全世界大傷腦筋！環(huán)境問題、經(jīng)濟問題、政治問題，自然災(zāi)害、戰(zhàn)爭…&
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基于CPLD的USB下載電纜設(shè)計

  • 　　引 言 　　隨著片上系統(tǒng)(SoC，System on Chip)時代的到來，包括復(fù)雜可編程邏輯器件(CPLD，Complex ProgrammableLogic Devi(e)和現(xiàn)場可編程門陣列(FPGA，F(xiàn)ield Programmable Gate Array)的可編程邏輯器件(具有在系統(tǒng)可再編程的獨特優(yōu)點)，應(yīng)用越來越廣泛。這給用于可編程邏輯器件編程的下載電纜提出了更高的要求。 　　本文研究基于IEEEll49．1標準的USB下載接口電路的設(shè)計及實現(xiàn)。針對Altera公司的FPGA器件Cy-
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CC2431的無線定位引擎及其應(yīng)用改進

  • 　　引 言 　　CC2431是TI公司推出的帶硬件定位引擎的片上系統(tǒng)(SoC)解決方案，能滿足低功耗ZigBee／IEEE 802.15.4無線傳感器網(wǎng)絡(luò)的應(yīng)用需要。CC2431定位引擎基于RS-SI(Received Signal Strength Indicator，接收信號強度指示)技術(shù)，根據(jù)接收信號強度與已知參考節(jié)點位置準確計算出有關(guān)節(jié)點位置，然后將位置信息發(fā)送給接收端。相比于集中型定位系統(tǒng)，RSSI功能降低了網(wǎng)絡(luò)流量與通信延遲，在典型應(yīng)用中可實現(xiàn)3～5 m定位精度和0.25 m的分辨率。本文在
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千兆高速采集系統(tǒng)的硬件電路設(shè)計

  • 　　1 ADC08D1000的結(jié)構(gòu) 　　ADC08D1000是NS(National Semiconductor，國家半導體)公司于2005年推出的雙通道低功耗的高速8位A／D轉(zhuǎn)換器，其最高單通道采樣頻率達l.3 GHz，全功率帶寬(FPBW)為1．7 GHz，在500 MHz標準信號輸入的情況下可以獲得7．4位的有效采樣位數(shù)。整個A／D轉(zhuǎn)換器用單電源1．9V供電，內(nèi)帶高質(zhì)量參考源和高性能采樣保持電路，每個通道均為差分輸入，采樣范圍可選為650 mV或870 mV(峰一峰值)。在高速數(shù)／模轉(zhuǎn)換系統(tǒng)中，有
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SoC功耗設(shè)計的黃金模型

  • 　　在SoC系統(tǒng)設(shè)計方面，現(xiàn)在還有一些人們幾乎未涉足的領(lǐng)域，而這些領(lǐng)域?qū)档凸漠a(chǎn)生最大的推動作用。幸運的是，人們現(xiàn)在已經(jīng)擁有大量針對這一領(lǐng)域的設(shè)計工具。在近日美國舊金山舉辦的Electronic Summit2008上，Mentor Graphics的ESL-HDL部門總經(jīng)理Glenn Perry介紹了系統(tǒng)級設(shè)計需要考慮的方方面面。 　　系統(tǒng)架構(gòu)方面的改進將帶來巨大的好處，不過在EDA世界，人們只有在設(shè)計的較晚階段才使用功耗仿真工具，如門級和物理實現(xiàn)級。那為何不在系統(tǒng)級進行這些工作？原因主要包括：
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外形似集成電路的完整 DC/DC 解決方案為基于 FPGA 的系統(tǒng)帶來切實益處

  • FPGA工藝尺寸的進步和更加靈活的設(shè)計配置、以及基于FPGA的系統(tǒng)取得的進步已經(jīng)使FPGA制造商充滿信心地進入了以前由微處理器和ASIC供應(yīng)商壟斷的市場。最近，Xilinx的VirtexTM和Altera的Stratix產(chǎn)品系列分別推出了新器件，進一步縮小了性能差距，再次提高了性能標準。盡管這些器件的通用和可配置性吸引了系統(tǒng)設(shè)計師，但是控制這些器件內(nèi)部工作方式的設(shè)計規(guī)則及其外部接口協(xié)議的復(fù)雜性導致需要廣泛的培訓、基準設(shè)計評估、設(shè)計仿真和驗證。因此，F(xiàn)PGA供應(yīng)商提供了詳盡的硬件和固件支持，旨在幫助系統(tǒng)設(shè)計
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安富利電子元件部推出Virtex-5 FXT FPGA評估工具套件

  • 　　安富利公司 (NYSE: AVT) 旗下安富利電子元件部宣布推出Xilinx® Virtex®-5 FXT FPGA 評估工具套件。該套件以Xilinx最新的Virtex-5 FXT 現(xiàn)場門陣列(FPGA)為基礎(chǔ)，還包括了一塊評估板、ISE® Design Suite 10.1 WebPACK™ 設(shè)計工具、評估版Embedded Development Kit (EDK)軟件、電源并能獲得參考設(shè)計和設(shè)計指南等資料。此套件成本低廉，是意圖研究Virtex-5 FXT平
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基于FPGA的高速流水線FFT算法實現(xiàn)

  • 　　0 引言 　　有限長序列的DFT(離散傅里葉變換)特點是能夠?qū)㈩l域的數(shù)據(jù)離散化成有限長的序列。但由于DYT本身運算量相當大，限制了它的實際應(yīng)用。FFT(快速傅里葉變換)算法是作為DFT的快速算法提出，它將長序列的DFT分解為短序列的DFT，大大減少了運算量，使得DFT算法在頻譜分析、濾波器設(shè)計等領(lǐng)域得到了廣泛的應(yīng)用。 　　FPGA(現(xiàn)場可編程門陣列)是一種具有大規(guī)模可編程門陣列的器件，不僅具有專用集成電路(ASIC)快速的特點，更具有很好的系統(tǒng)實現(xiàn)的靈活性。FPGA可通過開發(fā)工具實現(xiàn)在線編程。與C
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系統(tǒng)設(shè)備低功耗設(shè)計的4個層次

  • 　　系統(tǒng)級設(shè)備往往是能耗的最終反映。在考慮功耗降低時，往往需要從四個層次來考慮。在近日舊金山舉行的Electronic Summit2008上，Cadence公司低功耗市場行銷總監(jiān)Mohit Bhatnagar舉例了數(shù)據(jù)中心設(shè)備的低功耗考慮。 　　第一是服務(wù)器中心，即綠色電網(wǎng)的問題，如果你采用相同的IC、工藝、軟件，你能讓設(shè)計出的數(shù)據(jù)中心的功耗更低嗎？數(shù)據(jù)分析表明，考察一個數(shù)據(jù)中心時，45％的功耗出現(xiàn)在服務(wù)器元件上，諸如存儲器或CPU；另外的45％則是用于冷卻它們。因此，其中90％的功耗是半導體集成電路
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Altera Stratix III FPGA的LVDS I/O支持SGMII

  • 　　Altera公司今天宣布，Stratix® III FPGA在其LVDS I/O上支持串行千兆位介質(zhì)無關(guān)接口(SGMII)。Stratix III LVDS I/O的接口速率達到1.25 Gbps，滿足SGMII嚴格的抖動性能要求，支持不含收發(fā)器的三速以太網(wǎng)(10/100/1000 Mbps)接口。Stratix III FPGA是業(yè)界首款在LVDS引腳上支持千兆以太網(wǎng)SGMII的可編程邏輯器件，降低了每個器件的成本和功耗，提供更多的接口。 　　Stratix III FPGA的SGMII
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用于便攜式設(shè)備的低功耗MCU系統(tǒng)設(shè)計方法及應(yīng)用

  • 　　1、便攜式設(shè)備對處理器提出的挑戰(zhàn) 　　 　　隨著電子便攜式設(shè)備在全球的風行，人們對電子便攜式設(shè)備的要求也越來越高，希望產(chǎn)品有更多的功能，如手機攝像機自動對焦與手機閃信與計步器；希望產(chǎn)品功耗更低，如無線設(shè)備、手持POS機和家庭醫(yī)療產(chǎn)品；希望產(chǎn)品體積更小，如運動手表；希望產(chǎn)品的保密性好；處理能力強，如便攜式儀器和高精度運動控制；希望價格更低和開發(fā)周期短。 　　 　　然而困惑的是，很多的便攜式設(shè)備往往會同時要有上面的多個要求，然而現(xiàn)實中很難做到：同時滿足高速處理、低功耗和價格？ARM高速，但是功耗而
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如何在SoC設(shè)計中加入低開銷、低功耗的音頻處理功能

  • 如果你打算設(shè)計一個包含數(shù)字音頻的SoC系統(tǒng)，或者正在進行這樣一個項目，那么花幾分鐘時間閱讀本文可以幫助你在各種技術(shù)參數(shù)之間做出更好的平衡，避免設(shè)計方向出現(xiàn)偏差，提高流片的成功率，從而節(jié)省數(shù)周的開發(fā)時間。我們將為你逐一分析設(shè)計備選方案，評估中的關(guān)鍵因素以及由此做出的決策。 　　消費類音頻產(chǎn)品的歷史 　　消費類音頻產(chǎn)品的歷史最早可以追溯到130年前，在開始的100年間，音頻回放只能采用模擬技術(shù)。那時采用數(shù)字技術(shù)的產(chǎn)品體積龐大，價格昂貴，對于消費類產(chǎn)品來說也過于復(fù)雜。直到1982年，CD光盤和CD播放器的
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突發(fā)通信中Turbo碼的FPGA實現(xiàn)

  • 　　Turbo碼一種低信噪比條件下也能達到優(yōu)異糾錯性能的信道編碼。早期為了強調(diào)Turbo碼接近香農(nóng)限的優(yōu)異性能，研究的碼字度非常大[1～2]，存在譯碼復(fù)雜度大、譯碼時延長等問題。突發(fā)數(shù)據(jù)通信以傳輸中小長度的數(shù)據(jù)報文業(yè)務(wù)為主，所以突發(fā)通信中的Turbo碼的碼長也是中等長度以下的。本文面向突發(fā)數(shù)據(jù)通信中的信道編碼應(yīng)用，研究了短幀長Turbo碼編譯碼算法的FPGA實現(xiàn)。實現(xiàn)中采用了優(yōu)化的編譯碼算法，以降低譯碼復(fù)雜度和譯碼延時。最后仿真和測試了Turbo譯碼器的糾錯性能和吞吐量。 　　1 Turbo碼編碼器的F
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安富利電子元件部推出低成本Spartan-3A FPGA評估工具套件

  • 　　安富利公司 (NYSE: AVT) 旗下安富利電子元件部宣布推出價格僅為39美元Xilinx® Spartan®-3A 評估工具套件。這套件工具上裝有Xilinx的 Spartan-3A 400A 現(xiàn)場可編程門陣列 (FPGA)，為設(shè)計師評估或測試其針對低成本大批量應(yīng)用的設(shè)計提供了高性價比解決方案。 　　設(shè)計師可以用Spartan-3A工具套件進行FPGA原型設(shè)計、研究Xilinx MicroBlaze™軟處理器、嘗試各種不同的FPGA配置技術(shù)以及驗證低成本的FPGA設(shè)計
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