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Xilinx FPGA的功耗優(yōu)化設(shè)計(jì)
- 對(duì)于FPGA來(lái)說(shuō)，設(shè)計(jì)人員可以充分利用其可編程能力以及相關(guān)的工具來(lái)準(zhǔn)確估算功耗，然后再通過(guò)優(yōu)化技術(shù)來(lái)使FPGA設(shè)計(jì)以及相應(yīng)的PCB板在功率方面效率更高。
靜態(tài)和動(dòng)態(tài)功耗及其變化在90nm工藝時(shí)，電流泄漏問(wèn)題對(duì)ASIC和 - 關(guān)鍵字： 設(shè)計(jì) 優(yōu)化 功耗 FPGA Xilinx
Xilinx推出ISE設(shè)計(jì)套件11.1版本
- 全球可編程邏輯解決方案領(lǐng)導(dǎo)廠商賽靈思公司今天宣布正式推出ISE® 設(shè)計(jì)套件11.1版本(ISE® Design Suite 11.1)。這一FPGA設(shè)計(jì)解決方案在業(yè)界率先為邏輯、數(shù)字信號(hào)處理、嵌入式處理以及系統(tǒng)級(jí)設(shè)計(jì)提供了完全可互操作的領(lǐng)域?qū)Ｓ迷O(shè)計(jì)流程和工具配置。 該新版本為面向多種市場(chǎng)和應(yīng)用的基于FPGA的片上系統(tǒng)解決方案提供了更簡(jiǎn)單、更智能的設(shè)計(jì)方法。賽靈思公司致力于為設(shè)計(jì)人員提供目標(biāo)設(shè)計(jì)平臺(tái)，而ISE 設(shè)計(jì)套件 11.1版本的推出是一個(gè)重要的里程碑。 為更好地滿(mǎn)足當(dāng)前異常多
- 關(guān)鍵字： Xilinx FPGA 嵌入式
德州儀器首席科學(xué)家展望SoC時(shí)代演進(jìn)藍(lán)圖
- 從幾間屋子大的大型計(jì)算機(jī)到身段玲瓏的上網(wǎng)本，從老舊笨重的手搖電話到可裝入口袋隨身而行的智能手機(jī)?；厥装雮€(gè)多世紀(jì)來(lái)IC產(chǎn)業(yè)日新月異的發(fā)展，人們見(jiàn)證了一個(gè)個(gè)創(chuàng)新傳奇，越來(lái)越多的電子產(chǎn)品被裝進(jìn)口袋。在低成本、高性能、便攜性成為眾望所歸的今天，半導(dǎo)體行業(yè)的創(chuàng)新之路又將何去何從?德州儀器(TI)首席科學(xué)家方進(jìn)(Gene Frantz)訪問(wèn)中國(guó)，在著名學(xué)府“清華園”與業(yè)內(nèi)人士一起暢談電子技術(shù)發(fā)展前景，探討口袋中科技演進(jìn)的秘密。 此次，方進(jìn)就電子設(shè)備從體積龐大向便攜袖珍的發(fā)展過(guò)程中，嵌
- 關(guān)鍵字： TI SoC 嵌入式處理技術(shù)
基于FPGA和LVDS技術(shù)的光纜傳輸技術(shù)
- 為了解決彈上記錄器和地面測(cè)試臺(tái)之間高速數(shù)據(jù)流遠(yuǎn)距離傳輸問(wèn)題，提出一種利用低電壓差分信號(hào)(LVDS)接口器件實(shí)現(xiàn)數(shù)據(jù)遠(yuǎn)距離傳輸?shù)脑O(shè)計(jì)方案。實(shí)驗(yàn)證明該方案?jìng)鬏斔俣冗_(dá)到20 Mh／s，傳輸距離達(dá)到300 m，傳輸速度和傳輸距離得到顯著提高。該優(yōu)秀的長(zhǎng)線傳輸技術(shù)已成功應(yīng)用于在某項(xiàng)目中。
- 關(guān)鍵字： FPGA LVDS 光纜 傳輸技術(shù)
FPGA引腳信號(hào)指配的幾個(gè)原則
- 現(xiàn)在的FPGA正變得越來(lái)越復(fù)雜，向引腳分配信號(hào)的任務(wù)曾經(jīng)很簡(jiǎn)單，現(xiàn)在也變得相當(dāng)繁復(fù)。下面這些用于向多用途引腳...
- 關(guān)鍵字： 引腳信號(hào)指配 FPGA 單極信號(hào)
采用創(chuàng)新降耗技術(shù)應(yīng)對(duì)FPGA靜態(tài)和動(dòng)態(tài)功耗的挑戰(zhàn)
- 傳統(tǒng)上，數(shù)字邏輯并不耗費(fèi)大量靜態(tài)功耗，但隨著工藝節(jié)點(diǎn)的不斷精微，這一情況在發(fā)生顯著變化。現(xiàn)在，隨著工藝尺度的...
- 關(guān)鍵字： FPGA 動(dòng)態(tài)功耗 動(dòng)態(tài)功耗 Stratix
利用低成本FPGA設(shè)計(jì)下一代游戲控制臺(tái)
- 游戲控制臺(tái)設(shè)計(jì)者必須在實(shí)現(xiàn)系統(tǒng)的多功能、可靠性和低成本之間尋找平衡。市場(chǎng)壓力經(jīng)常迫使最初的控制臺(tái)價(jià)格...
- 關(guān)鍵字： FPGA 游戲控制臺(tái) DSP
Mentor Graphics 推出Olympus-SoC平臺(tái)
- Mentor Graphics公司近日宣布，即將推出針對(duì)低功耗集成電路而新增特性的Olympus-SoC? 平臺(tái)。低功耗功能是高級(jí)技術(shù)工藝的追求目標(biāo)，它充分利用了Olympus-SoC經(jīng)生產(chǎn)實(shí)踐驗(yàn)證的可變異性設(shè)計(jì)[M1] (DFV)架構(gòu)，而該架構(gòu)本身就可以?xún)?yōu)化設(shè)計(jì)模式、制程邊角和工藝中存在的多樣性。結(jié)果是，與傳統(tǒng)的解決方案相比，Olympus-SoC的客戶(hù)在設(shè)計(jì)收斂時(shí)間上比以前快了1到2倍，同時(shí)功耗也降低了30%。 Olympus-SoC低功耗解決方案包括針對(duì)自動(dòng)化多電壓設(shè)計(jì)流程的靈
- 關(guān)鍵字： Mentor Graphics Olympus-SoC
基于FPGA的LVDS高速差分板間接口應(yīng)用
- 隨著ADC器件速率的提高以及FPGA、DSP器件運(yùn)算速度的提升，高速AD和信號(hào)處理系統(tǒng)之間需要進(jìn)行高速、穩(wěn)定的數(shù)據(jù)傳輸，原來(lái)廣泛應(yīng)用CPCI以及FDPD高速總線的帶寬已經(jīng)無(wú)法滿(mǎn)足寬帶接收機(jī)的數(shù)據(jù)傳輸速率要求，成為影響接收機(jī)性能的新瓶頸。針對(duì)這一情況，提出了一種基于LVDS差分接口的DDR傳輸接口，解決了這一瓶頸，并且在實(shí)際硬件平臺(tái)上進(jìn)行了FPGA實(shí)現(xiàn)，達(dá)到了18．4 Gbit／s的接口速率。
- 關(guān)鍵字： FPGA LVDS 差分板 接口應(yīng)用
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