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fpga ip 文章 最新資訊

SiTime為賽靈思(Xilinx) FPGA評估套件提供可編程時脈方案

  • 　　全硅MEMS時脈技術(shù)方案領(lǐng)導(dǎo)公司SiTime Corporation今天宣布賽靈思(Xilinx)在其Virtex?-6 FPGA ML605評估套件, Spartan?-6 FPGA SP601 和SP605 FPGA評估套件上導(dǎo)入了SiTime可編程全硅MEMS振蕩器。全球可編程平臺領(lǐng)導(dǎo)廠商賽靈思公司在這些評估套件中采用了SiTime的 SiT9102高性能差分振蕩器及各種規(guī)格組合的SiT8102可編程高性能振蕩器。 　　
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SiTime為賽靈思FPGA評估套件提供可編程時鐘方案

  • 　　2010年9月15，美國加洲森尼韋爾市-全硅MEMS時鐘技術(shù)方案領(lǐng)導(dǎo)公司SiTime Corporation今天宣布賽靈思(Xilinx)在其Virtex®-6 FPGA ML605評估套件, Spartan®-6 FPGA SP601 和SP605 FPGA評估套件上導(dǎo)入了SiTime可編程全硅MEMS振蕩器。全球可編程平臺領(lǐng)導(dǎo)廠商賽靈思公司在這些評估套件中采用了SiTime的 SiT9102高性能差分振蕩器及各種規(guī)格組合的SiT8102可編程高性能振蕩器。 　　“賽靈
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一種基于FPGA和單片機的掃頻儀設(shè)計與實現(xiàn)

  • 一個網(wǎng)絡(luò)的頻率特性包括幅頻特性和相頻特性，在系統(tǒng)設(shè)計時，各個網(wǎng)絡(luò)的頻率特性對該系統(tǒng)的穩(wěn)定性、工作頻帶...
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基于FPGA分布式算法的濾波器設(shè)計

  • 設(shè)計了FPGA的分布式算法結(jié)構(gòu)和具體的硬件環(huán)境?；贔PGA的分布式算法充分利用FPGA的并行處理特性設(shè)計算法，簡化了濾波器系統(tǒng)設(shè)計。采用了分割查找表技術(shù)，節(jié)省了FPGA硬件資源。對查找表(LUT)中內(nèi)容經(jīng)過相應(yīng)的修改即可方便地實現(xiàn)低通、高通、帶通濾波。對基于FPGA分布式算法的濾波器進行了仿真及工況環(huán)境下的測試實驗。實驗結(jié)果表明，該算法不僅提高了系統(tǒng)運行速度，而且節(jié)省了大量的FPGA資源，還具有極大的靈活性。
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MIPS科技加入臺積電IP聯(lián)盟, 加速客戶產(chǎn)品上市

  • 　　為數(shù)字消費、家庭網(wǎng)絡(luò)、無線、通信和商業(yè)應(yīng)用提供業(yè)界標(biāo)準(zhǔn)處理器架構(gòu)與內(nèi)核的領(lǐng)導(dǎo)廠商美普思科技公司(MIPS Technologies, Inc)宣布，已加入臺積電(TSMC)軟IP聯(lián)盟計劃(Soft IP Alliance Program)，以加速客戶的產(chǎn)品上市時間。通過軟IP計劃，臺積電將提供特定的設(shè)計文件與技術(shù)信息，使MIPS和其它聯(lián)盟伙伴可針對臺積電工藝技術(shù)優(yōu)化 IP 內(nèi)核。這些公司還將根據(jù)臺積電的技術(shù)路線圖展開合作，互相交流IP開發(fā)與工藝技術(shù)，以加快IP的準(zhǔn)備就緒。 　　MIPS科技營銷與業(yè)務(wù)
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一種基于FPGA的雷達脈沖預(yù)分選器設(shè)計

  • 0引言現(xiàn)代電子戰(zhàn)環(huán)境日趨復(fù)雜，信號日趨密集，新體制雷達不斷出現(xiàn)，雷達信號的各個參數(shù)以各種規(guī)律變化，...
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基于SOPC的通用TFT-LCD控制器IP核設(shè)計

  • 在嵌入式系統(tǒng)中，IP核的使用已成為SoPC系統(tǒng)的重要組成部分，針對現(xiàn)有LCD控制器型號之間兼容性差的缺陷，提出了一種基于SoPC Builder工具的參數(shù)化TFT-LCD控制器IP核的設(shè)計方法。用硬件描述語言進行通用TFT-LCD控制器的功能描述，將設(shè)計的控制器以IP核的形式添加到SoPC Builder中去，供SoPC系統(tǒng)設(shè)計使用。進行設(shè)計驗證，結(jié)果表明，該方法具有很好的通用性，也提高了系統(tǒng)的兼容性。
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基于FPGA的語音錄制與回放系統(tǒng)

  • 系統(tǒng)用FPGA實現(xiàn)了I2C總線控制器，以Altera公司的NiosⅡ嵌入式軟處理器為核心，結(jié)合高品質(zhì)數(shù)字信號音頻編／解碼芯片WM8731成功地實現(xiàn)了語音的錄制及回放功能，同時利用Matlab 7．O．4軟件對所采集的語音數(shù)據(jù)進行仿真。系統(tǒng)采用SoPC技術(shù)，自行設(shè)計采集模塊和I2C協(xié)議驅(qū)動模塊，并通過AWALON總線掛裁在Nios軟核上實時高速采集與回放。實踐表明，系統(tǒng)具有集成度高，穩(wěn)定性好，實時性強的特點。
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基于FPGA的PCI總線串口卡設(shè)計

  • 為了方便外部設(shè)備與計算機進行串口通信，提出一種基于FPGA的PCI總線串口卡設(shè)計。利用Altera公司的FPGA芯片EP1C6SQ240實現(xiàn)了串口和PCI總線的連接。介紹了用FPGA實現(xiàn)PCI接口、UART的方法，將PCI接口、UART的核心功能集中在FPGA上，使整個設(shè)計緊湊、小巧。該設(shè)計符合PCI 2.2規(guī)范，傳輸速率高，可廣泛應(yīng)用于各類測試設(shè)備、工廠自動化、有線通信等領(lǐng)域。
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MIPS科技加入臺積電IP聯(lián)盟

  • 　　為數(shù)字消費、家庭網(wǎng)絡(luò)、無線、通信和商業(yè)應(yīng)用提供業(yè)界標(biāo)準(zhǔn)處理器架構(gòu)與內(nèi)核的領(lǐng)導(dǎo)廠商美普思科技公司(MIPS Technologies, Inc)宣布，已加入臺積電(TSMC)軟IP聯(lián)盟計劃(Soft IP Alliance Program)，以加速客戶的產(chǎn)品上市時間。通過軟IP計劃，臺積電將提供特定的設(shè)計文件與技術(shù)信息，使MIPS和其它聯(lián)盟伙伴可針對臺積電工藝技術(shù)優(yōu)化 IP 內(nèi)核。這些公司還將根據(jù)臺積電的技術(shù)路線圖展開合作，互相交流IP開發(fā)與工藝技術(shù)，以加快IP的準(zhǔn)備就緒。 　　
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基于中檔FPGA多相濾波器的設(shè)計實現(xiàn)

  • 基于中檔FPGA多相濾波器的設(shè)計實現(xiàn),　在現(xiàn)代電子系統(tǒng)中，到處都可以看到數(shù)字信號處理( DSP )的應(yīng)用，從MP3播放器、數(shù)碼相機到手機。DSP設(shè)計人員的工具箱的支柱之一是有限脈沖響應(yīng)( FIR )濾波器。FIR濾波器越長(有大量的抽頭)，濾波器的響應(yīng)越好。然而這
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基于FPGA的PCIE總線擴展卡的設(shè)計

  • 基于FPGA的PCIE總線擴展卡的設(shè)計,　PCIE(PCI express)是用來互聯(lián)諸如計算機和通信平臺應(yīng)用中外圍設(shè)備的第三代高性能I/0總線。PCIE體系結(jié)構(gòu)繼承了第二代總線體系結(jié)構(gòu)最有用的特點，采用與PCI相同的使用模型和讀/寫通信模型，支持各種常見的事務(wù)。其存
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FPGA 28納米市場戰(zhàn)火升溫 晶圓代工巨頭激烈角逐

  • 　　可程序邏輯閘陣列芯片(FPGA)雙雄賽靈思(Xilinx)與阿爾特拉 (Altera)先后推出28納米FPGA產(chǎn)品，不僅使FPGA市場戰(zhàn)火升溫，也讓晶圓代工市場激烈角逐，在Xilinx首度與臺積電攜手合作后，Altera在28納米產(chǎn)品的布局上亦相當(dāng)積極，近期亦展示在28納米 FPGA平臺上的25-Gbps收發(fā)器，F(xiàn)PGA雙雄的激烈競賽，預(yù)料臺積電將成為最大受惠者。 　　Altera指出，在28納米FPGA中展示25-Gbps收發(fā)器，是收發(fā)器產(chǎn)品的里程碑，該芯片是Altera用于在28納米FPGA上，
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FPGA 是實現(xiàn)綠色搜索技術(shù)的關(guān)鍵

  • 無論為數(shù)以百萬計的用戶搜索請求提供服務(wù)還是處理超大量的信息，都需要數(shù)量龐大的計算資源，進而消耗大量能源。事實上，用于計算與冷卻的能耗費用是數(shù)據(jù)中心運營的最大成本 [1]。隨著數(shù)據(jù)中心的數(shù)量和規(guī)模不斷增長，
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基于FPGA的棧空間管理器的研究和設(shè)計

  • 摘 要： 提出了一種將堆?？臻g劃分為任務(wù)棧和中斷嵌套棧的設(shè)計結(jié)構(gòu)，使堆?？臻g最小化。采用VHDL硬件語言，在FPGA設(shè)備上模擬實現(xiàn)了具有自動檢驗功能的棧空間管理器。棧空間管理器由不同功能的邏輯模塊組成，主要闡
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