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EEPW首頁 >> 主題列表 >> flash fpga

FPGA最小系統(tǒng)之：最小系統(tǒng)電路分析

  • FPGA的管腳主要包括：用戶I/O（User I/O）、配置管腳、電源、時鐘及特殊應用管腳等。其中有些管腳可有多種用途，所以在設計FPGA電路之前，需要認真的閱讀相應FPGA的芯片手冊。
  • 關鍵字： Cyclone  Altera  Flash  FPGA  CPLD  SDRAM  FPGA最小系統(tǒng)  

FPGA最小系統(tǒng)之：最小系統(tǒng)的概念

  • FPGA最小系統(tǒng)是可以使FPGA正常工作的最簡單的系統(tǒng)。它的外圍電路盡量最少，只包括FPGA必要的控制電路。一般所說的FPGA的最小系統(tǒng)主要包括：FPGA芯片、下載電路、外部時鐘、復位電路和電源。如果需要使用NIOS II軟嵌入式處理器還要包括：SDRAM和Flash。一般以上這些組件是FPGA最小系統(tǒng)的組成部分。
  • 關鍵字： FPGA最小系統(tǒng)  Altera  NiosII  Flash  SDRAM  

基于Xilinx FPGA的嵌入式Linux設計流程

  • 結(jié)合FPGA和Linux雙方優(yōu)勢，可以很好地滿足嵌入式系統(tǒng)設計需求，量體裁衣，去除冗余。本文給出了一種基于Xilinx FPGA的嵌入式Linux操作系統(tǒng)解決方案。
  • 關鍵字： 操作系統(tǒng)加載  Linux  FPGA  

FPGA跨時鐘域異步時鐘設計的幾種同步策略

  • 實際的工程中，純粹單時鐘系統(tǒng)設計的情況很少，特別是設計模塊與外圍芯片的通信中，跨時鐘域的情況經(jīng)常不可避免。如果對跨時鐘域帶來的亞穩(wěn)態(tài)、采樣丟失、潛在邏輯錯誤等等一系列問題處理不當，將導致系統(tǒng)無法運行。本文總結(jié)出了幾種同步策略來解決跨時鐘域問題。
  • 關鍵字： 跨時鐘域  同步時序  FPGA  

基于SPI Flash實現(xiàn)FPGA的復用配置

  • SPI(Serial Peripheral Interface，串行外圍設備接口)是一種高速、全雙工、同步的通信總線，在芯片的引腳上只占用4根線，不僅節(jié)約了芯片的引腳，同時在PCB的布局上還節(jié)省空間。正是出于這種簡單、易用的特性，現(xiàn)在越來越多的芯片集成了這種通信協(xié)議。
  • 關鍵字： 復用編程  SPIFlash  FPGA  

基于FPGA的數(shù)字化變電站計量儀表研究與設計

  • 提出一種基于IEC61850和SoPC的數(shù)字化變電站計量儀表設計方案。在DE2—70開發(fā)板的基礎上，首先依據(jù)IEC61850標準對數(shù)字化變電站計量儀表進行了總體設計；其次對基于FPGA的電量參數(shù)算法進行了研究；最后完成了光纖通信電路、快速以太網(wǎng)接口電路、雙軟核SoPC系統(tǒng)等硬件電路的設計。基于FPGA的數(shù)字化變電站計量儀表設計方案具有設計
  • 關鍵字： 數(shù)字化變電站  SOPC  FPGA  

利用FPGA的M4K作為移位寄存器的邏輯分析儀設計

  • 采用Altera公司的Cyclone系列EPlC3T144C8作為控制芯片，QuartusⅡ為軟件平臺，用硬件描速語言設計了一個具有變頻采樣時鐘和16路采樣通道，基于VGA顯示的邏輯分析僅．該設計方案利用FPGA內(nèi)部的M4K決作為移位寄存器不斷地進行讀進數(shù)據(jù)的方式，提高了工作速度、性能穩(wěn)定性以及分析的范圍和質(zhì)量。該邏輯分析儀實現(xiàn)簡單，價格低，具有較高的使用價值。
  • 關鍵字： 采樣模式  邏輯分析儀  FPGA  

基于FPGA的生物電阻抗成像系統(tǒng)設計

  • 根據(jù)電阻抗斷層成像技術(shù)要求，設計了以Spartan3E系列XC3S500E FPGA為核心的16電極生物電阻抗成像系統(tǒng)，系統(tǒng)嵌入8 bit微處理器PicoBlaze實現(xiàn)邏輯控制并產(chǎn)生激勵信號實現(xiàn)高速A/D采集及實現(xiàn)數(shù)字解調(diào)，通過RS232將采集數(shù)據(jù)傳輸?shù)絇C機，重建人體內(nèi)部的電阻率分布或其變化圖像。為廣泛應用研究電阻抗斷層成像技術(shù)提供一種
  • 關鍵字： Spartan3E  生物電阻抗成像系統(tǒng)  FPGA  

基于FPGA的VLIW微處理器的設計與實現(xiàn)

  • 超長指令字VLIW微處理器架構(gòu)采用了先進的清晰并行指令設計。VLIW微處理器的最大優(yōu)點是簡化了處理器的結(jié)構(gòu)，刪除了處理器內(nèi)部許多復雜的控制電路，它能從應用程序中提取高度并行的指令數(shù)據(jù)，并把這些機器指
  • 關鍵字： VLIW微處理器  并行指令控制  FPGA  

FPGA的雙緩沖模式PCI Express總線設計

  • 介紹了軟件無線電平臺中基于FPGA的雙緩沖模式PCI Express（PCIE）總線的設計與實現(xiàn)。設計了基于Xilinx Virtex6 FPGA的通用軟件無線電平臺，開發(fā)了基于Linux系統(tǒng)的驅(qū)動程序和PCIE硬核的DMA控制器。雙緩沖提高了數(shù)據(jù)傳輸速度，節(jié)約了硬件資源。測試結(jié)果顯示，該系統(tǒng)工作穩(wěn)定可靠，讀寫速度可達402 MB/s。
  • 關鍵字： PCIExpress總線  雙緩沖模式  FPGA  

基于FPGA的模糊控制交通燈控制方案設計

  • 針對目前交叉路口交通控制信號燈的綠信比固定不變的問題，提出一種模糊控制的方案。根據(jù)當前相位的車流量和當前相位與下一相位車流量之差，實時控制相位綠信比，縮減車輛在交叉路口的排隊長度。綠信比可在FPGA上模擬實現(xiàn)，采用EElements ISE Development Kit開發(fā)套件，使用ISE10.1軟件設計工具，對上述控制方案進行仿真。
  • 關鍵字： 模糊控制  交通燈控制方案  FPGA  

基于FPGA的PUSCH信道估計仿真與實現(xiàn)

  • 基于最小平方 (LS) 算法，利用FPGA實現(xiàn)了一種適用于TD-LTE系統(tǒng)的上行信道估計算法。主要研究了如何利用FPGA實現(xiàn)LS算法，包括算法的介紹、方案的形成、FPGA實現(xiàn)的處理流程、FPGA實現(xiàn)結(jié)果及分析。以Virtex-5芯片為硬件平臺，完成了仿真、綜合、板級驗證等工作。實現(xiàn)結(jié)果表明，該信道估計算法應用到TD-LTE系統(tǒng)具有良好的穩(wěn)
  • 關鍵字： PUSCH  信道估計仿真  FPGA  

FPGA設計系統(tǒng)時鐘的影響因素及其分析

  • 時鐘是整個電路最重要、最特殊的信號，系統(tǒng)內(nèi)大部分器件的動作都是在時鐘的跳變沿上進行， 這就要求時鐘信號時延差要非常小， 否則就可能造成時序邏輯狀態(tài)出錯；因而明確FPGA設計中決定系統(tǒng)時鐘的因素，盡量較小時鐘的延時對保證設計的穩(wěn)定性有非常重要的意義。
  • 關鍵字： 信號時延  系統(tǒng)時鐘  FPGA  

一種基于FPGA技術(shù)的紅外視頻采集系統(tǒng)設計

  • 介紹了一種基于FPGA技術(shù)的紅外視頻采集系統(tǒng)組成架構(gòu)，給出了各功能模塊的實現(xiàn)方法,包括主要的HDL代碼、SignaltapII波形以及QuartusII頂層原理，并制作電路板進行調(diào)試，最終的紅外圖像通過VGA實時顯示。結(jié)果表明該系統(tǒng)能充分利用FPGA技術(shù)的優(yōu)勢，具有擴展性好、控制靈活、開發(fā)周期短等特點。
  • 關鍵字： 紅外視頻采集系統(tǒng)  ADV7181B  FPGA  

JavaCard指令處理器的FPGA設計和實現(xiàn)

  • 給出了一種基于微碼的JavaCard指令處理器的FPGA設計和實現(xiàn)，以此JavaCard CPU為核心搭建的測試平臺已集成在一塊FPGA上實現(xiàn)。
  • 關鍵字： JavaCard  復雜指令集  FPGA  
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