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CPLD 實現(xiàn)DDS 信號源的設(shè)計

中文摘要:利用CPLD 在高速數(shù)據(jù)處理方面的特點設(shè)計出以VHDL 硬件描述語言為設(shè)計輸入, 以AL TERA 公司的 EPM 7256 芯片為設(shè)計載體, 基于DDS 技術(shù)的任意波形信號發(fā)生器。該信號發(fā)生器能同時輸出兩路信號, 輸出信號的頻
關(guān)鍵字： CPLD DDS 信號源設(shè)計

基于AD9850的多功能信號源設(shè)計

摘要：AD9850以芯片為多功能信號源頻率合成核心，以單片機(89C52)為控制和數(shù)據(jù)處理核心，實現(xiàn)了正弦波、方波及AM、FM、ASK、FSK、PSK 等調(diào)制波形的產(chǎn)生和輸出。結(jié)合鍵盤和顯示部分，實現(xiàn)了任意頻率值的選擇和顯示，
關(guān)鍵字：多功能信號源 DDS 89c52 AD9850

基于DDS芯片AD9852的雷達回波模擬器設(shè)計

摘要基于直接數(shù)字頻率合成技術(shù)DDS的原理，分析了影響DDS頻率輸出的核心因素。在此基礎(chǔ)上仿真驗證了相位累加器的位數(shù)對DDS頻率輸出的作用。介紹了一種DDS芯片AD9852并基于這種芯片提出了一種雷達回波模擬器的設(shè)計，
關(guān)鍵字： DDS 相位累加器 AD9852

用DDS芯片AD9835開發(fā)的精度頻率信號發(fā)生器

高精度測量往往需采用高精度、高穩(wěn)定性、高分辨率的頻率信號源。采用多個鎖相環(huán)構(gòu)成的頻率合成器，電路復(fù)雜、價格昂貴，且信號建立時間長、動態(tài)特性較差。近年來發(fā)展起來的直接數(shù)字式頻率合成器(DDS)采用高速數(shù)字電
關(guān)鍵字： AD9835 DDS 精度頻率信號發(fā)生器

基于DDS構(gòu)建可調(diào)頻穩(wěn)幅信號發(fā)生器

摘要系統(tǒng)采用基于DDS工作原理的AD9851，以單片機為控制核心，設(shè)計了可產(chǎn)生頻率可調(diào)的穩(wěn)幅高精度正弦波、方波信號發(fā)生器。輸出級通過橢A濾波器去除高頻噪聲以穩(wěn)定信號，并采用乙類推免功率放大器電路以提高系統(tǒng)的負
關(guān)鍵字： DDS 橢圓濾波器乙類推免功率放大器

基于DDS的多路任意波形發(fā)生器的設(shè)計與實現(xiàn)

摘要：本文采用單片機控制DDS專用芯片(AD9854)設(shè)計了信號發(fā)生器。以AD9854芯片為核心，詳細分析了該信號發(fā)生器的系統(tǒng)結(jié)構(gòu)、軟硬件設(shè)計和具體電路實現(xiàn)，并介紹了使用單片機STC12LE5A56S2對AD9854的控制方法。信號發(fā)生
關(guān)鍵字：信號發(fā)生器 DDS AD9854 上位機串口通信

基于Verilog的多路相干DDS信號源設(shè)計

摘要：傳統(tǒng)的多路同步信號源常采用單片機搭載多片專用DDS芯片配合實現(xiàn)。該技術(shù)實現(xiàn)復(fù)雜，且在要求各路同步相干可控時難以實現(xiàn)。本文在介紹了DDS原理的基礎(chǔ)上，給出了用Verilog_HDL語言實現(xiàn)相干多路DDS的工作原理、設(shè)
關(guān)鍵字： DDS 現(xiàn)場可編程門陣列(FPGA) 相位累加器 Verilog_HDL

一種射頻信號干擾器的設(shè)計

摘要：為了測試電子設(shè)備的抗干擾能力，設(shè)計了一種射頻信號干擾器，可用于產(chǎn)生406 0～406.1 MHz范圍內(nèi)的隨機干擾、點頻干擾和掃頻干擾信號。設(shè)計采用了直接數(shù)字頻率合成(DDS)技術(shù)，通過單片機對DDS芯片的控制，可靈活
關(guān)鍵字：干擾器隨機干擾點頻干擾掃頻干擾 DDS

基于DDS技術(shù)的波形設(shè)計

針對數(shù)字基帶信號的特點和通信系統(tǒng)對信號傳輸?shù)囊螅肈DS數(shù)字頻率合成技術(shù)進行波形設(shè)計。采用了ADI公司的AD9958芯片為核心設(shè)計實現(xiàn)了全數(shù)字頻率合成器，構(gòu)建了具備FSK調(diào)制，PSK調(diào)制及線性掃描功能的全數(shù)字通信系統(tǒng)。詳細介紹了該通信系統(tǒng)的主要構(gòu)成和實現(xiàn)全數(shù)字波形設(shè)計的軟件控制方式，使其具備多種信號形式，較寬的工作頻帶、根據(jù)工作需要隨時變換波形的功能。該系統(tǒng)具有可重復(fù)編程和動態(tài)重構(gòu)的優(yōu)點，使其易于修改，靈活可控，可適用于通信工程實踐中。
關(guān)鍵字： DDS 波形設(shè)計 FSK PSK 線性掃描調(diào)制 AD9958

基于ARM與DDS的高精度正弦信號發(fā)生器設(shè)計

隨著電子技術(shù)的不斷發(fā)展與進步，現(xiàn)代的電子測量、通信系統(tǒng)越來越需要有高精度和靈活的正弦信號源進行測量和調(diào)試。為了滿足外場試驗對便攜式信號發(fā)生器的需要，利用直接數(shù)字合成技術(shù)，通過ARM芯片STM32實現(xiàn)對DDS芯片ML2035的控制，產(chǎn)生從0～25 kHz的正弦信號。結(jié)論表明，使用ARM和ML2035構(gòu)成的正弦信號源的頻率具有精度高的特點，設(shè)計方法對于特定場合的應(yīng)用具有借鑒意義。
關(guān)鍵字：正弦信號源 STM32 DDS ML2035

基于實驗系統(tǒng)采用電路可動態(tài)重組的設(shè)計方案

0 引言“ 數(shù)字電路與邏輯設(shè)計”、“ 可編程邏輯器件與應(yīng)用”、“單片機原理與應(yīng)用”是電子類相關(guān)專業(yè)的重要專業(yè)課程，在電工電
關(guān)鍵字： DDS PLD 單片機

實驗挑戰(zhàn)：利用MSP430制作一個DDS

　　電路圖也可見：　　　　連線說明：　　MCU-1602(1602可以用4根數(shù)據(jù)線，傳2次數(shù)據(jù)，編程稍微復(fù)雜點) 　　----------- 　　PC0-RS 　　PC1-RW 　　PC2-E 　　PC4-D4 　　PC5-D5 　　PC6-D6 　　PC7-D7 　　MCU-Key 　　-------------- 　　PD0-DOWN 　　PD1-LEFT 　　PD2-START 　　PD3-RIGHT 　　PD4-UP 　　PD5-HS
關(guān)鍵字： MSP430 DDS

基于DDS驅(qū)動PLL結(jié)構(gòu)的寬帶頻率合成器設(shè)計

　　結(jié)合數(shù)字式頻率合成器(DDs)和集成鎖相環(huán)(PLL)各自的優(yōu)點，研制并設(shè)計了以DDS芯片AD9954和集成鎖相芯片ADF4113構(gòu)成的高分辨率、低雜散、寬頻段頻率合成器，并對該頻率合成器進行了分析和仿真，從仿真和測試結(jié)果看，該頻率合成器達到了設(shè)計目標(biāo)。該頻率合成器的輸出頻率范圍為 594～999 MHz，頻率步進為5 Hz，相位噪聲為-91dBc。　　　　DDS的參考信號由晶振產(chǎn)生，其頻率為fref。DDS輸出的信號頻率為fDDS，頻率值由頻率控制字(FTW)控制。鎖相環(huán)
關(guān)鍵字： DDS PLL

基于STM32的雙路信號源及配置平臺設(shè)計

　　隨著在雷達探測、儀表測量、化學(xué)分析等領(lǐng)域研究的不斷深入，不僅要求定性的完成目標(biāo)檢測，更加需要往高精度、高分辨率成像的方向發(fā)展。一方面，產(chǎn)生頻率、幅度靈活可控，尤其是低相位噪聲、低雜散的頻率源對許多儀器設(shè)備起著關(guān)鍵作用。另一方面，電子元器件實際性能參數(shù)并非理想以及來存在自外部內(nèi)部的干擾，大量的誤差因素會嚴(yán)重影響系統(tǒng)的準(zhǔn)確性。雙路參數(shù)可調(diào)的信號源可有效地對系統(tǒng)誤差、信號通道間不平衡進行較調(diào)，并且可以產(chǎn)生嚴(yán)格正交或相關(guān)的信號，這在弱信號檢測中發(fā)揮重要作用。為此本文采用雙通道DDS方法，以STM32為控
關(guān)鍵字： STM32 DDS

FPGA和DDS在信號源中的應(yīng)用

　　1引言　　DDS同DSP(數(shù)字信號處理)一樣，是一項關(guān)鍵的數(shù)字化技術(shù)。DDS是直接數(shù)字式頻率合成器(DirectDigitalSynthesizer)的英文縮寫。與傳統(tǒng)的頻率合成器相比，DDS具有低成本、低功耗、高分辨率和快速轉(zhuǎn)換時間等優(yōu)點，廣泛使用在電信與電子儀器領(lǐng)域，是實現(xiàn)設(shè)備全數(shù)字化的一個關(guān)鍵技術(shù)。在各行各業(yè)的測試應(yīng)用中，信號源扮演著極為重要的作用。但信號源具有許多不同的類型，不同類型的信號源在功能和特性上各不相同，分別適用于許多不同的應(yīng)用。目前，最常見的信號源類型包括任意波形發(fā)生器，函數(shù)發(fā)
關(guān)鍵字： FPGA DDS

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dds介紹

DDS的簡單介紹　　DDS同 DSP（數(shù)字信號處理）一樣，是一項關(guān)鍵的數(shù)字化技術(shù)。DDS是直接數(shù)字式頻率合成器（Direct Digital Synthesizer）的英文縮寫。與傳統(tǒng)的頻率合成器相比，DDS具有低成本、低功耗、高分辨率和快速轉(zhuǎn)換時間等優(yōu)點，廣泛使用在電信與電子儀器領(lǐng)域，是實現(xiàn)設(shè)備全數(shù)字化的一個關(guān)鍵技術(shù)。　　一塊DDS芯片中主要包括頻率控制寄存器、高速相位累加器和正弦計算 [ 查看詳細 ]