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EEPW首頁 >> 主題列表 >> dds-11a型實驗室電導率

dds-11a型實驗室電導率 文章 進入dds-11a型實驗室電導率技術社區(qū)

一種改善雜散的DDS頻率合成器

  • 摘 要：相位舍位及量化噪聲引起的雜散問題一直是數(shù)字頻率合成器研究的重點。針對雜散問題，使用了修正頻率控制字和相位抖動兩種技術，再結合延遲疊加方法，很好地降低了幅度量化雜散和相位舍位雜散，提高了系統(tǒng)的信噪
  • 關鍵字： DDS  頻率合成器    

DDS技術在機場助航燈恒流調(diào)光器系統(tǒng)中的應用

  • 機場助航燈恒流調(diào)光器系統(tǒng)要求輸出電壓的波形總諧波含量小，穩(wěn)壓穩(wěn)頻精度高。本文提出了一種基于DDS技術的SPWM波形產(chǎn)生方法。通過DDS頻率合成的數(shù)學模型，介紹了在助航燈恒流調(diào)光器系統(tǒng)中基于DDS理論在TMS320LF2407A上實現(xiàn)SPWM波形的原理和方法及利用LF2407A的EVA模塊生成SPWM波形的簡便性，并通過實驗進行了驗證，對機場助航燈新型調(diào)光器的設計具有重要的參考意義。
  • 關鍵字： DDS  恒流  調(diào)光器  系統(tǒng)    

基于ARM和FPGA的聲納波形產(chǎn)生系統(tǒng)設

  • 基于ARM和FPGA的聲納波形產(chǎn)生系統(tǒng)設,1、引言　　最佳聲納系統(tǒng)的設計需要從聲納波形、聲納信道和聲納接收機三方面進行綜合考慮[1]。在聲納信道一定的假設下，需要設計最佳聲納波形和最佳接收機，使聲納系統(tǒng)能在給定的聲納環(huán)境中對目標有最佳的檢測效果。
  • 關鍵字： 產(chǎn)生  系統(tǒng)  波形  聲納  ARM  FPGA  基于  ARM  FPGA  聲納波形產(chǎn)生系統(tǒng)  DDS  軟件  

基于DDS芯片AD9850的全數(shù)控函數(shù)信號發(fā)生器的設計與

  • 信號源是電子產(chǎn)品測量與調(diào)試、部隊設備技術保障等領域的基本電子設備。隨著科學技術的發(fā)展和測量技術的進步，普通的信號發(fā)生器已無法滿足目前日益發(fā)展的電子技術領域的生產(chǎn)調(diào)試需要。而DDS技術是一種新興的直接數(shù)字頻率合成技術，具有頻率分辨率高、頻率切換速度快、切換相位連續(xù)、輸出信號相位噪聲低、可編程、全數(shù)字化易于集成、體積小、重量輕等優(yōu)點，因而在雷達及通信等領域具有廣泛的應用前景。


  • 關鍵字： 9850  DDS  AD  芯片    

基于DDS技術的智能信號發(fā)生器的設計

  •         引言         變壓器繞組變形測試儀是保證電力系統(tǒng)安全運行的重要儀器之一，它需要程控的高精度的正弦信號才能正常工作。智能信號源為其提供了頻率按步長值可自動更新輸出的掃頻信號，其性能的特點直接影響著變壓器繞組變形測試儀的研發(fā)工作。傳統(tǒng)的方法往往采取壓控振蕩器或分離模塊組成的“直接數(shù)字頻率合成器”（DDS）,但這些方法大
  • 關鍵字： DDS  AD9850  信號發(fā)生器  功率放大   

基于DDS的頻譜分析儀的設計與應用

  • 1 引言 　　直接數(shù)字頻率合成(DDS)是近幾年一種新型的頻率合成法，其具有頻率切換速度快，頻率分辨率高，以及便于 ...
  • 關鍵字： DDS  頻譜分析儀  現(xiàn)場可編程門陣列    

基于DDS的頻譜分析儀設計

  • 　　1 引言 　　直接數(shù)字頻率合成(DDS)是近幾年一種新型的頻率合成法，其具有頻率切換速度快，頻率分辨率高，以及便于集成等優(yōu)點。在此，設計了基于DDS的頻譜分析儀，該頻譜分析儀依據(jù)外差原理，被測信號與本征頻率混頻，實現(xiàn)信號的頻譜分析。 　　2 系統(tǒng)設計 　　圖1給出系統(tǒng)設計框圖，主要由本機振蕩電路、混頻電路、放大檢波電路、頻譜輸出顯示電路等組成。通過單片機和現(xiàn)場可編程門陣列(FPGA)共同控制AD985l，以產(chǎn)生正弦掃頻輸出信號，然后經(jīng)濾波、程控放大得到穩(wěn)定輸出，與經(jīng)放大處理的被測信號混頻，再經(jīng)放
  • 關鍵字： DDS  頻譜分析儀  

基于DDS的8051F330囀音信號發(fā)生器

  • 通過對囀音信號進行簡化處理。將復雜的囀音信號轉換為簡單的純音信號。在此基礎上，利用DDS技術對純音信號進行數(shù)字化處理，并通過CVI強大的信號分析和處理函數(shù)得到單周期純音信號所對應的離散幅值。同時設計了硬件電路。對構造的囀音信號進行輸出。此外，還提出了對該系統(tǒng)進行拓展的可行性及優(yōu)化的著眼點。
  • 關鍵字： 信號發(fā)生器  8051F330  DDS  基于  數(shù)字處理  8051F330  放大器  單片機  

基于FPGA+DDS的控制設計

  • 為了滿足目前對數(shù)據(jù)處理速度的需求，設計了一種基于FPGA+DDS的控制系統(tǒng)。闡述了系統(tǒng)硬件實現(xiàn)方法，給出了相關的軟件設計例程。并對DDS AD9911各個控制寄存器的設置與時序進行詳細說明，最后給出了實驗結果。
  • 關鍵字： FPGA  DDS  控制設計    

一種基于DDS的幅值可調(diào)信號發(fā)生器的設計

  • 提出了一種基于DDS(Direct Digital Synthesize)AD9850的頻率、相位、幅值均可調(diào)節(jié)的正弦信號發(fā)生器。該正弦信號發(fā)生器采用AT89S52單片機為控制器，D／A轉換器TLC5615與乘法器AD534相結合。實現(xiàn)輸出正弦信號幅值可控，采用AD8ll控制輸出正弦信號電壓幅值，產(chǎn)生50 H2~3 kHz頻段的正弦波，步進頻率為50 Hz。該信號發(fā)生器可應用在交變磁場測量儀和試驗儀器、工程設計的函數(shù)發(fā)生器中。
  • 關鍵字： DDS  可調(diào)  信號發(fā)生器  設計  基于  模擬  AD9850  TLC5615  

基于DDS的數(shù)字PLL

  • 　　多年以來，作為業(yè)界主流產(chǎn)品的模擬PLL已被熟知，模擬PLL性能穩(wěn)定，可為頻率合成和抖動消除提供低成本的解決方案，工作頻率高達8GHz及以上。然而新興的基于直接數(shù)字頻率合成（DDS）的數(shù)字PLL在某些應用中極具競爭力。本文比較了模擬PLL和基于DDS的數(shù)字PLL之間的差異，以及如何利用這些差異來指導設計人員選擇最佳的解決方案。 　　數(shù)字PLL利用數(shù)字邏輯實現(xiàn)傳統(tǒng)的PLL模塊。雖然實現(xiàn)數(shù)字PLL的方法有很多，但本文只介紹基于DDS的數(shù)字PLL架構。   　　圖1 典型的模擬PLL結構框圖
  • 關鍵字： PLL  DDS  分頻器  鑒相器  DAC  VCO  

基于FPGA的直接數(shù)字頻率合成器的設計實現(xiàn)

基于DDS的數(shù)字PLL

  • 　　多年以來，作為業(yè)界主流產(chǎn)品的模擬PLL已被熟知，模擬PLL性能穩(wěn)定，可為頻率合成和抖動消除提供低成本的解決方案，工作頻率高達8GHz及以上。然而新興的基于直接數(shù)字頻率合成（DDS）的數(shù)字PLL在某些應用中極具競爭力。 　　數(shù)字PLL利用數(shù)字邏輯實現(xiàn)傳統(tǒng)的PLL模塊。雖然實現(xiàn)數(shù)字PLL的方法有很多，但本文只介紹基于DDS的數(shù)字PLL架構。 圖1 典型的模擬PLL結構框圖 　　圖1所示的是典型的模擬PLL。輸入信號首先進入?yún)⒖挤诸l器，參考分頻器可降低輸入鑒相器的信號頻率。在PLL中，參考分頻器的
  • 關鍵字： DDS  數(shù)字PLL  

基于C8051F060單片機控制AD9833實現(xiàn)FSK調(diào)制

  • 　　引言  　　在數(shù)字信息傳輸中，基帶數(shù)字信號通常要經(jīng)過調(diào)制器調(diào)制，將頻率搬移到適合信息傳輸?shù)念l段上。2FSK就是用數(shù)字信號去調(diào)制載波的頻率（移頻鍵控），由于它具有方法簡單、易于實現(xiàn)、抗噪聲和抗衰落性能較強等優(yōu)點，因此在現(xiàn)代數(shù)字通信系統(tǒng)的低、中速數(shù)據(jù)傳輸中得到了廣泛應用。 　　直接數(shù)字頻率合成技術(DDS)將先進的數(shù)字處理技術與方法引入信號合成領域。DDS器件采用高速數(shù)字電路和高速D/A轉換技術，具備頻率轉換時間短、頻率分辨率高、頻率穩(wěn)定度高、輸出信號頻率和相位可快速程控切換等優(yōu)點，可以
  • 關鍵字： 數(shù)字信號  調(diào)制器  DDS  單片機控  
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