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EEPW首頁 >> 主題列表 >> arm+fpga

基于FPGA的RISC微處理器的設(shè)計與實現(xiàn)

  • 基于FPGA和電子設(shè)計自動化技術(shù)，采用模塊化設(shè)計的方法和VHDL語言，設(shè)計一個基于FPGA的RISC微處理器。
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基于FPGA的微處理器內(nèi)核設(shè)計與實現(xiàn)

  • 與傳統(tǒng)投片實現(xiàn)ASIC相比，F(xiàn)PGA具有實現(xiàn)速度快、風險小、可編程、可隨時更改升級等一系列優(yōu)點，因而得到了越米越廣泛的應用。MCS-51應用時間長、范圍廣，相關(guān)的軟硬件資源豐富，因而往往在FPGA應用中嵌人MCS-51內(nèi)核作為微控制器。但是傳統(tǒng)MCS-51的指令效率太低，每個機器周期高達12時鐘周期，因此必須對內(nèi)核加以改進，提高指令執(zhí)行速度和效率，才能更好地滿足FPGA的應用。 通過對傳統(tǒng)MCS-51單片機指令時序和體系結(jié)構(gòu)的分析，使用VHDL語言采用自頂向下的設(shè)計方法重新設(shè)計了一個高效的微控制器內(nèi)核
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采用軟處理器IP規(guī)避器件過時的挑戰(zhàn)

  • 在向一個嵌入式產(chǎn)品設(shè)計做出幾年的財力和物力投資之后，你最不愿意聽到的消息就是你所采用的器件已經(jīng)“生命終止”。在分立的嵌入式處理中，陳舊過時意味著你必須為你的下一個設(shè)計轉(zhuǎn)向采用另外一種處理器，并且完全可能要重新設(shè)計你想在市場中保持的現(xiàn)有產(chǎn)品。即使是半導體行業(yè)中的巨頭，也并不是總能夠為所有類型的應用找到利用個別分立解決方案的途徑。許多最終產(chǎn)品無法證明采用特定的分立器件是恰當?shù)?，因此，隨著時間的推移，甚至長期供應商也會在不合適的時間停止為他們的客戶提供器件支持。 英特爾公司最近宣布他們將退出嵌入式市場。在1
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在Ubuntu上建立Arm Linux 開發(fā)環(huán)境

  • 電子產(chǎn)品世界,為電子工程師提供全面的電子產(chǎn)品信息和行業(yè)解決方案,是電子工程師的技術(shù)中心和交流中心,是電子產(chǎn)品的市場中心,EEPW 20年的品牌歷史,是電子工程師的網(wǎng)絡(luò)家園
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2007年5月22日，ARM與英蓓特推出中國版RealView開發(fā)工具包

  • 　　2007年5月22日 ARM與英蓓特推出中國版RealView微控制器開發(fā)工具包, 加速基于ARM處理器的微控制器軟件開發(fā)。
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利用Virtex-5 FPGA實現(xiàn)更高的性能

  • 在FPGA系統(tǒng)設(shè)計中，要達到性能最大化需要平衡具有混合性能效率的元器件，包括邏輯構(gòu)造(fabric)、片上存儲器、DSP和I/O帶寬。在本文中，我將向你解釋怎樣能在追求更高系統(tǒng)級性能的過程中受益于Xilinx® 的Virtex™-5 FPGA構(gòu)建模塊，特別是新的ExpressFabric™技術(shù)。以針對邏輯和算術(shù)功能的量化預期性能改進為例，我將探究ExpressFabric架構(gòu)的主要功能?；趯嶋H客戶設(shè)計的基準將說明Virtex-5ExpressFabric技術(shù)性能平均比前一
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FPGA與DSP的高速通信接口設(shè)計與實現(xiàn)

  • 在雷達信號處理、數(shù)字圖像處理等領(lǐng)域中，信號處理的實時性至關(guān)重要。由于FPGA芯片在大數(shù)據(jù)量的底層算法處理上的優(yōu)勢及DSP芯片在復雜算法處理上的優(yōu)勢，DSP+FPGA的實時信號處理系統(tǒng)的應用越來越廣泛。ADI公司的TigerSHARC系列DSP芯片浮點處理性能優(yōu)越，故基于這類。DSP的DSP+FPGA處理系統(tǒng)正廣泛應用于復雜的信號處理領(lǐng)域。同時在這類實時處理系統(tǒng)中，F(xiàn)PGA與DSP芯片之間數(shù)據(jù)的實時通信至關(guān)重要。 TigerSHARC系列DSP芯片與外部進行數(shù)據(jù)通信主要有兩種方式：總線方式和鏈路口方式。鏈路
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鳳凰微電子獲ARM7TDMI授權(quán) 用于MEGAFLASH SIM卡片上系統(tǒng)

  • 　　ARM公司宣布，中國本土新興fabless設(shè)計公司鳳凰微電子（中國）有限公司（鳳凰微電子）通過ARM® 代工廠計劃獲得ARM7TDMI® 處理器授權(quán)。鳳凰微電子新型片上系統(tǒng)現(xiàn)已上市，是為megaflash SIM卡應用而設(shè)計的，并已獲得了中國本土運營商的支持。鳳凰微電子通過ARM DesignStart™ Program開始基于ARM技術(shù)的設(shè)計，現(xiàn)在正在將其已經(jīng)驗證的研發(fā)成果推向市場。 　　ARM DesignStart Program起步于2005年4月，已經(jīng)幫助許多中
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2007年5月17日，鳳凰微電子獲得ARM7 TDMI處理器授權(quán)

  • 　　2007年5月17日 鳳凰微電子獲得ARM7TDMI處理器授權(quán), 用于MegaFlash SIM卡片上系統(tǒng), 中國新興fabless公司借助ARMDesignStart Program量產(chǎn)先進片上系統(tǒng)。
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面向FPGA的ESL工具

  • 邏輯設(shè)計領(lǐng)域正在發(fā)生根本變化。新一代設(shè)計工具幫助軟件開發(fā)者將其算法表達直接轉(zhuǎn)換成硬件，而無需學習傳統(tǒng)的硬件設(shè)計技術(shù)。 這些工具及相關(guān)設(shè)計方法學一起被歸類為電子系統(tǒng)級 (ESL) 設(shè)計，廣泛地指從比目前主流的寄存器傳輸級 (RTL) 更高的抽象級別上開始的系統(tǒng)設(shè)計與驗證方法學。與硬件語言如 Verilog 和 VHDL比起來，ESL 設(shè)計語言在語法和語義上與流行的 ANSI C 比較接近。 ESL 與 FPGA 有何關(guān)系？ ESL 工具已經(jīng)存在了一段時間，而許多人覺得這些工具主要專注于 ASIC 設(shè)計
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賽靈思宣布SPARTAN-3A I/O優(yōu)化FPGA全線產(chǎn)品實現(xiàn)量產(chǎn)

  • 　　賽靈思公司（Xilinx, Inc. ）今天宣布90nm I/O優(yōu)化的Spartan™-3A平臺全線產(chǎn)品實現(xiàn)量產(chǎn)。這些產(chǎn)品包括Spartan-3A平臺的全部五款器件：XC3S50A、XC3S200A、XC3S400A、XC3S700A和XC3S1400A。 　　隨著產(chǎn)品架構(gòu)的不斷演進和成本的迅速降低，賽靈思Spartan系列FPGA自從1998年推出以來，應用范圍不斷擴展，目前已經(jīng)成為全球消費電子和汽車應用設(shè)計人員的首選器件平臺。其主要應用包括數(shù)字顯示、手機、PDA、汽車后座娛樂系統(tǒng)和
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采用靈活的汽車FPGA來提高片上系統(tǒng)級集成和降低物料成本

  • 汽車制造商們堅持不懈地改進車內(nèi)舒適性、安全性、便利性、工作效能和娛樂性，反過來，這些努力又推動了各種車內(nèi)數(shù)字技術(shù)的應用。然而，汽車業(yè)較長的開發(fā)周期卻很難跟上最新技術(shù)的發(fā)展，尤其是一直處于不斷變化中的車內(nèi)聯(lián)網(wǎng)規(guī)范，以及那些來自消費市場的快速興起和消失的技術(shù)，從而造成了較高的工程設(shè)計成本和大量過時。向這些組合因素中增加低成本目標、擴展溫度范圍、高可靠性與質(zhì)量目標和有限的物理板空間，以及汽車設(shè)計中存在的挑戰(zhàn)，最多使人進一步感到沮喪?？删幊踢壿嬈骷?nbsp;(PLD)，如現(xiàn)場可編程門陣列 (FPGA)
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Actel推出業(yè)界最低功耗的FPGA系列——IGLOO

  • 　　Actel 公司宣布推出業(yè)界最低功耗的現(xiàn)場可編程門陣列 (FPGA) -- IGLOO™ 系列。這個以 Flash 為基礎(chǔ)的產(chǎn)品系列的靜態(tài)功耗為5µW，是最接近競爭產(chǎn)品功耗的四分之一；與目前領(lǐng)先的PLD產(chǎn)品比較，更可延長便攜式應用的電池壽命達5倍，因而奠定了低功耗的新標準。 　　由于便攜式產(chǎn)品的生命周期短及市場競爭激烈，設(shè)計人員必需不斷增加新的功能和復雜性，但卻不能耗用更多的電池能量。這個需求使到可重編程及全功能的Actel IGLOO 方案別具吸引力，足以取代ASIC和 C
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基于ARM體系的嵌入式系統(tǒng)BSP的程序設(shè)計方案

  • 電子產(chǎn)品世界,為電子工程師提供全面的電子產(chǎn)品信息和行業(yè)解決方案,是電子工程師的技術(shù)中心和交流中心,是電子產(chǎn)品的市場中心,EEPW 20年的品牌歷史,是電子工程師的網(wǎng)絡(luò)家園
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ARM指令中的條件代碼

  • ARM指令集中所有ARM指令都是可以帶條件執(zhí)行的。下面是條件代碼的列表: EQ : 等于 如果一次比較之后設(shè)置了 Z 標志。 　 NE : 不等于 如果一次比較之后清除了 Z 標志。 　 VS : 溢出設(shè)置 如果在一次算術(shù)操作之后設(shè)置了 V 標志，計算的結(jié)果不適合放入一個 32bit 目標寄存器中。 　 VC : 溢出清除 如果清除了 V 標志，與 VS 相反。 　 HI : 高于(無符號) 如果一次比較之后設(shè)置了 C 標志并清除了 Z 標志。 　 LS : 低于或同于(無符號) 如果一次比較操作之后
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