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基于Wishbone和端點IP的PCIE接口設(shè)計

  • 摘要：介紹了FPGA內(nèi)嵌的PCI Express硬核端點模塊和Wishbone片上總線規(guī)范。應(yīng)用VHDL語言，編程實現(xiàn)了Wishbone總線的主從端口，以及TLP包的編碼和解碼功能。在FPGA上運行程序并使用Chipscope測試時序波形，驗證了接口數(shù)
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基于片內(nèi)WISHBONE總線的高速緩存一致性實現(xiàn)

  • 基于片內(nèi)WISHBONE總線的高速緩存一致性實現(xiàn),摘要：基于IP可重用的設(shè)計方法，利用WISHBONE總線協(xié)議，把兩個已成功開發(fā)出的具有自主知識產(chǎn)權(quán)的THUMP內(nèi)核在一個芯片上，實現(xiàn)了片上多處理器FPGA。開發(fā)重點是實現(xiàn)基于片內(nèi)WISHBONE總線的高速緩存一致性協(xié)議。關(guān)鍵詞：
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基于FPGA的SDX總線與Wishbone總線接口設(shè)計

  • 摘要 針對機載信息采集系統(tǒng)可靠性、數(shù)據(jù)管理高效性以及硬件成本的需求，介紹了基于硬件描述語言Verilog HDL設(shè)計的SDX總線與Wishbo ne總線接口轉(zhuǎn)化的設(shè)計與實現(xiàn)，并通過Modelsim進行功能仿真，在QuartusⅡ軟件平臺上綜
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基于Wishbone總線的UART IP核設(shè)計

  • 摘要：介紹了一種基于Wishbone總線的UART IP核的設(shè)計方法。該設(shè)計采用了自頂向下的模塊化劃分和有限狀態(tài)機相結(jié)合的方法，由于其應(yīng)用了標(biāo)準的Wishbone總線接口，從而使微機系統(tǒng)與串行設(shè)備之間的通信更加靈活方便。驗證
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Altium推出最新版一體化電子產(chǎn)品設(shè)計解決方案

  • 　　日前，Altium 宣布推出擁有 100 多項新特性的最新版一體化電子產(chǎn)品設(shè)計解決方案，從而使截然不同的設(shè)計領(lǐng)域進一步實現(xiàn)了關(guān)聯(lián)融合。 　　首次實現(xiàn)與機械領(lǐng)域的真正協(xié)作 　　電子產(chǎn)品通常需要某種形式的包裝與外殼，但傳統(tǒng)上電子設(shè)計人員與機械設(shè)計人員之間鮮有聯(lián)系。要將電子產(chǎn)品放進機械外殼中，過去更多是靠運氣，而非通過良好的管理來實現(xiàn)。 　　Altium 推出了一款可真正解決這些問題的高效解決方案，能將電子設(shè)計 (ECAD) 與外殼的機械設(shè)計 (MCAD) 工作相互匹配聯(lián)系，徹底改變了現(xiàn)狀。如今，電子
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基于Wishbone片上總線的PCI Bridge核的研究和應(yīng)

  • 討論了PCI主橋的應(yīng)用和Wishbone片上總線技術(shù)，詳細介紹了基于Wishbone總線的PCI Bridge核的功能、內(nèi)部結(jié)構(gòu)和操作方式。實驗證明，在PCI系統(tǒng)中使用PCI Bridge核進行開發(fā)設(shè)計，電路簡潔，使用方便靈活。
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