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EEPW首頁(yè) >> 主題列表 >> 仿真測(cè)試

門(mén)電路延遲時(shí)間的Multisim仿真測(cè)試方案

  • 摘 要:介紹了用Multisim 仿真軟件測(cè)試門(mén)電路延遲時(shí)間的方法,提出了三種測(cè)試方案,即將奇數(shù)個(gè)門(mén)首尾相接構(gòu)成環(huán)形振蕩電路,用虛擬示波器測(cè)試所產(chǎn)生振蕩信號(hào)的周期,計(jì)算門(mén)的傳輸延遲時(shí)間;奇數(shù)個(gè)門(mén)首尾相接構(gòu)成環(huán)形
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使用真實(shí)數(shù)據(jù)來(lái)測(cè)試GPS接收機(jī)

80C51原始IP核內(nèi)部RAM的擴(kuò)展方案

  •   引 言   80C51系列單片機(jī)是一類(lèi)經(jīng)典的8位微處理器,其設(shè)計(jì)方法和體系結(jié)構(gòu)一直是其他各類(lèi)單片機(jī)設(shè)計(jì)的參考典范,自從20世紀(jì)80年代面世以后,得到了極大的發(fā)展與應(yīng)用。直到今天,市場(chǎng)上還有一大部分單片機(jī)應(yīng)用成品將其作為處理核心?;?0C51系列單片機(jī)無(wú)知識(shí)產(chǎn)權(quán)保護(hù)、市場(chǎng)應(yīng)用廣泛等優(yōu)點(diǎn),對(duì)其進(jìn)行功能拓展,既有利于經(jīng)濟(jì)上節(jié)約成本,也有利于成果的推廣使用。而隨著單片機(jī)應(yīng)用日趨復(fù)雜化,傳統(tǒng)的51系列單片機(jī)在設(shè)計(jì)上的不足逐漸顯現(xiàn)出來(lái)。如在現(xiàn)有128字節(jié)內(nèi)部RAM基礎(chǔ)上,處理一些比較復(fù)雜的算法就顯不足。鑒于此
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