- 1 引言目前，嵌入式系統(tǒng)在家電、移動電話、PDA等各種領域的應用日益廣泛，程序設計也越來越復雜，這就需要采用一個通用的嵌入式操作系統(tǒng)來對其進行管理和控制。移植了操作系統(tǒng)的嵌入式系統(tǒng)開發(fā)，可大大減輕程序員的負
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ARM7 移植 C/OS-II µ 操作系統(tǒng) 實時
- 硅產品知識產權(SIP)平臺解決方案和數字信號處理器(DSP)內核授權廠商CEVA公司推出高能效1 GHz DSP內核CEVA-X1643，新產品可提升有線和無線通信、安防監(jiān)控、便攜多媒體等廣泛應用的總體芯片性能。CEVA-X1643是CEVA-X
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提供 出色 通信 功能 SoC 多媒體 可編程 DSP 內核 基于
- 據美國的一家市場調研與咨詢機構MarketsandMarkets的一份市場調查報告顯示，預計半導體知識產權(IP)市場的銷售額將由2012年的25億美元增長到2017年的57億美元，復合年增長率高于14%。
調查報告指出，半導體知識產權市場的增長分別體現在集成電路IP和片上系統(tǒng)IP兩個領域，但預計片上系統(tǒng)IP的總收入的增長幅度將會更大，復合年增長率將在19%左右。其中，集成電路和片上系統(tǒng)中的FPGA和PLD的增長是最快的，達到21.16%，其總銷售額緊隨SoC處理器IP之后，位居第二。
報
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半導體 SoC
- Alliacense今天宣布，瑞薩電子(Renesas Electronics Corporation)已經向TPL Group購買了FastLogic組合授權許可證。瑞薩總部位于日本，是全球第一大微控制器供應商，同時也是微控制器、系統(tǒng)芯片(SoC)解決方案和一系列模擬與電源裝置等先進半導體解決方案的首要供應商。
自該項授權計劃于2007年推出以來，全球已經有30多家電子領先企業(yè)—包括三星(Samsung)、摩托羅拉(Motorola)、飛利浦(Philips)、通用電氣(GE)和諾
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瑞薩 SoC
- 擁有模擬和數字領域的優(yōu)勢技術、提供領先的混合信號半導體解決方案的供應商 IDT? 公司 (Integrated Device Technology, Inc.; NASDAQ: IDTI) 宣布推出針對智能電網應用的全球最先進單相電能計量 SoC。該器件擁有業(yè)界最寬的動態(tài)范圍和前所未有的集成度，幫助智能電表制造商在提高精度的同時簡化設計并降低整個系統(tǒng)成本。
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IDT SoC 智能電表
- 基于LPC2214和μCOS-II的iButton接口,iButton(信息鈕扣)的物理結構是一個封裝在扁圓型不銹鋼外殼里的直徑為16 mm、厚度為3～6 mm的微型計算機晶片，是一種攜帶自動識別號的電子數據標簽。先進的設計理念及封裝形式賦予了iButton超強的抗沖擊、防靜電、防
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接口 iButton COS-II LPC2214 基于
- 要實現能夠將所有重要功能集成在單一器件的設計理由很簡單，因為這樣就能將材料成本、部件庫存及電路板面積減至最低。另外，相較于多芯片解決方案，單芯片方案的功耗也較低，同時也有助于提高對知識產權的保護。如果
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FPGA SOC 混合信號 單芯片
- 上網本已經失勢，但是Atom處理器的前途依然光明。根據最新消息，下一代Bay Trail平臺將采用真正的SoC片上系統(tǒng)設計理念，單芯片整合所有模塊，其中處理器核心代號Valleyview。
Bay Trail將首次為Atom家族帶來22nm制造工藝，并會把一直獨立在外的IOH芯片組納入處理器之中，整個平臺其實只要一顆芯片就搞定了，不過注意因為Intel沒有合適的PHY，所以其中不會整合Gb MAC，仍然需要獨立的PCI-E以太網芯片。
頻率方面，標準的四核心(八線程?)型號最高可達1.9G
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SoC Atom
- 用FPGA實現Nios II嵌入式系統(tǒng)配置技術,現場可編程門陣列(FPGA，Field Programmable Gate Array)是一種高密度可編程邏輯器件，其邏輯功能是通過把設計生成的數據文件配置進芯片內部的靜態(tài)配置數據存儲器(SRAM )來實現的，具有可重復編程性，可以靈活實現各
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系統(tǒng) 配置 技術 嵌入式 II 實現 Nios FPGA
- 設計與驗證復雜SoC中可綜合的模擬及射頻模型設計用于SoC集成的復雜模擬及射頻模塊是一項艱巨任務。本文介紹的采用基于性能指標規(guī)格來優(yōu)化設計(如PLL或ADC等)的方法，可確保產生可制造性的魯棒性設計。通過這樣的設計
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SoC 模擬 射頻 模型
- 1. 引言目前，嵌入式語音識別系統(tǒng)的實現主要通過單片機MCU和數字信號處理器DSP來實現[1]。但是單片機運算速度慢，處理能力不高；雖然DSP處理速度很快，但是產品的成本很高，電源能量消耗也很大。因此，為了滿足嵌入式
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SoC 片上系統(tǒng) 語音識別 算法設計
- SoC中CPU總線一般采用應答機制，是非實時的，數據的處理采用中斷響應機制以發(fā)揮效率。處理特定實時數據并沒有固定的延時與穩(wěn)定的吞吐率，因此需要設計一個模塊來處理實時數據到非實時總線之間的平滑過度問題。作者以
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SoC 系統(tǒng) 模塊 設計理念
- 賽普拉斯半導體公司（納斯達克股票代碼：CY）日前宣布立即推出面向 EZ-USB? FX3? 控制器的 GPIF? II Designer 軟件，用以支持 SuperSpeed USB 3.0 功能。GPIF（通用可編程接口）II Designer 可為設計人員提供功能強大且易于使用的圖形界面，用于配置 EZ-USB FX3 的可編程 GPIF II 接口，可以與任何需要 USB 連接功能的微控制器、ASIC、FPGA、圖像傳感器或類似器件進行通信。EZ-USB FX3 是業(yè)界首款，也是唯一一款通過認證的可
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賽普拉斯 USB 3.0 GPIF II Designer
- μC/OS-II在C8051F上的移植,在嵌入式應用中，使用RTOS的最主要原因是提高系統(tǒng)的可靠性，其次是提高開發(fā)效率、縮短開發(fā)周期。mu;C/OS-II 是一個基于優(yōu)先級的搶占式實時內核，支持56 個用戶任務，90%的代碼使用標準的ANSI C語言書寫，程序可讀性
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移植 C8051F C/OS-II
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