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基于FPGA的RS碼譯碼器的設計

  • 摘要：介紹了符合CCSDS標準的RS(255，223)碼譯碼器的硬件實現結構。譯碼器采用8位并行時域譯碼算法，主要包括了修正后的無逆BM迭代譯碼算法，錢搜索算法和Forney算法。采用了三級流水線結構實現，減小了譯碼器的時延
  • 關鍵字： RS碼  FPGA  譯碼器  有限域  改進的BM算法  

基于IP集成的RS碼+DQPSK系統(tǒng)設計

  • 1 引言近年來，無線通信技術得到了飛速發(fā)展，一方面，數字無線通信的新算法和新技術層出不窮；另一方面，無線通信技術的應用范圍也在不斷擴大。為了滿足無線通信技術的飛速發(fā)展，驗證新算法和新技術的正確性和可行性
  • 關鍵字： DQPSK  集成  RS碼  系統(tǒng)設計    

RS編譯碼的一種硬件解決方案

  • 摘  要: 提出了基于歐氏算法和頻譜分析相結合的RS碼硬件編譯碼方法;利用FPGA芯片實現了GF(28)上最高速率為50Mbps、最大延時為640ns的流式譯碼方案,滿足了高速率的RS編譯碼需求。 關鍵詞: RS碼  FPGA  伴隨式  關鍵方程  IDFT 　　差錯控制編碼技術對改善誤碼率、提高通信的可靠性具有重要作用。RS碼既可以糾正隨機錯誤,又可以糾正突發(fā)錯誤,具有很強的糾錯能力,在通信系統(tǒng)中應用廣泛。由于RS碼的譯碼復雜度高,數學運算量大,常
  • 關鍵字： FPGA  RS碼  伴隨式  關鍵方程  IDFT  
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