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EEPW首頁 >> 主題列表 >> 邏輯電平

TTL和CMOS電路解析

  • TTL電平最常用于有關(guān)電專業(yè)，如：電路、數(shù)字電路、微機原理與接口技術(shù)、單片機等課程中都有所涉及。在數(shù)字電路中只有兩種電平(高和低)高電平+5V、低電
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由非同步的邏輯電平產(chǎn)生同步脈沖

可由邏輯電平控制分頻系數(shù)的分頻器

具有TTL邏輯電平輸出的壓控振蕩器

邏輯電平開關(guān)電路

  • 邏輯電平開關(guān)電路如圖所示實驗臺右下方設(shè)有8個開關(guān)K7～K0，開關(guān)撥到“1”位置時開關(guān)斷開，輸出高電平。向下打到“0”位置時開關(guān)接通，輸出低電平。電路中串接了保護電阻使接口電路不直接同＋5V、GND相連，可有效地防止因誤操作...
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信號邏輯電平標(biāo)準(zhǔn)詳解

  • 　　信號的邏輯電平經(jīng)歷了從單端信號到差分信號、從低速信號到高速信號的發(fā)展過程。最基本的單端信號邏輯電平為CMOS、TTL，在此基礎(chǔ)上隨著電壓擺幅的降低，出現(xiàn)LVCMOS、LVTTL等邏輯電平，隨著信號速率的提升又出現(xiàn)ECL、PECL、LVPECL、LVDS、CML等差分信號邏輯電平。 　　1.信號邏輯電平參數(shù)概念定義 　　邏輯電平是指數(shù)字信號電壓的高、低電平，相關(guān)參數(shù)定義如下： 　　(1)輸入高電平門限Vih：保證邏輯門的輸入為高電平時所允許的最小輸入高電平，當(dāng)輸入電平高于Vih時，則認(rèn)為輸入電平為
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兩種簡易的低成本雙向的邏輯電平轉(zhuǎn)化電路

  • 　　簡介：本文介紹了兩種雙向通信中電平標(biāo)準(zhǔn)不同時的電平轉(zhuǎn)換方法。 　　在電子電路設(shè)計中，可能需要這樣一種電路： 　　單片機輸出5V或3.3V信號，但在總線上的信號是12V或24V甚至更高的電壓。單片機I/O輸出的邏輯信號可以反應(yīng)到通訊總線上，而總線上的電平有變化時，也可以反應(yīng)到單片機的I/O口上，而且只用到單片機的一個I/O口，而不需要輸入輸出各占一個I/O，也不需要使用比較器。 　　對于雙向電平轉(zhuǎn)換電路，市場上也有一些成熟的芯片，如maxim 的max13042，但這些芯片只局限于標(biāo)準(zhǔn)的邏輯電平之
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應(yīng)用于智能手機的邏輯電平轉(zhuǎn)換方案

  • 近一兩年來，在蘋果公司iPhone手機的帶動下，智能手機市場迅速擴大。智能手機等便攜產(chǎn)品的一個重要特點是功能越...
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堅固的 38V、10A 降壓型 μModule 穩(wěn)壓器 具防故障負(fù)載保護功能

  • 凌力爾特公司(LinearTechnologyCorporation)推出4.5V至38V輸入、0.6V至6V輸出、10A降壓型微型模...
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MAX14569 雙對單向邏輯電平轉(zhuǎn)換器

  • MAX14569是專用的雙對單向邏輯電平轉(zhuǎn)換器是工業(yè)和儀表應(yīng)用的理想選擇。設(shè)置電壓VCC和VL任器件兩側(cè)的邏輯電平。邏輯高電平信號對設(shè)備的VL側(cè)目前出現(xiàn)的設(shè)備上，反之亦然VCC側(cè)高電壓邏輯信號。該器件具有兩對背到后端配
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混合邏輯電平的接口技術(shù)

低壓 CPLD EPM7512A的混合電壓系統(tǒng)設(shè)計

可用邏輯電平選擇極盡性的正、負(fù)峰值保持電路

  • 電路的功能如果希望保持輸入信號的正、負(fù)峰值，只要增加一個把二極管極性顛倒的電路，并進行切換即可。本電路是在輸出、輸入端配置了極性切換電路，對極性進行選擇。峰值保持電路必須設(shè)置“復(fù)位”電路，可通過模擬開
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TMS320LF2407A在混合電壓系統(tǒng)中的設(shè)計

  • 摘 要: 介紹了TMS320LF2407A在混合電壓系統(tǒng)中的設(shè)計。首先對TMS320LF2407A做了簡單的介紹,然后闡述了TMS320LF2407A的電源問題以及與5V器件接口時存在的邏輯電平不匹配問題,分析了產(chǎn)生這些問題的原因,并給出了相應(yīng)的解決方案。 關(guān)鍵詞: 邏輯電平  DSP控制器  電源  接口 　　隨著便攜式數(shù)字電子產(chǎn)品、數(shù)字式移動電話、手持式測試儀表等的迅速發(fā)展,要求使用體積小、功耗低、電池耗電小的器件,從而使得集成電路的工作電壓已經(jīng)從5V降到3
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幾種常用邏輯電平電路的特點及應(yīng)用

  • 　　引 言 　　在通用的電子器件設(shè)備中，TTL和CMOS電路的應(yīng)用非常廣泛。但是面對現(xiàn)在系統(tǒng)日益復(fù)雜，傳輸?shù)臄?shù)據(jù)量越來越大，實時性要求越來越高，傳輸距離越來越長的發(fā)展趨勢，掌握高速數(shù)據(jù)傳輸?shù)倪壿嬰娖街R和設(shè)計能力就顯得更加迫切了。 　　1 幾種常用高速邏輯電平 　　1.1LVDS電平 　　LVDS(Low Voltage Differential Signal)即低電壓差分信號，LVDS接口又稱RS644總線接口，是20世紀(jì)90年代才出現(xiàn)的一種數(shù)據(jù)傳輸和接口技術(shù)。 　　LVDS的典型工作原理如圖
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邏輯電平介紹

　邏輯電平的一些概念 　　要了解邏輯電平的內(nèi)容，首先要知道以下幾個概念的含義： 1：輸入高電平（Vih）：保證邏輯門的輸入為高電平時所允許的最小輸入高電平，當(dāng)輸入電平高于Vih時，則認(rèn)為輸入電平為高電平。 2：輸入低電平（Vil）：保證邏輯門的輸入為低電平時所允許的最大輸入低電平，當(dāng)輸入電平低于Vil時，則認(rèn)為輸入電平為低電平。 3：輸出高電平（Voh）：保證邏輯門的輸出為高電平時的輸出電平的最 [ 查看詳細(xì) ]

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