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EEPW首頁(yè) >> 主題列表 >> 邏輯切換優(yōu)化

功率與性能:DSP設(shè)計(jì)面臨的終極挑戰(zhàn)

  •   多年來(lái),數(shù)字信號(hào)處理器 (DSP) 設(shè)計(jì)人員一直在應(yīng)付這樣一項(xiàng)艱難的工作:提供占用空間小的高性能芯片,而且要不影響靈活性和軟件的可編程能力。   由于新的應(yīng)用程序發(fā)展速度驚人,提供的 DSP 必須在功率、性能和使用壽命上跟上這種速度,應(yīng)對(duì)當(dāng)前面臨的挑戰(zhàn),并準(zhǔn)備好應(yīng)對(duì)未來(lái)的應(yīng)用。這些高性能多核心 DSP被越來(lái)越多地應(yīng)用在電信接入、改進(jìn)數(shù)據(jù)率GSM服務(wù)(EDGE)和基礎(chǔ)設(shè)施設(shè)備領(lǐng)域,用來(lái)處理語(yǔ)音、視頻和無(wú)線電信號(hào)。   以前,電信設(shè)備制造商使用專用的 ASIC 或 DSP-ASIC 組合來(lái)達(dá)到自己的目
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邏輯切換優(yōu)化介紹

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